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Hack電子

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CMOS圖像傳感器中像素技術(shù)的進(jìn)化史

移動(dòng)設(shè)備及其日新月異的拍照功能已經(jīng)成為我們?nèi)粘I畹囊粋€(gè)重要組成部分。得益于越來越先進(jìn)的手持設(shè)備,人....
的頭像 Hack電子 發(fā)表于 06-10 10:11 ?2082次閱讀
CMOS圖像傳感器中像素技術(shù)的進(jìn)化史

Xilinx ZYNQ UltraScale+系列產(chǎn)品介紹

Zynq UltraScale+MPSoC是Xilinx推出的第二代多處理SoC系統(tǒng),它在第一代Z....
的頭像 Hack電子 發(fā)表于 06-09 10:07 ?5157次閱讀
Xilinx ZYNQ UltraScale+系列產(chǎn)品介紹

AMD MicroBlaze中通過AXI Timer獲取時(shí)間戳

硬件的Vivado Block design設(shè)計(jì)中,添加AXI Timer
的頭像 Hack電子 發(fā)表于 06-08 09:21 ?1607次閱讀

verilog整數(shù)四則運(yùn)算的位寬考量簡介

加、減 使用補(bǔ)碼時(shí),加減法可以統(tǒng)一,因而對加減不加區(qū)分,對有無符號也不加以區(qū)分。
的頭像 Hack電子 發(fā)表于 06-06 17:07 ?2427次閱讀
verilog整數(shù)四則運(yùn)算的位寬考量簡介

什么是SerDes?SerDes的應(yīng)用場景又是什么呢?

首先我們要了解什么是SerDes,SerDes的應(yīng)用場景又是什么呢?SerDes又有哪些常見的種類?
的頭像 Hack電子 發(fā)表于 06-06 17:03 ?14406次閱讀
什么是SerDes?SerDes的應(yīng)用場景又是什么呢?

LVDS、接口和時(shí)序講解

這種接口電路中,采用單路方式傳輸,每個(gè)基色信號采用6位數(shù)據(jù),共18位RGB數(shù)據(jù),因此,也稱18位或1....
的頭像 Hack電子 發(fā)表于 06-02 16:01 ?11683次閱讀
LVDS、接口和時(shí)序講解

跨時(shí)鐘域知識點(diǎn)梳理

隨著實(shí)習(xí)面試的臨近、秋招的逐步靠近,愈發(fā)覺得知識需要成系統(tǒng),讓它們串接起來。不然,太容易忘了。
的頭像 Hack電子 發(fā)表于 05-29 10:42 ?2364次閱讀
跨時(shí)鐘域知識點(diǎn)梳理

MicroByte:基于ESP32 DIY復(fù)古游戲機(jī)

MicroByte 是一款微型主機(jī),能夠運(yùn)行 NES、GameBoy、GameBoy Color、G....
的頭像 Hack電子 發(fā)表于 05-29 10:02 ?1885次閱讀
MicroByte:基于ESP32 DIY復(fù)古游戲機(jī)

Multi-scaler的裸機(jī)測試流程

Multi-Scaler是一個(gè)用于圖像縮放的視頻處理IP核,支持最多8路輸出,使用Memory接口,....
的頭像 Hack電子 發(fā)表于 05-19 14:08 ?2316次閱讀
Multi-scaler的裸機(jī)測試流程

單bit信號的跨時(shí)鐘域傳輸可以使用兩級同步但后果呢?

看的東西多了,發(fā)現(xiàn)有些并未領(lǐng)會到位。單bit信號的跨時(shí)鐘域傳輸,可以使用兩級同步,但后果呢?
的頭像 Hack電子 發(fā)表于 05-10 10:08 ?1724次閱讀
單bit信號的跨時(shí)鐘域傳輸可以使用兩級同步但后果呢?

如何使用verilog參數(shù)和generate語句來編寫可重用的verilog代碼?

與大多數(shù)編程語言一樣,我們應(yīng)該嘗試使盡可能多的代碼可重用。這使我們能夠減少未來項(xiàng)目的開發(fā)時(shí)間,因?yàn)槲?...
的頭像 Hack電子 發(fā)表于 05-08 16:59 ?2660次閱讀

簡談FPGA引腳信號分配的幾個(gè)原則

現(xiàn)在的FPGA正變得越來越復(fù)雜,向引腳分配信號的任務(wù)曾經(jīng)很簡單,現(xiàn)在也變得相當(dāng)繁復(fù)。下面這些用于向多....
的頭像 Hack電子 發(fā)表于 05-04 17:38 ?1716次閱讀

如何在verilog中使用If語句和case語句?

我們在上一篇文章中已經(jīng)看到了如何使用程序塊(例如 always 塊來編寫按順序執(zhí)行的 verilog....
的頭像 Hack電子 發(fā)表于 04-18 09:45 ?7134次閱讀

Verilog中循環(huán)語句簡介

在這篇文章中,我們討論了可以在verilog中使用的不同類型的循環(huán) - for循環(huán),while循環(huán),....
的頭像 Hack電子 發(fā)表于 04-15 09:19 ?4626次閱讀

Vivado中常用TCL命令匯總

Vivado是Xilinx推出的可編程邏輯設(shè)備(FPGA)軟件開發(fā)工具套件,提供了許多TCL命令來簡....
的頭像 Hack電子 發(fā)表于 04-13 10:20 ?5826次閱讀

AMBA總線協(xié)議概述

高級微控制器總線架構(gòu)(AMBA)是一種開放標(biāo)準(zhǔn)的片上互連方式。概述了如何連接和管理SoC中的不同組件....
的頭像 Hack電子 發(fā)表于 04-12 10:29 ?2324次閱讀

CIC插值濾波器與直接頻率合成器DDS的FPGA實(shí)現(xiàn)

CIC濾波器是無線通信中的常用模塊,一般用于數(shù)字下變頻(DDC)和數(shù)字上變頻(DUC)系統(tǒng)。隨著現(xiàn)代....
的頭像 Hack電子 發(fā)表于 04-12 10:26 ?2919次閱讀

時(shí)序約束--多時(shí)鐘

對于邏輯N而言,由clka產(chǎn)生數(shù)據(jù),clkc采樣數(shù)據(jù),在它們周期的最小公倍數(shù)內(nèi),最嚴(yán)格的時(shí)序是3ns....
的頭像 Hack電子 發(fā)表于 04-06 11:30 ?2172次閱讀

基于FPGA實(shí)現(xiàn)分離用軟件的圖像處理系統(tǒng)設(shè)計(jì)

灰度直方圖統(tǒng)計(jì)直方圖是圖像的灰度分布統(tǒng)計(jì)的一種表示方法,統(tǒng)計(jì)目標(biāo)圖像中各個(gè)灰度點(diǎn)的像素個(gè)數(shù),很多對于....
的頭像 Hack電子 發(fā)表于 04-04 10:32 ?2134次閱讀

GPT-4 驅(qū)動(dòng)的新Copilot編碼助手

在經(jīng)過一年的技術(shù)試驗(yàn)之后,Copilot 于去年夏季正式推出,能夠?yàn)槭褂?GitHub 及受支持文本....
的頭像 Hack電子 發(fā)表于 03-27 11:44 ?2101次閱讀

Vitis IDE Git集成快速入門指南

雖然“Platform”(平臺)、“System Project”(系統(tǒng)工程)和“Applicati....
的頭像 Hack電子 發(fā)表于 03-27 09:41 ?1307次閱讀

賽靈思的局部重配置技術(shù)(Partial Reconfiguration)

一般情況下,要重新配置一個(gè)FPGA需要使其處于復(fù)位狀態(tài),并通過外部控制器重新加載一個(gè)新設(shè)計(jì)到器件中。....
的頭像 Hack電子 發(fā)表于 03-17 14:03 ?3039次閱讀

基于FPGA的圖像處理

圖像處理的算法中,大部分需要采用浮點(diǎn)數(shù)運(yùn)算,而浮點(diǎn)數(shù)運(yùn)算再FPGA中是非常不劃算的,因此需要轉(zhuǎn)換成定....
的頭像 Hack電子 發(fā)表于 02-17 09:16 ?3620次閱讀

AXI VDMA IP 的高級用例

如果 STRIDE 等于 HSIZE,那么 AXI VDMA IP 會在沒有任何跳轉(zhuǎn)的情況下讀取幀緩....
的頭像 Hack電子 發(fā)表于 02-15 11:25 ?2266次閱讀

搜索引擎技術(shù)大戰(zhàn),始于昨日

“搜索引擎的技術(shù)大戰(zhàn),始于今日。我們會繼續(xù)前進(jìn)并加快步伐。更重要的是,我們希望能在搜索領(lǐng)域持續(xù)創(chuàng)新,....
的頭像 Hack電子 發(fā)表于 02-10 16:02 ?1718次閱讀

國產(chǎn)FPGA!哪些公司比較牛?

為了滿足經(jīng)濟(jì)發(fā)展和國防需求,打破美國的壟斷,中國政府多年來投入了數(shù)百億科研經(jīng)費(fèi),通過逆向工程方式仿制....
的頭像 Hack電子 發(fā)表于 02-03 17:24 ?7778次閱讀

實(shí)現(xiàn)高速收發(fā)器TX通道間相位對齊的方法

當(dāng)TX Buffer被使能時(shí),可以通過TXBUFSTATUS的Bit0(Half Full)的狀態(tài)和....
的頭像 Hack電子 發(fā)表于 02-02 10:00 ?3116次閱讀

平頭哥宣布:RISC-V成功運(yùn)行安卓12

美國、英國政府將限制處理器矽智財(cái)(IP)廠Arm在Neoverse V產(chǎn)品授權(quán)給中國廠商,由于Neo....
的頭像 Hack電子 發(fā)表于 12-16 11:14 ?1324次閱讀

為什么回跳機(jī)制不起作用了呢?FPGA怎么掛死了呢

Xapp1247, Appendix A提供了一個(gè)很好的解決方案。利用兩個(gè)timer或者稱之為bar....
的頭像 Hack電子 發(fā)表于 11-23 09:05 ?2705次閱讀

如何壓低芯片的功耗

既然要優(yōu)化功耗,我們先看看功耗是怎么造成的。現(xiàn)代大規(guī)模集成電路里面廣泛用的是CMOS, Comple....
的頭像 Hack電子 發(fā)表于 11-10 14:44 ?2771次閱讀
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