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用FPGA做流水燈

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LTC5588-1的基帶輸入可以單端的方式輸入嗎?具體該怎么?

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2025-04-15 06:10:52

國產(chǎn)FPGA往事

首先,這篇文章的后半部分,會有一個廣告:我去年和紫光同創(chuàng)原廠的技術(shù)專家寫了一本書——《國產(chǎn)FPGA權(quán)威開發(fā)指南》,我想送一些書給到熟悉的、曾經(jīng)熟悉的、或者還未熟悉的FPGA開發(fā)者同行,請各位開發(fā)者
2025-04-14 09:53:34645

FPGA開發(fā)板只需19.9元,配套十五期教學視頻和案例

、FPGA工程師......嗯嗯,FPGA工程師工資最高,就它了!*(圖源:網(wǎng)絡)2012年FPGA開發(fā)板的廠家不比現(xiàn)在少:紅芯電子、紅色颶風、黑金......非常非常多,可能很多品牌今天大家都沒有聽過,到
2025-04-14 09:52:511084

燈光太普通?快來試試這款多模式的七彩燈方案!

爆閃模式:紅、綠、藍、黃、青、粉、白七種顏色交替爆閃;七彩跑馬流水燈:在偶數(shù)燈流水模式下,偶數(shù)LED依次點亮,奇數(shù)LED熄滅。流水達到設定燈數(shù)后,切換顏色繼續(xù)顯示
2025-03-17 18:22:491176

求助,求分享STM32F429IAR的外部SPIFLASH下載算法例程

你好,請問可不可以提供一下STM32F429IAR的外部SPIFLASH(例如W25Q128)下載算法例程,現(xiàn)在我的下載算法是能下載到外部FLASH但是不能跳到main函數(shù),麻煩指教一下,謝謝!
2025-03-11 07:40:09

【瑞薩RA2L1入門學習】+LED流水燈實驗

基于 Arm? Cortex?-M23 核心(現(xiàn)今 Arm? Cortex-M 系列中功耗最低的 CPU)。 這款產(chǎn)品采用優(yōu)化的制程和瑞薩電子的低功耗工藝技術(shù),是業(yè)界一流水平的超低功耗微控制器。 RA2L1
2025-03-07 15:27:37

LM5116的電流源,LM5116輸出占空比受限怎么解決?

LM5116的電流源(最大可設置為2A),48V供電帶感性負載(該負載加30V電壓產(chǎn)生2A多電流)。當設置電流在1.5A以下時一切正常,但是超過1.5A時發(fā)現(xiàn)電流達不到目標值,示波器觀察
2025-03-06 08:03:53

軟件工程師學習硬件原理圖--第一講看懂GPIO和門電路

看,那寫個錘子的程序喲,還怎么分配管教,就像學單片機的童鞋一樣,單片機只知道寫流水燈,電路不會,那也頂個肺。有很多人就說,去看模電,數(shù)電,跟著做做就會了,然而書本上
2025-03-05 19:33:161065

對標AD9643,14位雙通道超低功耗250MSPS流水線型ADC-CM3432

概述CM3432是一款14位 、集成雙通道流水線型模數(shù)轉(zhuǎn)換器(ADC),采樣率最高達250MSPS,旨在為低成本、小尺寸、寬帶寬、多功能通信應用提供解決方案。CM3432內(nèi)核采用七級差分流水線結(jié)構(gòu)
2025-03-03 17:54:09

基于DLPA3000+DLPC3470設計,20%左右板子顯示有條紋怎么解決?

我們自己DLPA3000+DLPC3470設計了產(chǎn)品,FPGA輸出RGB888圖像到DLPC3470,RGB888信號串聯(lián)33R電阻。板子50套,發(fā)現(xiàn)有10套板子工作20~60分鐘后,出現(xiàn)豎
2025-02-25 08:30:48

APPSFPGA的vhdl源碼,fpga如何修改pgen送數(shù)據(jù)到數(shù)據(jù)總線然后復位?

有人在做 APPSFPGA的 vhdl 源碼嗎,我剛開始接觸 fpga 如何修改 pgen 送數(shù)據(jù) 到數(shù)據(jù)總線 然后 復位 ,有大佬可以指點一下嗎
2025-02-21 06:01:34

如果不用DLPC3479,直接單片機或者FPGA去驅(qū)動DLP4710,這樣可以實現(xiàn)嗎?

您好,我購買了貴公司的DLP4710EVM-LC,查看原理圖發(fā)現(xiàn)只有最上面板子的原理圖,底部的DMD所在板的原理圖可以提供下嗎,謝謝。另外,想請問,如果不用DLPC3479,直接單片機或者FPGA去驅(qū)動DLP4710,這樣可以實現(xiàn)嗎?如果可以的話,有沒有相關(guān)的例程可以提供,謝謝。
2025-02-20 07:18:20

DLP3310 EVM二次開發(fā),FPGA這部分是需要我們自己寫控制程序嗎?

您好: 我看到DLP3310 EVM的開發(fā)套件的方案中用到了FPGA,想問一下,FPGA在這個設計中具體做什么功能用?在DLP4710的設計中,為什么沒有用到FPGA? 另外,如果我們DLP3310 EVM二次開發(fā),FPGA這部分是需要我們自己寫控制程序嗎?
2025-02-19 07:48:41

使用自己的PCB板卡,發(fā)現(xiàn)DLP9500第一幀圖像故障,怎么解決?

使用自己的PCB板卡,發(fā)現(xiàn)DLP9500第一幀圖像故障(顯示不完全),于是把相同的代碼放到DLP410EVM官方評估板上,發(fā)現(xiàn)也會偶爾顯示不完全。FPGA工程的邏輯是,上電之后等待電源軌正常,512*5ns,之后開始顯示動作,我現(xiàn)在應該從哪里排查?
2025-02-19 07:11:10

DAC8043UC可編程增益控制(衰減)是否可行?

請問DAC8043UC可編程增益控制(衰減)是否可行?Vref腳作為電壓輸入,頻率固定1KHz,Vpp 在50nV至5V之間,DAC8043后面有放大電路,謝謝!
2025-02-14 06:08:53

USB控制SPI再控制ADS1248配置及讀值遇到的疑問求解

我目前的項目用到ADS1248數(shù)據(jù)采集,的是USB控制SPI再控制ADS1248配置及讀值,目前碰到的問題有2個 1.如果我用命令配置ADC芯片為使能內(nèi)部2.048V基準,轉(zhuǎn)換采用該基準并
2025-02-13 06:30:59

TVP5150做得視頻解碼芯片然后過FPGA處理,有黑線怎么處理?

我是TVP5150做得視頻解碼芯片,然后過FPGA處理(直接顯示的,沒有過RAM,開始以為是場沒有處理好,后來我只用奇場顯示,或只用偶場顯示效果是一樣的),一個320*240的LCD顯示出來
2025-02-12 08:43:15

FPGA配置TVP5150,把PAL制標準視頻轉(zhuǎn)換成BT656數(shù)據(jù)格式,能否把數(shù)據(jù)流直接給SAA7121?

FPGA配置TVP5150,把PAL制標準視頻轉(zhuǎn)換成BT656數(shù)據(jù)格式,請問能否把數(shù)據(jù)流直接給SAA7121這樣的編碼芯片,我這么的,但是出來的圖像是紅色的,是不是寄存器沒配置對?還是其他什么原因?
2025-02-11 07:14:40

A3P125-TQG144I是Microchip推出的一款FPGA(現(xiàn)場可編程門陣列)

是Microchip推出的一款FPGA(現(xiàn)場可編程門陣列),具有125K的邏輯門和350 MHz的工作頻率。這款FPGA采用TQFP-144封裝,支持寬廣的工作溫度范圍,從-40
2025-02-10 20:53:39

tvp7002在分量視頻采集的時候,相位寄存器配置是什么來參考?

tvp7002在分量視頻采集的時候,相位寄存器配置是什么來參考? 比如720P60、1080P60,相位是隨便配置還是需要計算才可以??? 在芯片里面是把相位分為了32個等級,通過5位來進行配置,每個等級是11.25度。
2025-02-08 06:29:45

FPGA控制ADS1248,DRDY一直為高是為什么?

FPGA控制ADS1248。 ads1248編程思路如下: FPGA產(chǎn)生時鐘給SCLK引腳,并且電路板上電后,一直給它時鐘;CLK雖和FPGA相連,但沒進行數(shù)據(jù)處理;TESET、START引腳
2025-02-05 08:20:55

fpga和cpu的區(qū)別 芯片是gpu還是CPU

一、FPGA與CPU的區(qū)別 FPGA(Field-Programmable Gate Array,現(xiàn)場可編程門陣列)和CPU(Central Processing Unit,中央處理器)是兩種不同類
2025-02-01 14:57:003321

MATLAB或者C語言開發(fā)FPGA有什么問題嗎

最近有個項目領(lǐng)導要求MATLAB開發(fā)FPGA,有大佬MATLAB或者C語言開發(fā)FPGA的嗎,有沒有什么問題,需要注意什么問題嗎
2025-01-26 09:57:47

ADS8363FPGA做了一個SPI接口控制器,示波器觀察SDO無信號輸出是怎么回事?

FPGA做了一個SPI接口控制器,示波器觀察,CS,convst/rd,SDI,BUSY,CLK到片腳信號正常,但SDO無信號輸出? 有誰知道SDI數(shù)據(jù)應在SPI CLK時鐘的上升沿改變還是下降沿改變,需要每次單通道采集一次數(shù)據(jù),應設置MODE幾方式較好?
2025-01-24 06:56:30

現(xiàn)代中端FPGA的主要亮點

FPGA 通常按照邏輯容量進行分類,這種方式固然簡單,但未能充分體現(xiàn)現(xiàn)代 FPGA 作為可更改的片上系統(tǒng)所能提供的豐富功能和資源。
2025-01-23 13:52:15959

【RA-Eco-RA2L1-48PIN-V1.0開發(fā)板試用】——點亮流水燈操作

燒錄板子,現(xiàn)在看到,LED1和LED2都常亮了?。?! (2)實現(xiàn)更復雜的流水燈效果 打開KEIL,在hal_entyr.c文件中定義好LED1和LED2 ON和OFF的宏 #define LED1
2025-01-23 09:57:53

CPLD 與 FPGA 的區(qū)別

在數(shù)字電路設計領(lǐng)域,CPLD和FPGA是兩種常用的可編程邏輯器件。它們都允許工程師根據(jù)需要設計和重新配置數(shù)字電路,但它們在結(jié)構(gòu)、性能和應用上存在顯著差異。 CPLD和FPGA的定義 CPLD
2025-01-23 09:46:362760

tlk10022的時鐘輸入是否可以3.3V的lvpecml電平交流耦合進去?

xilinx spartan6 的GTP輸出四路2.5Gbps信號是否可以使用tlk100224轉(zhuǎn)1轉(zhuǎn)換,FPGA輸出直接交流耦合到serdes輸入上是否可以?tlk10022的時鐘輸入是否可以3.3V的lvpecml電平交流耦合進去?
2025-01-23 08:24:36

FPGA加上DAC902DDS時候,出現(xiàn)DAC902的時鐘串擾進我輸出的波形中的問題怎么解決?

FPGA加上DAC902DDS時候,,經(jīng)常出現(xiàn)DAC902的時鐘串擾進我輸出的波形中的問題。我DAC902的時鐘給的100M,我對DDS的輸出波形進行FFT后,一直都可以看到100M的諧波分量,導致我輸出波形抖動。。。求TI大師指導好,好人一生平安。
2025-01-22 06:39:31

ADS8361 fpga如何實現(xiàn)

ADS8361項目中用到ADS8361,Verilog或者vhdl語言怎么實現(xiàn)對ad的讀寫?? ADS8361的誤差有多少?我FPGA寫的誤差有30mv,什么原因?求賜教
2025-01-20 06:15:49

#中國香河英茂科工#STC32G12K128#屠龍刀三.2 流水燈例程

流水燈
丙丁先生發(fā)布于 2025-01-19 14:19:35

xilinx FPGA IOB約束使用以及注意事項

采用了IOB約束,那么就可以保證從IO到達寄存器或者從寄存器到達IO之間的走線延遲最短,同時由于IO的位置是固定的,即存在于IO附近,所以每一次編譯都不會造成輸入或者輸出的時序發(fā)生改變。 二、為什么要使用IOB約束 考慮一個場景,當你FPGA寫了一個spi模塊,將時鐘、片選和數(shù)據(jù)線綁定到F
2025-01-16 11:02:011655

想用AMC1203電流采樣,AMC1210SINC濾波,不知道這樣可不可行?

想用AMC1203電流采樣,AMC1210SINC濾波,不知道這樣可不可行? 網(wǎng)上有帖子說AMC1210有問題,你們不推薦采用AMC1210SINC濾波,而是推薦采用CPLDSINC濾波,不知道是不是真的?
2025-01-14 07:22:02

可以ADS1292采集到數(shù)據(jù),但是信號處理怎么?

現(xiàn)在可以ADS1292采集到數(shù)據(jù),但是信號處理怎么?我的是MSP430F149單片機,但是軟件濾波感覺難度很大,可不可以用上位機濾波?
2025-01-10 07:33:37

ADS1292R心電檢測,信號剛接人體的時候干擾很大怎么解決?

目前在用ADS1292R心電檢測,信號剛接人體的時候干擾很大,之前咨詢過建議加右腿驅(qū)動,不能加右腿驅(qū)動的話可以10M的電阻將共模電壓加到電極上,請問這個10M的電阻怎么加呢?謝謝。
2025-01-09 07:01:20

工業(yè)二維碼條碼掃描器流水線條碼掃描

在工業(yè)生產(chǎn)的廣闊舞臺上,工業(yè)二維碼條碼掃描器以其卓越的耐用性和高效的掃描能力,成為了連接自動化生產(chǎn)與信息管理不可或缺的橋梁。它們不僅是工廠流水線上的“慧眼”,更是提升生產(chǎn)效率、保障產(chǎn)品質(zhì)量的得力助手
2025-01-07 16:07:33944

想用TFP401用來HDMI轉(zhuǎn)換RGB給投影光機頭,是否可行?

急啊,想用TFP401用來HDMI轉(zhuǎn)換RGB給投影光機頭,但是我們的光機頭RGB輸入只支持DE模式,也就是沒有行場頻信號的那種接口,問下這顆IC是否能支持沒有HSYNC和VSYNC同步的格式輸出?
2025-01-07 08:32:01

FPGA在AI方面有哪些應用

隨著人工智能技術(shù)的飛速發(fā)展,對計算性能的需求也日益增長。FPGA(現(xiàn)場可編程門陣列)作為一種高性能、低功耗、可靈活編程的硬件平臺,正逐漸在 AI 領(lǐng)域嶄露頭角,展現(xiàn)出獨特的優(yōu)勢,為 AI 應用的落地
2025-01-06 17:37:102317

FPGA控制ADS1256,讀回來的數(shù)據(jù)不對,跳動很大怎么解決?

FPGA控制ADS1256,讀回來的數(shù)據(jù)不對,跳動很大。我ChipScope抓取信號發(fā)現(xiàn)在我寫讀命令時,一個字節(jié)的命令未寫完drdy信號就會變高,后來我直接不管drdy信號是不是為低依舊寫讀命令,發(fā)現(xiàn)依舊可以讀回數(shù)據(jù),請高手解答一下
2025-01-06 08:05:24

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