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      電子發(fā)燒友網(wǎng)>電子資料下載>IC datasheet pdf>SN74ALVCH16525,pdf(18-BIT REGI

      SN74ALVCH16525,pdf(18-BIT REGI

      2010-07-21 | rar | 343 | 次下載 | 2積分

      資料介紹

      This 18-bit universal bus transceiver is designed for 1.65-V to 3.6-V VCC operation.

      Data flow in each direction is controlled by output-enable (OEAB\ and OEBA\) and clock-enable (CLKENAB\ and CLKENBA\) inputs. For the A-to-B data flow, the data flows through a single register. The B-to-A data can flow through a four-stage pipeline register path, or through a single register path, depending on the state of the select (SEL\) input.

      Data is stored in the internal registers on the low-to-high transition of the clock (CLK) input, provided that the appropriate CLKEN\ inputs are low. The A-to-B data transfer is synchronized to the CLKAB input, and B-to-A data transfer is synchronized with the CLK1BA and CLK2BA inputs.

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