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CPLD_FPGA高級(jí)應(yīng)用開關(guān)指南的主要內(nèi)容:
第1章 可編程邏輯器件與EDA技術(shù)
第2章 XilinxCPLD系列產(chǎn)品
第3章 XilinxFPGA系列產(chǎn)品
第4章 XilinxISE應(yīng)用基礎(chǔ)
第5章 FPGA高級(jí)設(shè)計(jì)技巧(一)——ISE高級(jí)工具
第6章 FPGA高級(jí)設(shè)計(jì)技巧(二)——約束與配置
第7章 FPGA高級(jí)設(shè)計(jì)技巧(三)——時(shí)鐘與RAM
第8章 FPGA設(shè)計(jì)仿真驗(yàn)證——ModeISim
第9章 基于Synplify的FPGA綜合設(shè)計(jì)
第10章 嵌入PowerPC的平臺(tái)FPGA軟硬件設(shè)計(jì)
第11章 Xilinx FPGA在數(shù)字信號(hào)處理領(lǐng)域的應(yīng)用
第12章 軟件使用基礎(chǔ)
附錄A IC和FPGA設(shè)計(jì)信手表必讀
附錄B Verilog HDL與VHDL的比較
附錄C Virtex-Ⅱ和Spartan-ⅡE的管腳
附錄D 實(shí)驗(yàn)指導(dǎo)
附錄E IC和FPGA專業(yè)術(shù)語(yǔ)的中英文對(duì)照
附錄F Xilinx FPGA支持的IP列表
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