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高分辨率、逐次逼近型 ADC 的整體精度取決于精度、穩(wěn)定性和其基準(zhǔn)電壓源的驅(qū)動能力。ADC 基準(zhǔn)電壓輸入端的開關(guān)電容具有動態(tài)負(fù)載，因此基準(zhǔn)電壓源電路必須能夠處理與時間和吞吐速率相關(guān)的電流。某些 ADC 片上集成基準(zhǔn)電壓源和基準(zhǔn)電壓源緩沖器，但這類器件在功耗或性能方面可能并非最佳——通常使用外部基準(zhǔn)電壓源電路才可達(dá)到最佳性能。本文探討基準(zhǔn)電壓源電路設(shè)計(jì)中遇到的挑戰(zhàn)和要求。
基準(zhǔn)電壓輸入
逐次逼近型 ADC 的簡化原理圖見圖 1。采樣間隔期間，容性 DAC 連接至 ADC 輸入，并且與輸入電壓成比例的電荷被存儲在電容器中。轉(zhuǎn)換開始后，DAC 從輸入端斷開。轉(zhuǎn)換算法逐個開關(guān)每一位至基準(zhǔn)電壓或地。電容上的電荷再分配可導(dǎo)致電流流入或流出基準(zhǔn)電壓源。動態(tài)電流負(fù)載是 ADC 吞吐速率和控制位檢驗(yàn)的內(nèi)部時鐘的函數(shù)。最高有效位（MSB）保持大部分的電荷，需要大部分電流。
電容器
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