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這篇文章的類似版本出現(xiàn)在這篇文章的類似版本出現(xiàn)在上，2012 年 10 月 4 日。上，2012 年 10 月 4 日。介紹介紹高性能音頻數(shù)模轉(zhuǎn)換器 (DAC) 傳統(tǒng)上需要非常干凈的采樣主時鐘 (MCLK) 以避免音頻質(zhì)量下降。時鐘源通常直接來自晶體振蕩器，通常產(chǎn)生小于 100ps 的抖動。在某些系統(tǒng)中，音頻過采樣頻率（通常是 3.072MHz 或 2.8224MHz 的倍數(shù)）不是晶體振蕩器參考頻率的方便分?jǐn)?shù)。盡管這些系統(tǒng)可以實現(xiàn)小數(shù) N 分頻器 PLL 以創(chuàng)建所需的音頻 MCLK 頻率，但此類基于 PLL 的頻率參考通常具有多個參考頻率雜散和大量低頻抖動。此外，這些基于 PLL 的頻率參考通常無法在不超過所需的引腳數(shù)、面積、或功耗目標(biāo)。然而，這個困境是有解決辦法的。可以容忍高抖動的音頻 DAC 允許在此類系統(tǒng)中使用更簡單的采樣時鐘參考。高性能音頻數(shù)模轉(zhuǎn)換器 (DAC) 傳統(tǒng)上需要非常干凈的采樣主時鐘 (MCLK) 以避免音頻質(zhì)量下降。
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