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74ALVCH16821 有兩個 10 位邊沿觸發(fā)寄存器，每個寄存器都耦合到 3 態(tài)輸出緩沖器。每個寄存器的兩個部分由時鐘獨立控制 （nCP） 和輸出使能 nOE 控制門。 每個寄存器都是完全邊沿觸發(fā)的。每個 nDn 輸入的狀態(tài)，在 低電平到高電平時鐘轉(zhuǎn)換，被傳送到相應(yīng)的觸發(fā)器的nQn輸出。 當(dāng)nOE為低電平時，寄存器中的數(shù)據(jù)出現(xiàn)在輸出端。當(dāng) nOE 為高電平時，輸出 處于高阻抗 OFF 狀態(tài)。nOE 輸入的操作不會影響 人字拖。 74ALVCH16821 具有有源總線保持電路，用于保持未使用或浮動 有效邏輯級別的數(shù)據(jù)輸入。此功能消除了對外部上拉或下拉的需要 電阻。
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