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隨著集成電路的發(fā)展，現(xiàn)代CPU芯片集成度越來越高，性能飛速發(fā)展，伴隨而來的是居高不下的功耗和散熱成本，單位面積的功耗太高已成為了CPU性能突破的瓶頸。如何降低CPU芯片的功耗，成為了當前研究的重點。
CPU 低功耗技術(shù)很多，譬如時鐘門控技術(shù)（Clock gating ），電源門控技術(shù)（Power gating ）和動態(tài)電壓頻率調(diào)節(jié)技術(shù)（DVFS） 等。其中Clock gating 技術(shù)通過在電路中增加額外的邏輯單元、優(yōu)化時鐘樹結(jié)構(gòu)來節(jié)省能量。Power gating 技術(shù)通過關掉當前電路中空閑的模塊，從而節(jié)省能量凹。DVFS 技術(shù)通過動態(tài)調(diào)節(jié)當前芯片的電壓和頻率來節(jié)省能量。這3種方法在CPU 中都有廣泛的應用。
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