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本文介紹了神經網絡VLSI硬件實現的基本情況和VerilgHDL硬件設計方法的概念，在此基礎上利用FPGA設計出了Kohonen競爭網絡硬件電路，其工作頻率為33Mhz，并對其工作過程進行了較詳細的分析，給出了綜合仿真的測試結果。
關鍵詞：神經網絡硬件實現 Kohonen競爭網絡算法 VerilgHDL FPGA
Abstract: This paper introduces the basic complexion of neural network VLSI hardware realization and the concept of VerilgHDL hardware’s design. Based on that, it designs Kohonen competitive network hardware circuit by utilizing FPGA, which working frequency is 33Mhz. Then in this paper detailedly analyses its working process, and provides the testing result of integrated simulation.
Keywords: neural network hardware realization; Kohonen competitive network arithmetic; VerilgHDL; FPGA
關鍵詞：神經網絡硬件實現 Kohonen競爭網絡算法 VerilgHDL FPGA
Abstract: This paper introduces the basic complexion of neural network VLSI hardware realization and the concept of VerilgHDL hardware’s design. Based on that, it designs Kohonen competitive network hardware circuit by utilizing FPGA, which working frequency is 33Mhz. Then in this paper detailedly analyses its working process, and provides the testing result of integrated simulation.
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