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吉比特網(wǎng)絡(luò)下,網(wǎng)絡(luò)終端CPU處理TCP/IP協(xié)議的能力已經(jīng)成為網(wǎng)絡(luò)應(yīng)用的瓶頸。為了使終端用戶能充分利用廣闊的帶寬資源,該文提出了一種硬件實(shí)現(xiàn)方法,將原來(lái)由軟件完成的IP層協(xié)議功能完全卸載出來(lái),并通過DMA（直接存儲(chǔ)器訪問）接口直接進(jìn)行主存讀寫,從而減少了CPU的負(fù)荷。并且基于FPGA設(shè)計(jì)流程，通過功能仿真、綜合后仿真、布局布線后仿真驗(yàn)證了協(xié)議處理器的可行性。該處理器具有靈活的電路接口,所用邏輯資源少,管腳數(shù)量少,成本低易于集成,是一種高效的解決方案。
網(wǎng)絡(luò)層
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