華強(qiáng)pcb線路板打樣X(jué)ilinx開(kāi)發(fā)FPGA之間的高速鏈路介紹
SAN JOSE - Xilinx公司正在通過(guò)提供一種技術(shù)使其基于Web的開(kāi)發(fā)工具套件得到支持，該技術(shù)使系統(tǒng)設(shè)計(jì)人員能夠在其最先進(jìn)的FPGA之間即時(shí)創(chuàng)建高速接口。
稱(chēng)為SelectLink，該工具自動(dòng)生成定制用于芯片間數(shù)據(jù)通道的Verilog源代碼和測(cè)試平臺(tái)，支持多個(gè)引腳上每秒高達(dá)80千兆位的聚合帶寬。
SelectLink借鑒了Xilinx的Spartan-II，Virtex和Virtex E系列的標(biāo)準(zhǔn)功能，例如延遲鎖定環(huán)（DLL），Block RAM以及可編程SelectI/O和SelectI/O +技術(shù)。 Xilinx表示，SelectLink技術(shù)可用于創(chuàng)建一個(gè)系統(tǒng)，每個(gè)引腳的吞吐量超過(guò)每秒311兆比特，總線寬度可達(dá)256個(gè)引腳。
SelectLink技術(shù)由兩個(gè)主要模塊組成。發(fā)送器模塊創(chuàng)建數(shù)據(jù)寬度轉(zhuǎn)換FIFO，其具有不同寬度的讀寫(xiě)總線。據(jù)該公司稱(chēng)，這提供了一種將數(shù)據(jù)從內(nèi)部總線匯集到更窄的外部總線的有效方法。
接收器模塊反轉(zhuǎn)發(fā)射器模塊執(zhí)行的漏斗和數(shù)據(jù)速率轉(zhuǎn)換，并執(zhí)行必要的數(shù)據(jù)移位，使其與信號(hào)時(shí)鐘對(duì)齊。
可從www.xilinx.com/applications/slcv/selectlink.htm
訪問(wèn)SelectLink技術(shù)工具。
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華強(qiáng)pcb線路板打樣
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