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Vitis AI平臺(tái)的介紹

FPGA之家 ? 來(lái)源:FPGA之家 ? 作者:FPGA之家 ? 2020-10-21 09:40 ? 次閱讀
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Vitis AI:從邊緣到云的最佳人工智能推斷

Vitis AI 開(kāi)發(fā)環(huán)境是 Xilinx 的開(kāi)發(fā)平臺(tái),適用于在 Xilinx 硬件平臺(tái)(包括邊緣器件和 Alveo 卡)上進(jìn)行人工智能推斷。它由優(yōu)化的 IP、工具、庫(kù)、模型和示例設(shè)計(jì)組成。Vitis AI 以高效易用為設(shè)計(jì)理念,可在 Xilinx FPGAACAP 上充分發(fā)揮人工智能加速的潛力。

全新 1.2 版本新增了以下功能:

Vitis AI 量化器和 DNNDK 運(yùn)行時(shí)開(kāi)源

AI Model Zoo 中添加了 14 個(gè)新參考模型(Pytorch, Caffe, Tensorflow

Vitis AI 量化器支持優(yōu)化的模型(剪枝)

更新了 DPU 命名規(guī)則,以在所有配置中保持一致

推出面向邊緣和云的 Vitis AI Profiler

ONNXRuntime 和 TVM 支持 Vitis AI

新增了對(duì) Alveo U50/U50LV 和 U280 的支持

Alveo U50/U50LV DPU DPUCAHX8H 微架構(gòu)改進(jìn)

升級(jí) DPU TRD,以支持 Vitis 2020.1 和 Vivado 2020.1

Vitis AI 支持 Pytorch CNN 通用訪問(wèn)(測(cè)試版)

Vitis AI 平臺(tái)的介紹

◆◆AI 優(yōu)化器◆◆

有了世界領(lǐng)先的模型壓縮技術(shù),我們可以在對(duì)精度影響極小的情況下,將模型的復(fù)雜性降低 5 至 50 倍。深度壓縮可將您的 AI 推斷性能提升到一個(gè)新的層次。

◆◆AI 量化器◆◆

通過(guò)將 32 位浮點(diǎn)權(quán)值和激活量轉(zhuǎn)換為 INT8 這樣的定點(diǎn),AI 量化器可在不影響預(yù)測(cè)精度的情況下,降低計(jì)算復(fù)雜度。定點(diǎn)網(wǎng)絡(luò)模型需要的內(nèi)存帶寬更少,因此比浮點(diǎn)網(wǎng)絡(luò)模型速度更快,電源效率更高。

◆◆AI 編譯器◆◆

將 AI 模型映射至高效指令集及數(shù)據(jù)流。還可執(zhí)行高級(jí)優(yōu)化任務(wù),如層融合和指令排程等,并可盡量重復(fù)使用片上內(nèi)存。

◆◆AI 配置器◆◆

性能分析器有助于程序員深入分析 AI 推斷實(shí)現(xiàn)方案的效率和利用率。

◆◆AI 庫(kù)◆◆

該運(yùn)行時(shí)提供一系列輕量級(jí) C++Python API,其可實(shí)現(xiàn)便捷的應(yīng)用開(kāi)發(fā)。此外,它還提供高效的任務(wù)調(diào)度、內(nèi)存管理和中斷處理。

責(zé)任編輯:lq

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原文標(biāo)題:速來(lái),Xilinx Vitis AI 1.2 開(kāi)放下載了!

文章出處:【微信號(hào):zhuyandz,微信公眾號(hào):FPGA之家】歡迎添加關(guān)注!文章轉(zhuǎn)載請(qǐng)注明出處。

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    使用AMD <b class='flag-5'>Vitis</b> Unified IDE創(chuàng)建HLS組件

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    的頭像 發(fā)表于 06-13 09:50 ?2309次閱讀
    如何使用AMD <b class='flag-5'>Vitis</b> HLS創(chuàng)建HLS IP

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