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MAX9205/MAX9207 10位、總線LVDS串行器技術(shù)手冊(cè)

要長(zhǎng)高 ? 2025-05-29 09:23 ? 次閱讀
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概述
MAX9205/MAX9207串行器將10位寬度并行LVCMOS/LVTTL數(shù)據(jù)轉(zhuǎn)換為串行高速總線LVDS數(shù)據(jù)流。串行器與解串器配對(duì)使用,如MAX9206/MAX9208解串器,完成將串行輸出再轉(zhuǎn)換為10位寬度的并行數(shù)據(jù)。

MAX9205/MAX9207在PCB線或雙絞線上,傳輸串行數(shù)據(jù)的速度分別高達(dá)400Mbps和660Mbps。因?yàn)?a href="http://m.sdkjxy.cn/tags/時(shí)鐘/" target="_blank">時(shí)鐘是從串行數(shù)據(jù)流中提取,所以消除了在并行總線上出現(xiàn)的時(shí)鐘至數(shù)據(jù)和數(shù)據(jù)至數(shù)據(jù)扭曲。

該串行器不需要外接元件,也僅需少量的控制信號(hào)。由TCLK_R/F選擇輸入數(shù)據(jù)選通邊沿,當(dāng)器件停止工作時(shí),/PWRDN可用于省電控制。一旦上電,將激活同步模式,它還受控于兩個(gè)同步輸入端:SYNC1和SYNC2。

MAX9205可以鎖定16MHz至40MHz系統(tǒng)時(shí)鐘,而MAX9207可以鎖定40MHz至66MHz的系統(tǒng)時(shí)鐘。在器件完全鎖定本地系統(tǒng)時(shí)鐘之前,以及器件處于電源關(guān)斷模式下,串行器輸出保持高阻態(tài)。

兩種器件均工作于+3.3V單電源,指定工作溫度范圍-40°C至+85°C,提供28引腳SSOP封裝。
數(shù)據(jù)表:*附件:MAX9205 MAX9207 10位、總線LVDS串行器技術(shù)手冊(cè).pdf

應(yīng)用

  • 上/下路復(fù)用器
  • 背板與互連應(yīng)用
  • 蜂窩電話基站
  • 數(shù)字交叉連接
  • DSLAM
  • 網(wǎng)絡(luò)路由器和交換機(jī)

特性

  • 單片串行器(對(duì)比SerDes),尤其適合于單向數(shù)據(jù)鏈路
  • 用于解串器的同步成幀位允許板卡熱插入,無須中止系統(tǒng)運(yùn)行
  • 額定速率的LVDS串行輸出,適合于點(diǎn)對(duì)點(diǎn)和總線應(yīng)用
  • 寬參考時(shí)鐘輸入范圍
    • 16MHz至40MHz (MAX9205)
    • 40MHz至66MHz (MAX9207)
  • 140ps (峰峰值)的低系統(tǒng)抖動(dòng)(MAX9207)
  • 34mA的低電源電流(MAX9205)
  • 10位并行LVCMOS/LVTTL接口
  • 高達(dá)660Mbps的有效數(shù)據(jù)速率(MAX9207)
  • 編程的輸入鎖存邊沿
  • 與DS92LV1021和DS92LV1023引腳兼容的升級(jí)器件

典型應(yīng)用電路
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DC電氣特性
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引腳配置描述
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應(yīng)用信息

電源去耦

使用高頻表面貼裝陶瓷電容(0.1μF 和 0.001μF 并聯(lián))對(duì)AVCC進(jìn)行去耦,盡可能靠近器件安裝,較小容值的電容靠近AVCC。使用高頻表面貼裝陶瓷電容(0.1μF 和 0.001μF 并聯(lián))對(duì)DVCC進(jìn)行去耦,盡可能靠近器件安裝,較小容值的電容靠近DVCC。

差分走線與端接

匹配MAX9205/MAX9207的輸出走線特性。使用受控阻抗介質(zhì),并在傳輸線兩端對(duì)介質(zhì)的特性阻抗進(jìn)行端接。在點(diǎn)對(duì)點(diǎn)鏈路的接收端,通常使用單個(gè)電阻進(jìn)行端接,可提供可接受的性能。不過,MAX9205/MAX9207的輸出電平是為雙端接的點(diǎn)對(duì)點(diǎn)和多點(diǎn)應(yīng)用而專門設(shè)定的。采用單個(gè)100Ω 端接時(shí),輸出擺幅會(huì)更大。

避免使用非平衡電纜,如帶狀電纜或簡(jiǎn)單同軸電纜。像雙絞線這樣的平衡電纜能提供更優(yōu)的信號(hào)質(zhì)量,且由于抵消效應(yīng),產(chǎn)生的電磁干擾(EMI)較少。平衡電纜易拾取共模噪聲,而這種噪聲會(huì)被差分接收器抑制。

通過緊密并行布置差分走線來消除反射,并確保噪聲以共模形式耦合。通過匹配走線的電氣長(zhǎng)度來減少偏斜。過度的偏斜會(huì)導(dǎo)致磁抵消效果下降。

差分輸出信號(hào)的布線應(yīng)使每路輸出與其外部返回路徑靠近,以保持差分間的距離恒定。避免差分走線出現(xiàn)不連續(xù)情況。避免90°轉(zhuǎn)彎,并盡量減少過孔數(shù)量,以進(jìn)一步防止阻抗不連續(xù)。
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聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場(chǎng)。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請(qǐng)聯(lián)系本站處理。 舉報(bào)投訴
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