在千兆以太網(wǎng)硬件設(shè)計(jì)中，PCB的層疊結(jié)構(gòu)和差分阻抗控制是保證信號(hào)完整性的基礎(chǔ)。許多工程師依賴PCB廠家默認(rèn)的層疊，導(dǎo)致阻抗失控、回波損耗超標(biāo)。本文從工程實(shí)戰(zhàn)出發(fā)，詳解4層/6層板的層疊方案、差分阻抗計(jì)算方法、線寬線距設(shè)計(jì)、阻抗測(cè)試及常見(jiàn)誤區(qū)，幫助工程師實(shí)現(xiàn)精準(zhǔn)阻抗控制。

一、層疊結(jié)構(gòu)設(shè)計(jì)原則

千兆以太網(wǎng)信號(hào)（125MHz基頻，500MHz三次諧波）對(duì)阻抗連續(xù)性要求高。層疊設(shè)計(jì)需保證：

差分走線有連續(xù)的參考地平面（相鄰層）。

電源平面與地平面緊耦合（減小電源噪聲）。

信號(hào)層與參考層距離盡量小，以減少串?dāng)_和輻射。

常見(jiàn)層疊方案：

4層板（常用）：TOP（信號(hào)） – GND – POWER – BOTTOM（信號(hào)）。差分線可走在TOP層（微帶線）或BOTTOM層，參考相鄰的GND/POWER層。缺點(diǎn)：POWER層作為參考平面時(shí)，阻抗計(jì)算需考慮電源層噪聲，建議在信號(hào)層旁直接放置地平面。

6層板（高密度）：TOP（信號(hào)） – GND – 內(nèi)層信號(hào) – POWER – GND – BOTTOM（信號(hào)）。可提供多層信號(hào)走線，且每個(gè)信號(hào)層都有完整地參考。

推薦： 對(duì)于千兆以太網(wǎng)，優(yōu)先選用4層板，TOP層走千兆差分線，參考第二層GND。如果空間緊張，可用6層板將PHY與變壓器之間的走線放在內(nèi)層以減少輻射。

二、差分阻抗計(jì)算與線寬線距設(shè)計(jì)

千兆以太網(wǎng)差分對(duì)要求100Ω差分阻抗，±10%公差。根據(jù)層疊結(jié)構(gòu)，需要計(jì)算微帶線（表層）或帶狀線（內(nèi)層）的差分線寬/線距。

1. 微帶線（表層）差分阻抗公式（近似）

Zo_diff ≈ 2 × Zo_single × (1 - 0.48 × e^(-1.35×S/H))

其中Zo_single為單端阻抗，S為差分線間距，H為走線到參考層的距離。實(shí)際使用阻抗計(jì)算工具（如Polar Si9000）更準(zhǔn)確。常用FR4板材（εr≈4.2~4.5），1oz銅厚，參考層距離H=5mil時(shí)，線寬/線距一般在6mil/6mil左右。

三、板材與銅箔選擇

FR4標(biāo)準(zhǔn)板材： 適用于大多數(shù)工業(yè)/消費(fèi)產(chǎn)品，介電常數(shù)εr約4.2~4.5，損耗正切Df≈0.02。對(duì)于千兆以太網(wǎng)，普通FR4足夠，若走線較長(zhǎng)（>50mm）可考慮中低損耗材料（Df<0.01）。

銅箔厚度： 1oz（35μm）是標(biāo)準(zhǔn)，大電流電源走線可用2oz。但厚銅會(huì)增加側(cè)蝕，影響精細(xì)線寬，阻抗控制難度大。高速信號(hào)建議1oz。

表面處理： HASL（噴錫）可能引起表面不平整，影響阻抗。高頻應(yīng)用推薦OSP或ENIG（沉金）。

四、阻抗測(cè)試與驗(yàn)收標(biāo)準(zhǔn)

投板前必須明確要求板廠進(jìn)行阻抗測(cè)試。驗(yàn)收標(biāo)準(zhǔn)：

差分阻抗100Ω ±10%（即90Ω~110Ω）。

板廠需提供阻抗測(cè)試條（coupon），與PCB同批次、同層疊生產(chǎn)，測(cè)試TDR曲線。

設(shè)計(jì)值應(yīng)設(shè)置在100Ω，允許板廠根據(jù)產(chǎn)線能力微調(diào)線寬（±0.5mil）。

常見(jiàn)阻抗偏差原因：板廠層疊厚度變化、介電常數(shù)批次差異、蝕刻側(cè)蝕。最好要求板廠在實(shí)際生產(chǎn)前提供阻抗測(cè)試報(bào)告。

五、設(shè)計(jì)實(shí)例：4層板千兆交換機(jī)阻抗設(shè)計(jì)

層疊： TOP（1oz銅） – 0.12mm PP – L2 GND（1oz） – 1.1mm FR4芯板 – L3 POWER（1oz） – 0.12mm PP – BOTTOM（1oz）。總板厚1.6mm。參考層到TOP距離H=0.12mm（4.7mil）。用Polar Si9000計(jì)算：線寬W=6mil，線距S=6mil，得到單端阻抗約57Ω，差分約101Ω。板廠實(shí)際生產(chǎn)時(shí)微調(diào)線寬至5.8mil，最終TDR測(cè)試差分阻抗98~102Ω，合格。

六、常見(jiàn)誤區(qū)與優(yōu)化技巧

誤區(qū)1： 認(rèn)為表層差分線比內(nèi)層好走線，但表層微帶線易輻射，內(nèi)層帶狀線抗干擾強(qiáng)但過(guò)孔多。對(duì)于敏感信號(hào)（如時(shí)鐘），可考慮內(nèi)層走線。

誤區(qū)2： 阻抗計(jì)算時(shí)忽略阻焊油墨的影響。綠油εr≈3.5，會(huì)使表層微帶線阻抗降低約2~5Ω。設(shè)計(jì)時(shí)可適當(dāng)增大線寬或要求板廠補(bǔ)償。

誤區(qū)3： 不同信號(hào)層參考不同的電源層，導(dǎo)致阻抗不連續(xù)。推薦所有差分線參考完整地平面，避免跨分割。

技巧： 在高速信號(hào)下方放置“地條”或包地過(guò)孔，可降低串?dāng)_。差分對(duì)周圍等間距放置接地過(guò)孔，間距<λ/10。

設(shè)計(jì)檢查清單：
□ 層疊結(jié)構(gòu)是否提供連續(xù)的參考地平面？
□ 是否使用Polar等工具計(jì)算線寬/線距，并預(yù)留了公差？
□ 是否與板廠確認(rèn)了層疊材質(zhì)和介電常數(shù)？
□ 是否要求板廠提供阻抗測(cè)試條（coupon）文件？
□ 是否考慮了阻焊油墨對(duì)阻抗的影響？
□ 差分線下方是否挖空變壓器等特殊區(qū)域？

總結(jié)： 千兆以太網(wǎng)的PCB層疊設(shè)計(jì)與阻抗控制是信號(hào)完整性的基石。通過(guò)合理的層疊結(jié)構(gòu)、精確的阻抗計(jì)算、與板廠的充分溝通以及嚴(yán)格的驗(yàn)收測(cè)試，可以有效保證100Ω差分阻抗的穩(wěn)定性，從而確保產(chǎn)品通過(guò)眼圖、回波損耗等一致性測(cè)試。設(shè)計(jì)初期就應(yīng)規(guī)劃好阻抗控制策略，避免后期需要修改PCB而浪費(fèi)成本。

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審核編輯 黃宇