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ICS9LPRS525:英特爾系統(tǒng)的高性能時鐘解決方案

璟琰乀 ? 2026-04-30 16:55 ? 次閱讀
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ICS9LPRS525:英特爾系統(tǒng)的高性能時鐘解決方案

在電子設(shè)計(jì)領(lǐng)域,時鐘信號的穩(wěn)定性和準(zhǔn)確性對于系統(tǒng)的正常運(yùn)行至關(guān)重要。今天,我們要介紹的是Renesas的ICS9LPRS525,一款專為英特爾系統(tǒng)設(shè)計(jì)的56引腳CK505兼容時鐘芯片。

文件下載:9LPRS525AGLF.pdf

產(chǎn)品概述

ICS9LPRS525符合英特爾CK505黃皮書規(guī)范,為英特爾桌面芯片組提供了單芯片解決方案。它由14.318MHz晶體驅(qū)動,能為串行ATA和PCI - Express提供高精度的輸出。

輸出特性

  • 多種輸出類型:該芯片具有豐富的輸出類型,包括2對CPU差分低功耗推挽對、7對SRC差分推挽對,還有可選擇的CPU/SRC、SRC/DOT、SRC/SE差分低功耗推挽對以及單端輸出。此外,還有5個PCI(33MHz)、1個USB(48MHz)和1個REF(14.318MHz)輸出。
  • 低抖動性能:CPU和SRC輸出的周期 - 周期抖動均小于85ps,PCI輸出的周期 - 周期抖動小于250ps,所有輸出的頻率精度為±100ppm。當(dāng)SRC輸出由PLL3提供時,可滿足PCIe Gen2標(biāo)準(zhǔn)。

引腳配置

ICS9LPRS525采用56 - TSSOP封裝,引腳功能豐富且復(fù)雜。例如,PCI相關(guān)引腳既可以作為時鐘輸出,也可以通過SMBus配置為時鐘請求控制引腳;一些引腳還具有多種功能選擇,可通過SMBus或上電時的邏輯值來確定其具體功能。

特性與優(yōu)勢

  • 支持?jǐn)U頻調(diào)制:支持0到 - 0.5%的向下擴(kuò)頻,有助于降低電磁干擾。
  • 高CPU時鐘支持:支持高達(dá)400MHz的CPU時鐘。
  • 外部晶體驅(qū)動:使用外部14.318MHz晶體,需要外部晶體負(fù)載電容進(jìn)行頻率調(diào)諧。

頻率選擇

通過FSLA、FSLB和FSLC三個引腳的不同組合,可以選擇不同的CPU、SRC、PCI、REF、USB和DOT頻率。具體的頻率選擇表如下: FS L C 2 B0b7 FS L B 1 B0b6 FS L A 1 B0b5 CPU MHz SRC MHz PCI MHz REF MHz USB MHz DOT MHz
0 0 0 266.66 100.00 33.33 14.318 48.00 96.00
0 0 1 133.33
0 1 0 200.00
0 1 1 166.66
1 0 0 333.33
1 0 1 100.00
1 1 0 400.00
1 1 1 Reserved

需要注意的是,F(xiàn)SLA和FSLB是低閾值輸入,F(xiàn)SLC是三電平輸入,具體的電壓規(guī)格需要參考輸入/電源/通用輸出參數(shù)表。

電氣特性

直流參數(shù)

包括最大電源電壓、最大輸入電壓、存儲溫度、輸入ESD保護(hù)等參數(shù)。例如,最大電源電壓VDDxxx為4.6V,最大輸入電壓VIH為4.6V,存儲溫度范圍為 - 65°C到150°C。

交流參數(shù)

  • 低功耗差分輸出:上升沿和下降沿的轉(zhuǎn)換速率在2.5 - 4V/ns之間,差分電壓擺幅不小于300mV,交叉點(diǎn)電壓在300 - 550mV之間。
  • 時鐘抖動:CPU和SRC的周期 - 周期抖動小于85ps,DOT的周期 - 周期抖動小于250ps。

時鐘周期

在擴(kuò)頻禁用和啟用兩種情況下,芯片的時鐘周期有所不同。具體的時鐘周期數(shù)據(jù)可以參考文檔中的表格,這些數(shù)據(jù)對于系統(tǒng)設(shè)計(jì)中的時序分析非常重要。

電源管理

ICS9LPRS525支持多種電源管理模式,包括PCI_STOP#、CPU_STOP#、CR#和PD#的電源管理。通過SMBus的OE位和相應(yīng)的控制信號,可以控制時鐘的運(yùn)行和停止?fàn)顟B(tài),以實(shí)現(xiàn)節(jié)能和系統(tǒng)控制的目的。

SMBus接口

芯片通過SMBus接口進(jìn)行配置和數(shù)據(jù)傳輸。寫操作時,主機(jī)發(fā)送起始位、寫地址、起始字節(jié)位置、數(shù)據(jù)字節(jié)數(shù)和數(shù)據(jù)字節(jié),最后發(fā)送停止位;讀操作時,主機(jī)需要進(jìn)行一系列的地址和數(shù)據(jù)交互,才能讀取芯片的數(shù)據(jù)。

寄存器配置

芯片具有多個寄存器,用于配置輸出使能、時鐘請求、頻率選擇、擴(kuò)頻調(diào)制等功能。例如,Byte 0用于FS讀回和PLL選擇,Byte 1用于DOT96選擇和PLL3快速配置等。

測試模式

通過FSLC/TEST_SEL和FSLB/TEST_MODE引腳以及B9b3和B9b4寄存器位,可以進(jìn)入測試模式,選擇REF/N或HI - Z輸出。

封裝與訂購信息

芯片采用56引腳6.10mm主體、0.50mm間距的TSSOP封裝。訂購時可以參考9LPRS525AGLFT等型號。

在實(shí)際設(shè)計(jì)中,電子工程師需要根據(jù)系統(tǒng)的需求,合理配置ICS9LPRS525的引腳和寄存器,以確保系統(tǒng)的穩(wěn)定性和性能。同時,要注意芯片的電氣特性和電源管理要求,避免出現(xiàn)信號干擾和功耗過大等問題。大家在使用這款芯片時,有沒有遇到過什么特別的挑戰(zhàn)呢?歡迎在評論區(qū)分享你的經(jīng)驗(yàn)。

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