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正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻:定時(shí)器 IP核

電子硬件DIY視頻 ? 來(lái)源:電子硬件DIY視頻 ? 2019-09-18 07:03 ? 次閱讀
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人類最早使用的定時(shí)工具是沙漏或水漏,但在鐘表誕生發(fā)展成熟之后,人們開(kāi)始嘗試使用這種全新的計(jì)時(shí)工具來(lái)改進(jìn)定時(shí)器,達(dá)到準(zhǔn)確控制時(shí)間的目的。定時(shí)器確實(shí)是一項(xiàng)了不起的發(fā)明,使相當(dāng)多需要人控制時(shí)間的工作變得簡(jiǎn)單了許多。人們甚至將定時(shí)器用在了軍事方面,制成了定時(shí)炸彈,定時(shí)雷管?,F(xiàn)在的不少家用電器都安裝了定時(shí)器來(lái)控制開(kāi)關(guān)或工作時(shí)間。

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    分享正點(diǎn)原子FPGA開(kāi)發(fā)板全套資料

    本帖最后由 100dongdong 于 2020-5-16 23:48 編輯 正點(diǎn)原子FPGA開(kāi)拓者開(kāi)發(fā)板,Intel(Altera) FPG
    發(fā)表于 05-16 23:35

    正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板資料連載第二十一章 VGA圖片顯示實(shí)驗(yàn)

    1)實(shí)驗(yàn)平臺(tái):正點(diǎn)原子開(kāi)拓者FPGA 開(kāi)發(fā)板2)摘自《開(kāi)拓者FPGA開(kāi)發(fā)指南》關(guān)注官方微信號(hào)公眾
    發(fā)表于 08-05 11:12

    正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板資料連載第四十三章 以太網(wǎng)通信實(shí)驗(yàn)(2)

    1)實(shí)驗(yàn)平臺(tái):正點(diǎn)原子開(kāi)拓者FPGA 開(kāi)發(fā)板2)摘自《開(kāi)拓者FPGA開(kāi)發(fā)指南》關(guān)注官方微信號(hào)公眾
    發(fā)表于 08-24 16:41

    正點(diǎn)開(kāi)拓者FPGA開(kāi)發(fā)板使用問(wèn)題

    求問(wèn)各位大佬,剛剛?cè)腴T(mén)正點(diǎn)開(kāi)拓者FPGA開(kāi)發(fā)板,用板載pcf8591采集信號(hào)發(fā)生單一頻率正弦波,再用ip做fft,結(jié)果和matlab上f
    發(fā)表于 01-04 09:34

    FPGA verilog相關(guān)視頻:quartus中的qsys的講解

    該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě),詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻。
    的頭像 發(fā)表于 08-06 06:02 ?3894次閱讀
    <b class='flag-5'>FPGA</b> verilog相關(guān)<b class='flag-5'>視頻</b>:quartus中的<b class='flag-5'>qsys</b>的講解

    正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻:uC/GUI圖片/數(shù)字顯示實(shí)驗(yàn)

    該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě),詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻。
    的頭像 發(fā)表于 09-18 07:04 ?3117次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> <b class='flag-5'>Qsys</b><b class='flag-5'>視頻</b>:uC/GUI圖片/數(shù)字顯示實(shí)驗(yàn)

    正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板配套視頻FPGA是什么

    正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板配套視頻
    的頭像 發(fā)表于 09-04 06:02 ?3086次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b>開(kāi)發(fā)板配套<b class='flag-5'>視頻</b>:<b class='flag-5'>FPGA</b>是什么

    正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板配套視頻(1)

    正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板配套視頻
    的頭像 發(fā)表于 09-04 06:00 ?2915次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b>開(kāi)發(fā)板配套<b class='flag-5'>視頻</b>(1)

    正點(diǎn)原子開(kāi)拓者FPGA視頻:Modelsim軟件的使用

    、和單一內(nèi)核仿真技術(shù),編譯仿真速度快,編譯的代碼與平臺(tái)無(wú)關(guān),便于保護(hù)IP,個(gè)性化的圖形界面和用戶接口,為用戶加快調(diào)錯(cuò)提供強(qiáng)有力的手段,是FPGA/ASIC設(shè)計(jì)的首選仿真軟件。
    的頭像 發(fā)表于 09-19 07:09 ?3546次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b><b class='flag-5'>視頻</b>:Modelsim軟件的使用

    正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻:uCOS II任務(wù)管理與時(shí)間管理(2)

    該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě),詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻
    的頭像 發(fā)表于 09-17 07:10 ?2257次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> <b class='flag-5'>Qsys</b><b class='flag-5'>視頻</b>:uCOS II任務(wù)管理與時(shí)間管理(2)

    正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻:EPCS IP(2)

    IP(知識(shí)產(chǎn)權(quán))將一些在數(shù)字電路中常用,但比較復(fù)雜的功能塊,如FIR濾波、SDRAM控制、PCI接口等設(shè)計(jì)成可修改參數(shù)的模塊。隨著CPLD/F
    的頭像 發(fā)表于 09-16 07:08 ?2083次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> <b class='flag-5'>Qsys</b><b class='flag-5'>視頻</b>:EPCS <b class='flag-5'>IP</b><b class='flag-5'>核</b>(2)

    正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻:自定義IP之?dāng)?shù)碼管(2)

    該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě),詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻。
    的頭像 發(fā)表于 09-16 07:07 ?3646次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> <b class='flag-5'>Qsys</b><b class='flag-5'>視頻</b>:自定義<b class='flag-5'>IP</b><b class='flag-5'>核</b>之?dāng)?shù)碼管(2)

    正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻:PIO按鍵控制LED

    該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě),詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻
    的頭像 發(fā)表于 09-16 07:06 ?3713次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> <b class='flag-5'>Qsys</b><b class='flag-5'>視頻</b>:PIO按鍵控制LED

    正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻:PIO IRQ

    該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě),詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻
    的頭像 發(fā)表于 09-16 07:04 ?2338次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> <b class='flag-5'>Qsys</b><b class='flag-5'>視頻</b>:PIO IRQ

    正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻:Hello World

    該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě),詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻
    的頭像 發(fā)表于 09-12 07:09 ?4593次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> <b class='flag-5'>Qsys</b><b class='flag-5'>視頻</b>:Hello World
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