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      XILINX開發(fā)者社區(qū)

      文章：178 被閱讀：49.8w 粉絲數(shù)：22 關(guān)注數(shù)：0 點贊數(shù)：5

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      塊RAM存儲器中的地址沖突場景

      塊 RAM 是基于 FPGA 的系統(tǒng)設(shè)計中的關(guān)鍵組件，通常用于其高速數(shù)據(jù)存儲功能。然而，地址沖突可能....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 04-24 09:59 ?6470次閱讀
      塊RAM存儲器中的地址沖突場景

      AMD Zynq UltraScale+ RFSoC評估套件調(diào)試檢查表

      本篇文章包含一份調(diào)試檢查表，它是對 AMD Zynq UltraScale+ RFSoC 評估套件（....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 04-15 14:08 ?228次閱讀
      AMD Zynq UltraScale+ RFSoC評估套件調(diào)試檢查表

      如何使用AMD Vitis硬件在環(huán)功能運行Vitis子系統(tǒng)設(shè)計

      到目前為止，本文關(guān)于 AMD Versal AIE 驗證和 AMD Vitis 新的驗證功能的研究，....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 04-02 10:29 ?7438次閱讀
      如何使用AMD Vitis硬件在環(huán)功能運行Vitis子系統(tǒng)設(shè)計

      第二代AMD VERSAL AI EDGE系列全面賦能汽車ADAS系統(tǒng)

      選擇 AMD 自適應 SoC 和 FPGA 第二代 AMD Versal AI Edge 系列自適應....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 03-27 16:30 ?978次閱讀
      第二代AMD VERSAL AI EDGE系列全面賦能汽車ADAS系統(tǒng)

      AMD Versal CPM5 QDMA Gen4x8 ST Only Performance Design CED示例

      本篇博文演示了在AMD Vivado Design Suite 2024.1 中生成 CPM5_QD....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 03-23 09:12 ?1527次閱讀
      AMD Versal CPM5 QDMA Gen4x8 ST Only Performance Design CED示例

      ORAN wireless-xorif硬件演示

      GitHub 上的 ORAN 硬件工程旨在演示 ZCU102 或 ZCU111 評估板上的不同用例。....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 03-14 11:16 ?2126次閱讀
      ORAN wireless-xorif硬件演示

      AMD Versal自適應SoC中eMMC燒錄/啟動調(diào)試檢查表（下）

      有多種受支持的方式可用于燒錄 eMMC 器件，包括使用 AMD Vivado IDE、使用 AMD ....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 03-09 10:27 ?3985次閱讀
      AMD Versal自適應SoC中eMMC燒錄/啟動調(diào)試檢查表（下）

      AMD Versal自適應SoC中eMMC燒錄/啟動調(diào)試檢查表（上）

      本篇博文提供了有關(guān) AMD Versal 自適應 SoC 中 eMMC 燒錄和啟動設(shè)置的技巧和指南。....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 03-09 10:24 ?2006次閱讀
      AMD Versal自適應SoC中eMMC燒錄/啟動調(diào)試檢查表（上）

      第二代AMD Kintex UltraScale+ FPGA的亮點

      第二代 AMD Kintex UltraScale+ FPGA 可有效賦能專業(yè)音視頻、廣播、醫(yī)療、機....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 03-03 11:32 ?2194次閱讀
      第二代AMD Kintex UltraScale+ FPGA的亮點

      如何使用Lopper實用工具為目標處理器生成DTB

      Lopper 是一個基于 Python 的框架，用于從系統(tǒng)設(shè)備樹中抽取系統(tǒng)元數(shù)據(jù)，例如，處理器地址映....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 02-24 11:23 ?478次閱讀

      使用AMD Value Package加速提升工作效率

      AMD Value Package (AVP) 是一種一體化解決方案套件，旨在幫助工程團隊提升工作效....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 01-30 11:01 ?777次閱讀

      使用Aurora 6466b協(xié)議實現(xiàn)AMD UltraScale+ FPGA與AMD Versal自適應SoC的對接

      在本博客中，我們將介紹使用 Aurora 6466b 協(xié)議實現(xiàn) AMD UltraScale+ FP....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 01-13 14:04 ?3848次閱讀
      使用Aurora 6466b協(xié)議實現(xiàn)AMD UltraScale+ FPGA與AMD Versal自適應SoC的對接

      鎖存器中的時間借用概念與靜態(tài)時序分析

      對于基于鎖存器的設(shè)計，靜態(tài)時序分析會應用一個稱為時間借用的概念。本篇博文解釋了時間借用的概念，若您的....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 12-31 15:25 ?5671次閱讀
      鎖存器中的時間借用概念與靜態(tài)時序分析

      AMD Power Design Manager 2025.2版本現(xiàn)已發(fā)布

      AMD Power Design Manager 2025.2 版本現(xiàn)已發(fā)布，并正式支持第二代 AM....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 12-24 11:08 ?838次閱讀

      一文詳解SystemC仿真庫的編譯

      AMD Vivado 設(shè)計套件以文件和庫的形式提供仿真模型。仿真庫包含器件和 IP 的行為和時序模型....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 12-12 15:08 ?5099次閱讀
      一文詳解SystemC仿真庫的編譯

      全新AMD Vitis統(tǒng)一軟件平臺2025.2版本發(fā)布

      AMD Vitis統(tǒng)一軟件平臺 2025.2 版現(xiàn)已推出，此版本為使用 AMD Versal AI ....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 12-12 15:06 ?893次閱讀

      AMD Vivado Design Suite 2025.2版本現(xiàn)已發(fā)布

      AMD Vivado Design Suite 2025.2 版本現(xiàn)已發(fā)布，新增對 AMD Vers....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 12-09 15:11 ?1381次閱讀

      NoC性能監(jiān)控器調(diào)試指南

      本篇博客展示了如何訪問 NPI 為 NoC（片上網(wǎng)絡(luò)）公開的 Performance Monitor....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 12-01 14:38 ?1931次閱讀
      NoC性能監(jiān)控器調(diào)試指南

      如何在AMD Vitis Unified IDE中使用系統(tǒng)設(shè)備樹

      您將在這篇博客中了解系統(tǒng)設(shè)備樹 (SDT) 以及如何在 AMD Vitis Unified IDE ....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 11-18 11:13 ?3357次閱讀
      如何在AMD Vitis Unified IDE中使用系統(tǒng)設(shè)備樹

      Video Processing Subsystem與HDMI示例設(shè)計

      在撰寫本文時，HDMI Transmitter Subsystem IP 核與 Video Proc....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 11-07 10:35 ?975次閱讀
      Video Processing Subsystem與HDMI示例設(shè)計

      AMD Vitis AI 5.1測試版發(fā)布

      AMD Vitis AI 5.1全新發(fā)布——新增了對 AMD Versal AI Edge 系列神經(jīng)....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 10-31 12:46 ?1029次閱讀

      如何在應用程序調(diào)試期間分析棧和堆使用情況

      隨著 AMD Vitis 統(tǒng)一軟件平臺 2021.2 的發(fā)布，Vitis 引入了一個 Tcl 腳本，....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 10-24 16:54 ?1072次閱讀
      如何在應用程序調(diào)試期間分析棧和堆使用情況

      AMD Versal自適應SoC內(nèi)置自校準的工作原理

      本文提供有關(guān) AMD Versal 自適應 SoC 內(nèi)置自校準 (BISC) 工作方式的詳細信息。此....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 10-21 08:18 ?4444次閱讀

      如何利用XPIO構(gòu)建并實現(xiàn)帶有Strobe的高速接口設(shè)計

      在 AMD Versal 自適應 SoC 器件中，SelectIO 是實現(xiàn)高速接口的重要組成部分。它....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 10-17 09:22 ?2724次閱讀
      如何利用XPIO構(gòu)建并實現(xiàn)帶有Strobe的高速接口設(shè)計

      AMD Vivado IP integrator的基本功能特性

      我們還將帶您了解在 AMD Zynq UltraScale+ MPSoC 開發(fā)板與 AMD Vers....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 10-07 13:02 ?2356次閱讀
      AMD Vivado IP integrator的基本功能特性

      如何使用PetaLinux檢查RFDC IP狀態(tài)

      本篇博客演示了在 ZCU208 評估板和 ZCU216 評估板中通過運行簡單的 RFDC 示例來快速....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 09-23 16:08 ?1493次閱讀
      如何使用PetaLinux檢查RFDC IP狀態(tài)

      如何解決I/O時鐘布局器錯誤

      在 I/O 時鐘布局器階段可能會發(fā)生錯誤，指出該工具無法對該時鐘結(jié)構(gòu)進行布局，直至最后 BUFG 仍....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 09-23 16:05 ?1350次閱讀

      AMD Vivado ChipScope助力硬件調(diào)試

      許多硬件問題只有在整個集成系統(tǒng)實時運行的過程中才會顯現(xiàn)出來。AMD Vivado ChipScope....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 09-05 17:08 ?1325次閱讀

      高扇出信號線優(yōu)化技巧（下）

      該屬性會將每個驅(qū)動程序的扇出限制告知工具，并通過指示布局器了解扇出限制來指引該工具對高扇出的負載進行....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 08-28 10:47 ?1993次閱讀
      高扇出信號線優(yōu)化技巧（下）

      高扇出信號線優(yōu)化技巧（上）

      高扇出信號線 (HFN) 是具有大量負載的信號線。作為用戶，您可能遇到過高扇出信號線相關(guān)問題，因為將....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 08-28 10:45 ?2522次閱讀
      高扇出信號線優(yōu)化技巧（上）
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