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數(shù)據(jù)： SN65LVDS93B 10MHz - 85MHz 28 位平板顯示鏈路 LVDS Serdes 發(fā)器 數(shù)據(jù)表
SN65LVDS93B LVDS SerDes（串行器/解串器）發(fā)送器在單個集成電路中包含4個7位并行負載串行輸出移位寄存器，1個7時鐘合成器以及5個低電壓差動信號（LVDS）驅(qū)動器。借助這些功能，可以通過5個平衡對導體同步傳輸28位單端LVTTL數(shù)據(jù)并由兼容的接收器（如DS90CR286A和SN65LVDS94） ）進行接收。
發(fā)送數(shù)據(jù)時，數(shù)據(jù)位D0至D27會在輸入時鐘信號（CLKIN）邊沿全部加載到寄存器中?？赏ㄟ^時鐘選擇（CLKSEL）引腳來選擇時鐘的上升沿或下降沿.CLKIN的頻率會實現(xiàn)比率為7的倍增，然后用于以串行方式以7位時間片解除數(shù)據(jù)寄存器的負載。接著會將4個串行數(shù)據(jù)流和鎖相時鐘（CLKOUT）輸出至LVDS輸出驅(qū)動器.CLKOUT的頻率與輸入時鐘（CLKIN）相同。
SN65LVDS93B器件無需外部組件，只需很少控制，甚至無需控制。發(fā)送器輸入端的數(shù)據(jù)總線與收器輸出端的數(shù)據(jù)總線相同，數(shù)據(jù)傳輸對于用戶而言是透明的。用戶唯一能夠干預的是選擇時鐘上升沿（向CLKSEL輸入高電平）或下降沿（向CLKSEL輸入低電平），以及使用關(guān)斷/清零（SHTDN）信號.SHTDN是一個低電平有效輸入，可禁用時鐘并關(guān)斷LVDS輸出驅(qū)動器，從而降低功耗。如果該信號為低電平，則可以清除所有內(nèi)部寄存器（處于低電平）。
SN65LVDS93B在環(huán)境空氣中的工作溫度范圍為-40°C至85°C。
所有商標都是正確的他們各自所有者的ty。
| ? |
|---|
| Protocols |
| Function |
| Parallel Bus Width (bits) |
| Compression Ratio |
| ESD (kV) |
| Input Compatibility |
| Output Compatibility |
| Supply Voltage(s) (V) |
| Data Throughput (Mbps) |
| Rating |
| Operating Temperature Range (C) |
| Package Group |
| Package Size: mm2:W x L (PKG) |
| Pin/Package |
| ? |
| SN65LVDS93B | SN65LVDS93A | SN65LVDS95 |
|---|---|---|
| LVDS I ? ? | Channel-Link I ? ? | Channel-Link I ? ? |
| Serializer ? ? | Serializer ? ? | Serializer ? ? |
| 28 ? ? | 28 ? ? | 21 ? ? |
| 28 to 4 ? ? | 28 to 4 ? ? | 21 to 3 ? ? |
| 5 ? ? | 5 ? ? | 6 ? ? |
| LVTTL ? ? | LVTTL ? ? | LVTTL ? ? |
| LVDS ? ? | LVDS ? ? | LVDS ? ? |
| 3.3 ? ? | 3.3 ? ? | 3.3 ? ? |
| 2380 ? ? | 3780 ? ? | 1428 ? ? |
| Catalog ? ? | Catalog ? ? | Catalog ? ? |
| -40 to 85 ? ? | -40 to 85 ? ? | -40 to 85 ? ? |
| TSSOP ? ? | BGA MICROSTAR JUNIOR TSSOP ? ? | TSSOP ? ? |
| 56TSSOP: 113 mm2: 8.1 x 14(TSSOP) ? ? | 56BGA MICROSTAR JUNIOR: 32 mm2: 4.5 x 7(BGA MICROSTAR JUNIOR) 56TSSOP: 113 mm2: 8.1 x 14(TSSOP) ? ? | 48TSSOP: 101 mm2: 8.1 x 12.5(TSSOP) ? ? |
| 56TSSOP ? ? | 56BGA MICROSTAR JUNIOR 56TSSOP ? ? | 48TSSOP ? ? |
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