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在BIST（內(nèi)建自測(cè)試）過程中，線性反饋移位寄存器作為測(cè)試矢量生成器，為保障故障覆蓋率，會(huì)產(chǎn)生很長(zhǎng)的測(cè)試矢量，從而消耗了大量功耗。在分析BIST結(jié)構(gòu)和功耗模型的基礎(chǔ)上，針對(duì)test-per-scan和test-per-clock兩大BIST類型，介紹了幾種基于LFSR（線性反饋移位寄存器）優(yōu)化的低功耗BIST測(cè)試方法，設(shè)計(jì)和改進(jìn)可測(cè)性設(shè)計(jì)電路，研究合理的測(cè)試策略和測(cè)試矢量生成技術(shù)，實(shí)現(xiàn)測(cè)試低功耗要求。
- Abstract:
- ?During the BIST testing,LFSR as the TPG give very long test pattern for guaranteeing the fault coverage which due to a lot of power consumption.After analyzing the BIST structure and power loss model, the paper makes research on the al-gorithm and realization of lower power BIST on base of optimized LFSR aiming at two kinds of BIST architecture: the test-per-clock and test-per-scan. In order to meet testing lower power,the design methods for low power BIST circuit and reason-able test strategy are studied.
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