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該四位寄存器包含D型觸發(fā)器，具有圖騰極三態(tài)輸出，能夠驅(qū)動高容量或低阻抗負(fù)載高阻抗?fàn)顟B(tài)和增加的高邏輯電平驅(qū)動，使這些觸發(fā)器能夠在總線組織系統(tǒng)中驅(qū)動總線，而無需接口或上拉將兩個輸出嘗試將公共總線連接到相反邏輯電平的可能性降至最低的元件輸出控制電路的設(shè)計(jì)使平均輸出禁用時(shí)間短于平均輸出啟用時(shí)間
當(dāng)兩個數(shù)據(jù)使能輸入都是低數(shù)據(jù)時(shí)，門控使能輸入用于控制數(shù)據(jù)進(jìn)入觸發(fā)器；當(dāng)兩個輸入都是低的時(shí)，在緩沖時(shí)鐘輸入的下一個正轉(zhuǎn)換時(shí)，D輸入被加載到各自的觸發(fā)器中；當(dāng)四個輸入的正常邏輯狀態(tài)都是低的時(shí)，也提供門控輸入輸出可用于驅(qū)動負(fù)載或總線。輸出在任一輸出控制輸入處通過高邏輯電平與時(shí)鐘電平獨(dú)立禁用。然后輸出呈現(xiàn)高阻抗，負(fù)載或驅(qū)動總線的詳細(xì)操作在真值表中給出。
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