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使用JESD204B接口的AD9144高速DA轉換模塊參數(shù)設定(私人總結版)

潘文明 ? 來源:明德?lián)P吳老師 ? 作者:明德?lián)P吳老師 ? 2022-07-12 08:59 ? 次閱讀
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本文為明德?lián)P原創(chuàng)文章,轉載請注明出處!

由于AD9144是高速DA轉換模塊,轉換速率可以達到2.5G,可以滿足普通的DA數(shù)據(jù)接口。為了匹配高速AD/DA轉換,JESD204B接口就應運而生,在本高速DA轉換工程中,AD9144的參數(shù)設定與JESD204B有千絲萬屢的關系,二者是相互對應的。

本次工程實現(xiàn)的目標:

波形:正弦波(波形由16個16位寬數(shù)據(jù)構成)

頻率:31.25MHZ

采樣率:500MHZ

DAC個數(shù):2個

LANE個數(shù):4個

插值:1

類型:單link

單次傳輸數(shù)據(jù)為:128位

一、 AD9144工作模式的選擇

AD9144共有Single-Link和dual-Link兩種類型可以選擇,其中Single-Link類型有10種工作模式,Dual-Link有6種工作模式。

具體工作模式如下圖所示:

pYYBAGLMxtOASdkkAABabgAmw4A597.png

poYBAGLMxt2AQNEvAABORngRqCc854.png

1. 參數(shù)介紹:

M:轉換DA個數(shù);

L:lane的個數(shù);

S:每一個AD的每一幀的采樣點數(shù);

F:每條lane的每一幀的字節(jié)數(shù);

2. 模式的選擇步驟

對于工作模式的選擇不同的項目有著不同的思考:

1) 本次采用單link方式所以有10種工作模式選擇;

2) AD9144使用兩個DAC所以只能在mode4-mode7之間選擇;

3) AD9144和JESD204B間采用4條lane相連,所以只能選擇mode4或mode5;

4) 為了便于AD9144參數(shù)計算,本次采用JESD204B的mode4。

二、JESD204B的時鐘關系

了解AD9144時鐘關系是我們計算AD9144參數(shù)的前提,下面介紹一下JESD204B中各個時鐘之間的關系。

poYBAGLMxvaAEuISAACBlwInb3U928.png

poYBAGLMxvyAZmOlAABCcV1WnPs768.png

1.名詞解釋:

SYSREF clock:同步時鐘頻率

Device clock:驅動時鐘頻率

Multifram clock:多幀頻率

Fram clock:幀頻率

Character clock:字節(jié)時鐘頻率

Bit clock:單條lane數(shù)據(jù)傳輸速率

Sample clock:采樣率

Conversation clock:轉換率

2.關系介紹

1個同步時鐘周期內(nèi),可以發(fā)R個多幀

1個多幀的發(fā)送需要D個工作時鐘;

1個多幀由K個幀組成

1個幀內(nèi)由F個字節(jié)數(shù)

1個字節(jié)經(jīng)過8B/10B編碼得到bit數(shù)

1幀內(nèi)由S個采樣點

1個采樣點經(jīng)過C倍插值得到轉化后的采樣結果(C由x1,x2,x4,x8四種模式)

三、 AD9144的參數(shù)設定

1.參數(shù)設定的意義

①確定配置AD9144所需要的寄存器值;

②設定JESD204B的IP核的參數(shù);

③ 確定AD9516的分頻時鐘頻率;

2.AD9144的時鐘參數(shù)計算

由工程的設計目標,可以結合JESD204B對AD9144進行參數(shù)設置。

= 1 * GB3 * MERGEFORMAT ①

有效數(shù)據(jù)傳輸速率 =sample*16*2=16G/s;

實際傳輸數(shù)據(jù)速率 =16G*(10/8)=20G/s;

Lane_rate =20G/4=5G;

Sapmple_clock =500MHZ;

Frame_clock =sample_clock/S=500MHZ(S取1);

Char_clock =fram_clock*F=500MHZ(F取1);

Bit_clock =char_clock*10=5G(8b/10B編碼得出);

Conversion_clock =sample_clock*C=500MHZ(單倍插值C=1);

Mul_fram_clock =fram_clock/K=15.625MHZ(K取32);

= 2 * GB3 * MERGEFORMAT ②

Sysref_clock =mul_fram_clock/R=7.8125MHZ(R取合適的整數(shù)即可R=2);

device_clock =mul_frame_clock*D=125MHZ(D 取合適整數(shù)即可D=8);

Refclk=lane/40 =125MHZ(AD9144參考時鐘);

注釋:

= 1 * GB3 * MERGEFORMAT ①實際速率是有效速率經(jīng)過8B/10B編碼得出;

= 2 * GB3 * MERGEFORMAT ②D最小值是,Dmin=有效數(shù)據(jù)量/128,D為整數(shù);

四、 AD9144的配置表生成

1.實現(xiàn)方法

方法1;對照AD9144手順根據(jù)工程的實現(xiàn)功能以及AD9144的計算參數(shù)進行逐個配置

方法2:使用AD9144的配置軟件進行配置,然后對照手順進行配置

本次使用方法2進行AD9144的寄存器值的配置

2.實現(xiàn)步驟

1. 打開ACE軟件選擇對應芯片AD9144-FMC-EBZ,并選擇添加。

pYYBAGLMxxCAVIhiAAHhczQcBeg614.png

2. 對照計算的AD9144的參數(shù)進行芯片設置,完成后雙擊藍色AD9144圖標。

(1)Link模式:single; (2)link;JESD MODE :mode4;

(3)Subclss:子類1; (4)Interpolation:選擇1倍插值(無插值模式);

(5)DAC PLL勾選; (6)RefClk:計算的AD9144參考時鐘,125MHZ;

(7)FIN=device_clock=125MHZ; (8)FADC=采樣率=500MHZ;

poYBAGLMxx6AfzyGAAGNFE2Xs0A428.png

3. 寄存器配置表生成后,即可用來配置AD9144寄存器

pYYBAGLMxyyAadLQAAOBC8wSUlA802.png

以上就是AD9144的參數(shù)設定,感興趣的同學可以留言相互討論!

審核編輯 黃昊宇

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權轉載。文章觀點僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學習之用,如有內(nèi)容侵權或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報投訴
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