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      Pynq是不是用Python編程FPGA的新物種？

      FPGA之家 ? 來源：FPGA之家 ? 作者：FPGA之家 ? 2022-07-23 09:40 ? 次閱讀
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      目前，雖然基于C/C++等高層次綜合相較于手寫RTL層級HDL語言已大幅提升了開發(fā)效率，但隨著相關技術的不斷進步，以及算法迭代的日益頻繁，人們似乎并不滿足于此。

      不少剛剛接觸到Pynq的用戶第一個問號

      Pynq是不是用Python編程FPGA的新物種？

      在Pynq的FAQ中，我們強調的第一個重點就是PYNQ是一個開源框架而不是一個直接用Python編程FPGA的工具。但是，在不遠的將來，我們也許就要修改這條FAQ了。

      因為在2月28日，Vitis HLS工具前端開源了?。?！

      0c52d0ba-0a22-11ed-ba43-dac502259ad0.png

      這是Xilinx的開源戰(zhàn)略和承諾的一部分，通過Vitis HLS工具鏈前端開源可以

      Add support for new high-level languages beyond C/C++ and OpenCL

      Add new domain-specific optimization pragmas or compiler directives

      Customize the transformations to the LLVMIR (new LLVM passes)

      這意味著，軟硬件開發(fā)人員可以靈活地使用標準的 Clang / LLVM 基礎架構，支持自由擴展，也可以定制高層次綜合 (HLS) 編譯過程的前端。

      例如，自定義語言支持和全新特定于應用的編譯器指令，以及更多的可能性。

      0c63251e-0a22-11ed-ba43-dac502259ad0.png

      研究人員早就在開始探索增加Python高層次綜合。例如2019年，Themefisher和康奈爾大學聯(lián)合推出了HeteroCL。

      HeteroCL是一種編程基礎結構，由基于Python的域特定語言（DSL）和編譯流程組成,其編譯器在CPU上生成LLVM代碼.

      因此可通過結合最新的HLS優(yōu)化（例如用于脈動陣列的PolySA和用于模板的SODA與數(shù)據(jù)流體系結構），產生高效的空間體系結構。

      0c7723d4-0a22-11ed-ba43-dac502259ad0.png

      將來要發(fā)生的事情，大家應該都有自己的想象空間了

      審核編輯 ：李倩

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      原文標題：PYNQ框架下用Python編程FPGA不是夢-Vitis HLS前端開源

      文章出處：【微信號：zhuyandz，微信公眾號：FPGA之家】歡迎添加關注！文章轉載請注明出處。

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