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RL78族噪聲的相關(guān)注意事項(xiàng)及對(duì)策應(yīng)用說(shuō)明

瑞薩嵌入式小百科 ? 來(lái)源:未知 ? 2023-02-09 21:25 ? 次閱讀
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本文要點(diǎn)

本篇應(yīng)用說(shuō)明介紹了RL78族有關(guān)噪聲的注意事項(xiàng)及其對(duì)應(yīng)方法。本應(yīng)用說(shuō)明中介紹的噪聲對(duì)應(yīng)方法僅作為通常的噪聲處理方法,在實(shí)際使用時(shí),請(qǐng)?jiān)趯?shí)施本處理方法后對(duì)系統(tǒng)進(jìn)行詳細(xì)的評(píng)價(jià)。

目錄

1. 噪聲的相關(guān)注意事項(xiàng)

1.1 縮短布線長(zhǎng)度

1.1.1 c40df77c-a87c-11ed-bfe3-dac502259ad0.png引腳的布線

1.1.2 時(shí)鐘輸入/輸出引腳的布線

1.2 在VSS-VDD之間連接旁路電容器

1.3 模擬輸入引腳的布線處理

1.4 對(duì)諧振器的考慮

1.4.1 避開(kāi)有大電流流過(guò)的信號(hào)

1.4.2 避開(kāi)有高速電平變化的信號(hào)線

1.5 輸入/輸出端口的處理

2. 參考文獻(xiàn)與公司主頁(yè)和咨詢窗口

1. 噪聲的相關(guān)注意事項(xiàng)

1.1 縮短布線長(zhǎng)度

電路板上的布線可能會(huì)成為接收噪聲信號(hào)的天線。因此,總的布線長(zhǎng)度越短(mm單位),將噪聲信號(hào)引入單片機(jī)內(nèi)部的可能性就越低。

1.1.1 c40df77c-a87c-11ed-bfe3-dac502259ad0.png引腳的布線

要盡量縮短連接c40df77c-a87c-11ed-bfe3-dac502259ad0.png引腳的布線。特別是在c40df77c-a87c-11ed-bfe3-dac502259ad0.png引腳與VSS引腳之間連接電容時(shí),以及復(fù)位集成電路與對(duì)應(yīng)的引腳連接時(shí),一定要以最短的布線(20mm以內(nèi))連接。

<理由>

輸入到c40df77c-a87c-11ed-bfe3-dac502259ad0.png引腳的復(fù)位信號(hào)的脈沖寬度要求有一定的時(shí)序,如果短于正常復(fù)位脈沖寬度的干擾信號(hào)輸入到c40df77c-a87c-11ed-bfe3-dac502259ad0.png引腳,那么在單片機(jī)完成內(nèi)部初始化之前復(fù)位被解除,導(dǎo)致程序失控。

c4523bf8-a87c-11ed-bfe3-dac502259ad0.png

圖1.1 c40df77c-a87c-11ed-bfe3-dac502259ad0.png引腳的布線

1.1.2 時(shí)鐘輸入/輸出引腳的布線

? 要盡量縮短連接時(shí)鐘輸入/輸出引腳的布線。

? 應(yīng)該以最短的布線(20mm以內(nèi))連接諧振器電容的接地引線和單片機(jī)的VSS引腳。

c47da806-a87c-11ed-bfe3-dac502259ad0.png

圖1.2 時(shí)鐘輸入/輸出引腳的布線

<理由>

當(dāng)有噪聲干擾侵入時(shí)鐘輸入/輸出引腳時(shí),時(shí)鐘的波形會(huì)發(fā)生紊亂,導(dǎo)致誤操作和失控。另外,如果噪聲使單片機(jī)的VSS電平和諧振器的VSS電平之間產(chǎn)生電位差,正確的時(shí)鐘會(huì)無(wú)法輸入到單片機(jī)。

1.2 在VSS-VDD之間連接旁路電容器

請(qǐng)按照下列條件,在VSS-VDD之間連接0.1uF左右的旁路電容器。

? VSS引腳—旁路電容器的布線長(zhǎng)度應(yīng)該和VDD引腳—旁路電容器的布線長(zhǎng)度相等。

? VSS引腳—旁路電容器的布線長(zhǎng)度和VDD引腳—旁路電容器的布線長(zhǎng)度一定要最短。

? VSS和VDD使用的布線要比其他信號(hào)線寬。

? 電源布線要經(jīng)由旁路電容器連接至VSS引腳和VDD引腳。

c49cbfca-a87c-11ed-bfe3-dac502259ad0.png

圖1.3 VSS-VDD之間的旁路電容器

1.3 模擬輸入引腳的布線處理

? 請(qǐng)?jiān)谀M輸入引腳連接的模擬信號(hào)線的盡可能靠近單片機(jī)的位置上,串聯(lián)100~1kΩ左右的電阻。

? 請(qǐng)?jiān)谀M輸入引腳與VSS引腳之間的盡可能靠近VSS引腳的位置上連接電容值在1000pF左右的電容。并且,模擬輸入引腳至電容的布線長(zhǎng)度應(yīng)該和VSS引腳至電容的布線長(zhǎng)度相等。

<理由>

一般來(lái)說(shuō),輸入模擬輸入引腳的信號(hào)通常都是從傳感器傳出來(lái)的。而用于檢測(cè)運(yùn)行情況的傳感器,多數(shù)都設(shè)置在遠(yuǎn)離安裝了單片機(jī)的電路板的位置,因此它與模擬輸入引腳之間的布線必然會(huì)變長(zhǎng)。由于較長(zhǎng)的布線會(huì)成為接收噪聲信號(hào)的天線,所以模擬輸入引腳很容易接收噪聲。

c4bf704c-a87c-11ed-bfe3-dac502259ad0.png

圖1.4 模擬信號(hào)線、電阻及電容

1.4 對(duì)諧振器的考慮

諧振器生成的時(shí)鐘信號(hào)是單片機(jī)運(yùn)行的基礎(chǔ),因此要采取措施使諧振器不易受到其他信號(hào)的干擾。

1.4.1 避開(kāi)有大電流流過(guò)的信號(hào)線

如果信號(hào)線中流過(guò)的電流值超過(guò)了單片機(jī)所能處理的電流值范圍,則需要將其設(shè)置在距離單片機(jī)(特別是諧振器)盡可能遠(yuǎn)的位置。

<理由>

單片機(jī)系統(tǒng)中分布著許多用來(lái)控制電機(jī)、LED和熱敏頭的信號(hào)線。當(dāng)這些信號(hào)線中流過(guò)大電流時(shí),會(huì)因相互之間的感應(yīng)而產(chǎn)生噪聲。

c4dff63c-a87c-11ed-bfe3-dac502259ad0.png

圖1.5 有大電流流過(guò)的信號(hào)線的布線

1.4.2 避開(kāi)有高速電平變化的信號(hào)線

有高速電平變化的信號(hào)線要設(shè)置在盡可能遠(yuǎn)離諧振器和諧振器的布線區(qū)域。另外,有高速電平變化的信號(hào)線不能與時(shí)鐘相關(guān)的信號(hào)線和其他容易受到噪聲影響的信號(hào)線平行或交叉。

<理由>

有高速電平變化的如TO01引腳的信號(hào)在發(fā)生上升或下降的電平變化時(shí),會(huì)給其他信號(hào)線帶來(lái)干擾。特別是如果與時(shí)鐘相關(guān)的信號(hào)線交叉,時(shí)鐘波形會(huì)發(fā)生紊亂,導(dǎo)致誤操作和失控。

c4fd9bba-a87c-11ed-bfe3-dac502259ad0.png

圖1.6 有高速電平變化的信號(hào)線的布線

1.5 輸入/輸出端口的處理

輸入/輸出端口要按照以下要求,從硬件和軟件兩個(gè)方面進(jìn)行處理。

硬件方面

? 要在連接輸入/輸出端口的信號(hào)線的盡可能靠近單片機(jī)的位置上串聯(lián)100Ω以上的電阻。

軟件方面

? 輸入端口應(yīng)通過(guò)程序反復(fù)多次進(jìn)行讀取,確定電平一致。

? 由于輸出端口可能會(huì)因噪聲的影響反相輸出數(shù)據(jù),因此每隔一定的周期就要進(jìn)行端口寄存器的再寫入。

? 每隔一定的周期進(jìn)行控制端口功能的寄存器的再寫入。

c51e8492-a87c-11ed-bfe3-dac502259ad0.png

圖1.7 輸入/輸出端口的處理

2. 參考文獻(xiàn)

各產(chǎn)品的用戶手冊(cè) 硬件篇

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原文標(biāo)題:RL78族噪聲的相關(guān)注意事項(xiàng)及對(duì)策應(yīng)用說(shuō)明

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