本系列將帶來FPGA的系統(tǒng)性學(xué)習(xí)，從最基本的數(shù)字電路基礎(chǔ)開始，最詳細(xì)操作步驟，最直白的言語描述，手把手的“傻瓜式”講解，讓電子、信息、通信類專業(yè)學(xué)生、初入職場小白及打算進(jìn)階提升的職業(yè)開發(fā)者都可以有系統(tǒng)性學(xué)習(xí)的機(jī)會(huì)。

系統(tǒng)性的掌握技術(shù)開發(fā)以及相關(guān)要求，對(duì)個(gè)人就業(yè)以及職業(yè)發(fā)展都有著潛在的幫助，希望對(duì)大家有所幫助。后續(xù)會(huì)陸續(xù)更新 Xilinx 的 Vivado、ISE 及相關(guān)操作軟件的開發(fā)的相關(guān)內(nèi)容，學(xué)習(xí)FPGA設(shè)計(jì)方法及設(shè)計(jì)思想的同時(shí)，實(shí)操結(jié)合各類操作軟件，會(huì)讓你在技術(shù)學(xué)習(xí)道路上無比的順暢，告別技術(shù)學(xué)習(xí)小BUG卡破腦殼，告別目前忽悠性的培訓(xùn)誘導(dǎo)，真正的去學(xué)習(xí)去實(shí)戰(zhàn)應(yīng)用，這種快樂試試你就會(huì)懂的。話不多說，上貨。

LED流水燈設(shè)計(jì)

在學(xué)習(xí)軟件設(shè)計(jì)時(shí)，第一個(gè)例程總是“hello world！”，那么學(xué)習(xí)硬件時(shí)，也會(huì)有硬件的“hello world”------流水燈。本篇硬件基于叁芯智能科技的 SANXIN-B01開發(fā)板，如有想要入手，可查看以下鏈接，官方淘寶店已上架。

在FPGA開發(fā)板上有四個(gè)LED，我們要做的流水燈，顧名思義就是要LED像流水一樣的點(diǎn)亮熄滅。直白點(diǎn)說就是，點(diǎn)亮第一個(gè)一段時(shí)間，然后熄滅第一個(gè)的同時(shí)，點(diǎn)亮第二個(gè)·····。在此，我們?cè)O(shè)置每一個(gè)LED點(diǎn)亮的時(shí)間為1秒鐘。

硬件介紹

在我們的開發(fā)板上有四個(gè)LED，設(shè)計(jì)邏輯為：FPGA輸出高電平時(shí)，LED點(diǎn)亮；FPGA輸出低電平時(shí)，LED熄滅。

架構(gòu)設(shè)計(jì)和信號(hào)說明

本設(shè)計(jì)的模塊名稱為ledrun。

建立工程、新建文件等步驟在專輯前篇中已經(jīng)明確羅列，以后將不再敘述。這里給出超鏈接，方便參考學(xué)習(xí)。

FPGA零基礎(chǔ)學(xué)習(xí)：Intel FPGA 開發(fā)流程

設(shè)計(jì)代碼

parameter可以定義一個(gè)參數(shù)（默認(rèn)是32位）。在寫代碼時(shí)，對(duì)于某些數(shù)字，設(shè)計(jì)者經(jīng)常利用定義參數(shù)的方式進(jìn)行編寫，方便修改，也方便閱讀。

在硬件電路中，使用計(jì)數(shù)器當(dāng)做計(jì)時(shí)器，每記錄一個(gè)數(shù)字等于過去一個(gè)時(shí)鐘周期。由于本設(shè)計(jì)中采用的clk為50MHz，所以經(jīng)過50_000_000（在verilog中，如果是描述數(shù)字，中間的下劃線只起到分隔的作用，不影響數(shù)值的大小）個(gè)周期正好為1秒鐘。由于計(jì)數(shù)器是從0開始計(jì)數(shù)，所以計(jì)數(shù)器只需要記錄到50_000_000-1即可。

為了能夠記錄到50_000_000-1這么大的數(shù)字，所以定義了一個(gè)26位的計(jì)數(shù)器cnt（參考附錄1：設(shè)計(jì)中位寬的概念和計(jì)算位寬的小技巧）。

在verilog中，“{}”（ 大括號(hào)）的第一個(gè)特殊作用為位拼接。{a，b}相當(dāng)于將a和b拼接為一個(gè)整體，并且是高位為a，低位為b。

當(dāng)led輸出為4’b0001時(shí)，第一個(gè)led點(diǎn)亮；經(jīng)過1秒鐘，輸出4’b0010時(shí)，第二個(gè)led點(diǎn)亮；經(jīng)過1秒鐘，輸出4’b0100時(shí)，第三個(gè)led點(diǎn)亮；經(jīng)過1秒鐘，輸出4’b1000時(shí)，第四個(gè)led點(diǎn)亮；經(jīng)過1秒鐘，輸出4’b0001時(shí)，第一個(gè)led點(diǎn)亮······按照上述的過程周而復(fù)始，就形成了流水燈。

不難發(fā)現(xiàn)，led的輸出，一直為3個(gè)0,1個(gè)1。并且1的位置每1秒鐘移動(dòng)一次，從頭到尾，然后又到頭。這種現(xiàn)象可以利用移位的思想進(jìn)行實(shí)現(xiàn)。即：led[3]<=led[2]; led[2]<=led[1]; led[1]<=led[0]; led[0]<=led[3];如果將被賦值的組成一個(gè)整體，那就是led，賦值的組成一個(gè)整體就是{led[2:0], led[3]}。

仿真代碼

$stop是一個(gè)系統(tǒng)任務(wù)，功能為將modelsim的仿真停止。

設(shè)置好testbench后，運(yùn)行分析綜合后，打開RTL仿真。

波形分析

在modelsim中，打開sim窗口，選擇ledrun_tb下的ledrun_inst。

打開objects，將cnt選中。

objects窗口中顯示在sim窗口中選中模塊中所有的信號(hào)。

右擊，將其添加入波形窗口。

返回到wave窗口中，cnt信號(hào)已經(jīng)添加到wave窗口中。由于新添加進(jìn)來，沒有數(shù)據(jù)（no data）。

點(diǎn)擊restart。

restart按鈕為重新運(yùn)行波形，點(diǎn)擊后，軟件會(huì)詢問是否保持各種屬性，點(diǎn)擊ok即可。

wave窗口中所有的波形都處于no data 狀態(tài)。點(diǎn)擊run –all按鈕，開始運(yùn)行波形。

運(yùn)行后，會(huì)自動(dòng)停止。停止在tb文件中的$stop處。

返回wave窗口，各個(gè)信號(hào)都會(huì)有波形。

設(shè)置cnt的信號(hào)進(jìn)制為無符號(hào)的十進(jìn)制：右擊cnt信號(hào)，選擇radix中的unsigned。

把光標(biāo)放到復(fù)位結(jié)束時(shí)，選擇放大波形。

放大按鈕的左側(cè)第一個(gè)按鈕為全局縮放，功能為將所有運(yùn)行波形，顯示到目前的窗口里；左側(cè)第二個(gè)為縮小。最左邊和最右邊的按鈕暫時(shí)用不到，這里不再介紹。

可以看到，在復(fù)位結(jié)束后，cnt信號(hào)每一個(gè)時(shí)鐘周期都會(huì)增加1。

由于我們?cè)O(shè)計(jì)的流水燈是每1秒鐘流動(dòng)一個(gè)，在上述的仿真中，led數(shù)值是不會(huì)變化的。如果仿真幾秒鐘的話，仿真的時(shí)間會(huì)比較長。在此不建議仿真幾秒鐘的時(shí)長，有可能會(huì)導(dǎo)致電腦卡住。

仿真時(shí)，可以將T_1s的值，改成一個(gè)較小值。例如：5。然后在此編譯仿真。

在quartus的編譯器中，修改完后。進(jìn)行綜合分析，保證沒有任何語法錯(cuò)誤。在之前打開的modelsim中，打開library窗口，找到最上面的work，打開其前面的“+”。

選中剛才修改過的文件，右擊，選擇recompile。此時(shí)，modelsim會(huì)重新編譯此文件。

回到wave窗口中，點(diǎn)擊restart，run-all。運(yùn)行波形。

能夠清楚的看到，led在進(jìn)行移位，并且都是5個(gè)周期移動(dòng)一次。

仿真通過后，關(guān)閉modelsim。回到quartus中，將參數(shù)修改成為50_000_000，綜合分析后，分配管腳。布局布線，生成配置文件，進(jìn)行下板測試。

開發(fā)板上的四個(gè)LED開始做流水狀點(diǎn)亮。

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