實(shí)現(xiàn)簽核時(shí)，為了保證芯片設(shè)計(jì)的耐用性，設(shè)計(jì)師會(huì)面臨重重挑戰(zhàn)，利用 Cadence Tempus 設(shè)計(jì)穩(wěn)健性分析（DRA）套件為設(shè)計(jì)工程師提供領(lǐng)先的建模技術(shù)，可實(shí)現(xiàn)最佳功耗、性能和面積目標(biāo)（PPA）。

相較于傳統(tǒng)方法，Tempus DRA 套件提供了一套全面的高級(jí)分析功能，有望增強(qiáng)設(shè)計(jì)級(jí)穩(wěn)健性，實(shí)現(xiàn)更優(yōu) PPA。

使用 Tempus DRA 套件完成完整分析后，設(shè)計(jì)工程師可以利用 Cadence Innovus 設(shè)計(jì)實(shí)現(xiàn)系統(tǒng)中的 Tempus ECO 選項(xiàng)進(jìn)行模塊級(jí)的收斂，并使用 Cadence Certus 收斂解決方案進(jìn)行子系統(tǒng)/全芯片層的簽核收斂，顯著提高設(shè)計(jì)收斂速度，優(yōu)化 PPA 目標(biāo)達(dá)成。

如需了解更多信息，請點(diǎn)擊文末“閱讀原文”。

關(guān)于 Cadence

Cadence 是電子系統(tǒng)設(shè)計(jì)領(lǐng)域的關(guān)鍵領(lǐng)導(dǎo)者，擁有超過 30 年的計(jì)算軟件專業(yè)積累?；诠镜闹悄芟到y(tǒng)設(shè)計(jì)戰(zhàn)略，Cadence 致力于提供軟件、硬件和 IP 產(chǎn)品，助力電子設(shè)計(jì)概念成為現(xiàn)實(shí)。Cadence 的客戶遍布全球，皆為最具創(chuàng)新能力的企業(yè)，他們向超大規(guī)模計(jì)算、5G 通訊、汽車、移動(dòng)設(shè)備、航空、消費(fèi)電子、工業(yè)和醫(yī)療等最具活力的應(yīng)用市場交付從芯片、電路板到完整系統(tǒng)的卓越電子產(chǎn)品。Cadence 已連續(xù)九年名列美國財(cái)富雜志評選的 100 家最適合工作的公司。如需了解更多信息，請?jiān)L問公司網(wǎng)站 www.cadence.com。

2023 Cadence Design Systems, Inc. 版權(quán)所有。在全球范圍保留所有權(quán)利。Cadence、Cadence 徽標(biāo)和 www.cadence.com/go/trademarks 中列出的其他 Cadence 標(biāo)志均為 Cadence Design Systems, Inc. 的商標(biāo)或注冊商標(biāo)。所有其他標(biāo)識(shí)均為其各自所有者的資產(chǎn)。