LMKDB 器件是一系列極低抖動(dòng)的 LP-HCSL 緩沖器,支持 PCIe Gen 1 至 Gen 7,并且符合 DB2000QL 標(biāo)準(zhǔn)。這些器件提供靈活的上電順序、故障安全輸入、故障安全輸出、單獨(dú)的輸出有源和非有源引腳、輸入信號(hào)丟失 (LOS) 檢測(cè)和自動(dòng)輸出禁用功能,以及出色的電源噪聲抑制性能。
支持 1.8V 和 3.3V 電源電壓。LMKDB1120,與 3.3V 相比,1.8V 電源可節(jié)省 250mW 功率。
*附件:lmkdb1108.pdf
特性
- LP-HCSL 時(shí)鐘緩沖器和時(shí)鐘多路復(fù)用器,支持:
- PCIe 第 1 代至第 7 代
- CC(共時(shí)鐘)和 IR(獨(dú)立參考)PCIe 架構(gòu)
- 帶或不帶 SSC 的輸入時(shí)鐘
- 符合DB2000QL標(biāo)準(zhǔn):
- 所有設(shè)備均符合DB2000QL規(guī)格
- LMKDB1120與DB2000QL引腳兼容
- 極低的附加抖動(dòng):
- 156.25MHz時(shí)最大12kHz至20MHz RMS附加抖動(dòng)為31fs
- PCIe Gen 4 的最大附加抖動(dòng)為 13fs
- PCIe Gen 5 的最大附加抖動(dòng)為 5fs
- PCIe Gen 6 的 3fs 最大附加抖動(dòng)
- PCIe Gen 7 的 2.1fs 最大附加抖動(dòng)
- 故障安全輸入
- 故障安全輸出(僅限LMKDB1120FS、LMKDB1108FS和LMKDB1104FS)
- 靈活的上電順序
- 自動(dòng)輸出禁用
- 單獨(dú)輸出使能
- SBI(邊帶接口)用于高速輸出啟用或禁用
- LOS(信號(hào)丟失)輸入檢測(cè)
- 85Ω 或 100Ω 輸出阻抗
- 1.8V / 3.3V ± 10% 電源
- –40°C 至 105°C 環(huán)境溫度
參數(shù)
方框圖

?1. 產(chǎn)品概述?
LMKDB11xx是德州儀器(TI)推出的超低抖動(dòng)LP-HCSL時(shí)鐘緩沖器系列,支持PCIe Gen 1至Gen 7標(biāo)準(zhǔn),符合DB2000QL規(guī)范。該系列包含多款型號(hào)(如LMKDB1102/1104/1108/1120等),適用于高性能計(jì)算、服務(wù)器主板、智能網(wǎng)卡等場(chǎng)景,具有以下核心特性:
- ?超低抖動(dòng)性能?:
- PCIe Gen 5添加抖動(dòng)僅5fs(最大值),Gen 7低至2.1fs。
- 156.25MHz下12kHz-20MHz RMS添加抖動(dòng)典型值22fs。
- ?靈活配置?:支持1.8V/3.3V雙電源、可編程輸出擺幅(600-975mV)、可調(diào)輸出阻抗(85Ω/100Ω)。
- ?安全與可靠性?:全系支持輸入故障保護(hù)(Fail-Safe),部分型號(hào)(如LMKDB1120FS)支持輸出故障保護(hù)。
?2. 關(guān)鍵功能?
- ?時(shí)鐘管理?:
- 支持同步輸出使能(OE),避免毛刺。
- 自動(dòng)輸出禁用(AOD)功能,在輸入時(shí)鐘失效時(shí)自動(dòng)靜音輸出。
- ?控制接口?:
- ?SMBus模式?:通過寄存器配置輸出參數(shù)(如斜率、幅度)。
- ? 側(cè)帶接口(SBI) ?:高速(25MHz)輸出使能控制,支持菊花鏈拓?fù)洹?/li>
- ?引腳模式?:通過硬件引腳直接控制基礎(chǔ)功能。
?3. 電氣特性?
- ?工作條件?:
- 電壓范圍:1.71-1.89V(1.8V模式)或2.97-3.6V(3.3V模式)。
- 溫度范圍:-40°C至105°C。
- ?抖動(dòng)性能?(典型值):
- PCIe Gen 5 CC架構(gòu):4.9fs RMS。
- 100MHz時(shí)鐘輸出:31fs RMS(12kHz-20MHz帶寬)。
?4. 封裝與型號(hào)對(duì)比?
| 型號(hào) | 輸出通道數(shù) | 封裝尺寸 | 特性 |
|---|---|---|---|
| LMKDB1102 | 2 | 3mm×3mm VQFN | 可編程阻抗選擇(85Ω/100Ω) |
| LMKDB1120 | 20 | 6mm×6mm TLGA | 兼容DB2000QL,支持20路獨(dú)立OE |
| LMKDB1104FS | 4 | 4mm×4mm VQFN | 輸入/輸出故障保護(hù) |
?5. 應(yīng)用設(shè)計(jì)建議?
- ?布局優(yōu)化?:匹配PCB走線阻抗(85Ω/100Ω),減少傳輸線不連續(xù)性。
- ?電源設(shè)計(jì)?:每個(gè)電源引腳需配置0.1μF去耦電容,推薦添加鐵氧體磁珠抑制噪聲。
- ?散熱管理?:確保散熱焊盤與PCB良好連接以降低熱阻。
?6. 文檔支持?
- 提供詳細(xì)的寄存器映射表(如R0-R100),支持SMBus/SBI寄存器編程。
- 評(píng)估模塊(EVM)用戶指南和相位噪聲測(cè)試數(shù)據(jù)可供參考。
該系列通過極低的抖動(dòng)和靈活的配置,為PCIe Gen 5/6/7等高速接口提供可靠的時(shí)鐘分配解決方案。
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