System Generator for DSP的設(shè)計流程
Xilinx System Generator?for DSP是Simulink的一個插件，使設(shè)計人員能夠為Xilinx FPGA開發(fā)高性能DSP系統(tǒng)。設(shè)計人員可以使用MATLAB，Simulink和Xilinx bit / cycle-true模型庫來設(shè)計和仿真系統(tǒng)。然后，該工具將自動生成映射到Xilinx預(yù)優(yōu)化算法的可綜合硬件描述語言（HDL）代碼。然后可以合成此HDL設(shè)計，以便在Xilinx FPGA和All Programmable SoC上實現(xiàn)。因此，設(shè)計人員可以定義系統(tǒng)級設(shè)計的抽象表示，并輕松地將此單個源代碼轉(zhuǎn)換為門級表示。此外，它還提供自動生成HDL測試平臺，可在實施時進行設(shè)計驗證。
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