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FPGA設計論壇

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FPGA之異構計算

對于一個開發(fā)人員,可能聽說過FPGA,甚至在大學課程設計中,可能拿FPGA做過計算機體系架構相關的驗....
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中國FPGA芯片技術解析

FPGA可用于處理多元計算密集型任務,依托流水線并行結構體系,F(xiàn)PGA相對GPU、CPU在計算結果返....
的頭像 FPGA設計論壇 發(fā)表于 02-03 06:10 ?1708次閱讀

串行 RapidIO: 高性能嵌入式互連技術

RapidIO 與傳統(tǒng)嵌入互連方式的比較 ????隨著高性能嵌入式系統(tǒng)的不斷發(fā)展,芯片間及板間互連對....
的頭像 FPGA設計論壇 發(fā)表于 02-02 14:15 ?1385次閱讀

FPGA!國內哪些公司比較牛?

國產FPGA市場格局及進展 摘要:FPGA作為通信、航天、軍工等領域的關鍵核心器件,是保障國家戰(zhàn)略安....
的頭像 FPGA設計論壇 發(fā)表于 02-01 23:05 ?5161次閱讀

FPGA——HLS簡介

HLS ?(high-level synthesis)稱為高級綜合, 它的主要功能是用 C/C++為....
的頭像 FPGA設計論壇 發(fā)表于 01-15 12:10 ?6851次閱讀

至芯科技12年不忘初心、再度起航2月11日北京中心FPGA工程師就業(yè)班開課、線上線下多維教學、歡迎咨詢!

點擊上方 藍字 關注我們 背景: 行業(yè)迅速崛起,但人才缺口大 近幾年,在FPGA的需求持續(xù)走高時,F(xiàn)....
的頭像 FPGA設計論壇 發(fā)表于 01-14 16:40 ?1158次閱讀

FPGA工程師需要掌握的技能

1.? ? ?需求核對階段 1)良好的溝通技能:需要與需求方核對需要的功能及性能,態(tài)度很重要,謙遜專....
的頭像 FPGA設計論壇 發(fā)表于 01-13 17:40 ?2801次閱讀

FPGA優(yōu)缺點,學習FPGA的優(yōu)勢在哪里?

FPGA 優(yōu)點: 設計周期短,靈活。 適合用于小批量系統(tǒng),提高系統(tǒng)的可靠性和集成度。 FPGA前景:....
的頭像 FPGA設計論壇 發(fā)表于 01-11 03:25 ?4046次閱讀

淺析FPGA的應用領域

FPGA 最初的應用領域也是傳統(tǒng)的應用領域,通信領域,但隨著信息產業(yè)以及微電子計數(shù)發(fā)展,F(xiàn)PGA的應....
的頭像 FPGA設計論壇 發(fā)表于 01-09 19:11 ?8085次閱讀

掌握Verilog FPGA設計和驗證方法是AI時代系統(tǒng)設計師的生命線

? ?在人工智能時代,AI的算法不斷推陳出新,對于硬件的算力和靈活度要求很高。FPGA的靈活性剛好符....
的頭像 FPGA設計論壇 發(fā)表于 01-08 18:35 ?1956次閱讀

FPGA到底是什么?,F(xiàn)PGA工程師核心競爭力是什么?

Intel和AMD都斥巨資收購了領先的 FPGA 公司。撇開相對較小的嵌入式計算和通信/互聯(lián)網(wǎng)市場,....
的頭像 FPGA設計論壇 發(fā)表于 01-07 02:45 ?2597次閱讀

PCI總線地址空間與系統(tǒng)地址空間的關系

1、PCI地址空間 PCI總線具有32位數(shù)據(jù)/地址復用總線,所以其存儲地址空間為2的32次方=4GB....
的頭像 FPGA設計論壇 發(fā)表于 01-06 08:30 ?3364次閱讀

verilog的時鐘分頻與時鐘使能

時鐘使能電路是同步設計的基本電路,在很多設計中,雖然內部不同模塊的處理速度不同,但由于這些時鐘是同源....
的頭像 FPGA設計論壇 發(fā)表于 01-05 14:00 ?3077次閱讀

校招FPGA筆試講解

1.對于同步fifo,每100個cycle可以寫入80個數(shù)據(jù),每10個cycle可以讀出8個數(shù)據(jù),f....
的頭像 FPGA設計論壇 發(fā)表于 01-04 10:45 ?1878次閱讀

FPGA學習-IO延遲的約束方法

為了對設計外部的時序情況進行精確建模,設計者必須設定輸入和輸出端口的時序信息。Vivado只能識別出....
的頭像 FPGA設計論壇 發(fā)表于 01-01 11:50 ?5012次閱讀

FIR濾波器和IIR濾波器的區(qū)別與聯(lián)系

1.根據(jù)沖激響應的不同,將數(shù)字濾波器分為有限沖激響應(FIR)濾波器和無限沖激響應(IIR)濾波器。....
的頭像 FPGA設計論壇 發(fā)表于 12-30 23:45 ?5579次閱讀

Vivado使用技巧-支持的Verilog語法

復雜的電路設計通常使用自頂向下的設計方法,設計過程中的不同階段需要不同的設計規(guī)格。比如架構設計階段,....
的頭像 FPGA設計論壇 發(fā)表于 12-29 10:30 ?7918次閱讀

Vivado使用技巧-HDL編寫

在 Vivado 中進行HDL代碼設計,不僅需要描述數(shù)字邏輯電路中的常用功能,還要考慮如何發(fā)揮Xil....
的頭像 FPGA設計論壇 發(fā)表于 12-28 17:05 ?4747次閱讀

Xilinx FPGA中的基礎邏輯單元

Xilinx FPGA的組成部分 本文是以Xilinx Kintex UltraScale+ 系列為....
的頭像 FPGA設計論壇 發(fā)表于 12-27 15:54 ?3647次閱讀

FPGA上電時序加載過程詳解

目前,大多數(shù) FPGA 芯片是基于 SRAM 的結構的, 而 SRAM 單元中的數(shù)據(jù)掉電就會丟失,因....
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FPGA基礎資源之IOB的應用

FPGA基礎資源之IOB的應用 1.應用背景 在我們做時序約束時,有時候需要對FPGA驅動的外圍器件....
的頭像 FPGA設計論壇 發(fā)表于 12-25 16:30 ?6452次閱讀

基于LVDS差分接口之IOSERDES的高速串行通信

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FPGA學習-DDR3

一、DDR3簡介 ? ? ? ? DDR3全稱double-data-rate 3 synchron....
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基于FPGA實現(xiàn)PN序列發(fā)生器的設計

近年來,擴頻通信技術在移動通信、個人通信、室內 無線通信 以及衛(wèi)星通信中得到越來越廣泛的應用。對于D....
的頭像 FPGA設計論壇 發(fā)表于 12-20 17:05 ?3673次閱讀

鎖存器、觸發(fā)器、寄存器的關聯(lián)與區(qū)別及其相應的verilog描述

1:鎖存器、觸發(fā)器、寄存器的關聯(lián)與區(qū)別 首先應該明確鎖存器和觸發(fā)器是由與非門之類的東西構成。尤其是鎖....
的頭像 FPGA設計論壇 發(fā)表于 12-19 12:25 ?15196次閱讀

FPGA 結構分析 -IO 資源

關于 FPGA 的 IO資源分析共分為三個系列進行具體闡述,分別為: IO資源:分析FPGA IO資....
的頭像 FPGA設計論壇 發(fā)表于 12-13 13:20 ?3460次閱讀

FPGA學習-Verilog例化說明

Verilog 例化說明 1.什么是模塊例化?為什么要例化? 模塊例化可以理解成模塊調用。對于一個 ....
的頭像 FPGA設計論壇 發(fā)表于 12-12 09:50 ?5772次閱讀

關于多周期路徑約束

一、什么是多周期路徑約束? 不管是quartus中還是在Vivado中,默認的建立時間和保持時間的檢....
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詳解浮點運算的定點編程

我們使用的處理器一般情況下,要么直接支持硬件的 浮點運算 ,比如某些帶有FPU的器件,要么就只支持定....
的頭像 FPGA設計論壇 發(fā)表于 12-09 12:25 ?4093次閱讀
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