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電子發(fā)燒友網(wǎng)技術(shù)文庫(kù)為您提供最新技術(shù)文章，最實(shí)用的電子技術(shù)文章，是您了解電子技術(shù)動(dòng)態(tài)的最佳平臺(tái)。

• 基于FPGA的內(nèi)存128M flash芯片控制器設(shè)計(jì)方案

  這款flash芯片的的存儲(chǔ)是一個(gè)扇區(qū)4KB，一個(gè)扇區(qū)可以存256個(gè)字，一個(gè)字是8位，一個(gè)塊是64KB，一共有256個(gè)塊組成一個(gè)存儲(chǔ)flash內(nèi)存。...

  2269次閱讀 · 0評(píng)論 FPGAFlaSh內(nèi)存狀態(tài)寄存器芯片控制器
  

• 基于FPGA的網(wǎng)絡(luò)攝像頭圖像封裝處理

  上位機(jī)才能夠在接收數(shù)據(jù)后正確顯示圖像。所以每幀圖像的開始需要多傳輸8字節(jié)數(shù)據(jù)，一般規(guī)定每次傳輸一行數(shù)據(jù)，由于OV7725一行有640個(gè)像素，每個(gè)像素16位，而以太網(wǎng)每個(gè)時(shí)鐘傳輸8位數(shù)據(jù)，因此需要1280個(gè)時(shí)鐘才能傳輸完一次數(shù)據(jù)。...

  1453次閱讀 · 0評(píng)論 FPGA以太網(wǎng)攝像頭上位機(jī)網(wǎng)絡(luò)攝像頭
  

• FPGA通過(guò)AXI總線讀寫DDR3實(shí)現(xiàn)方式

  AXI總線由一些核心組成，包括AXI主處理器接口（AXI4）、AXI處理器到協(xié)處理器接口（AXI4-Lite）、AXI主外設(shè)接口（AXI4）、AXI外設(shè)到主處理器接口（AXI4-Lite）等。...

  2712次閱讀 · 0評(píng)論 FPGADDR3總線AXI

• 基于FPGA的多通道高速信號(hào)采集與處理平臺(tái)設(shè)計(jì)方案

  以核心處理板為核心，由信號(hào)源產(chǎn)生的待處理模擬信號(hào)通過(guò)同軸線纜連接到核心處理板的信號(hào)接口，同時(shí)，連接同步時(shí)鐘等其他相關(guān)信號(hào)到核心處理板。...

  2852次閱讀 · 1評(píng)論 FPGA信號(hào)完整性電源完整性信號(hào)采集處理
  

• 利用ISE與Matlab創(chuàng)建并仿真FPGA設(shè)計(jì)中的ROM IP核

  一般都是先創(chuàng)建MIF文件，將圖像中的像素信息用一個(gè)ROM儲(chǔ)存起來(lái)，然后調(diào)用ROM里面的地址進(jìn)行處理，相當(dāng)于制作了一個(gè)ROM查找表。...

  1728次閱讀 · 0評(píng)論 FPGAmatlabROM
  

• FPGA的優(yōu)勢(shì)及潛在局限性介紹

  了解FPGA器件何時(shí)適合實(shí)現(xiàn)所需的系統(tǒng)功能是理解FPGA技術(shù)的關(guān)鍵要素。設(shè)計(jì)團(tuán)隊(duì)明白FPGA技術(shù)并不適用于每一個(gè)設(shè)計(jì)或應(yīng)用程序。...

  2239次閱讀 · 0評(píng)論 FPGA分立器件
  

• CAM在FPGA上的最優(yōu)化實(shí)現(xiàn)方案

  我們都知道RAM是根據(jù)地址查找對(duì)應(yīng)的數(shù)據(jù)，而對(duì)于CAM，則恰好相反，是已知數(shù)據(jù)查找其對(duì)應(yīng)的地址。像在網(wǎng)絡(luò)報(bào)文處理里，根據(jù)報(bào)文的五元組的一些信息去查詢其所屬的規(guī)則地址，隨后通過(guò)該地址去查詢對(duì)應(yīng)的RAM獲取對(duì)應(yīng)的Action信息。...

  2229次閱讀 · 0評(píng)論 FPGA寄存器RAMTCAM
  

• FPGA 原型設(shè)計(jì)開發(fā)復(fù)雜性策略

  FPGA 被封裝在更大的封裝中，從而提供了更多的 I/O。"然而，I/O 的增加并不像邏輯資源那樣引人注目。...

  838次閱讀 · 0評(píng)論 FPGAasicsocHDL機(jī)器學(xué)習(xí)
  

• 淺談FPGA、ASIC和RFSOC

  數(shù)據(jù)轉(zhuǎn)換功能的集成為5G基站中的遠(yuǎn)程無(wú)線單元（RRU）提供了巨大的節(jié)能效果。對(duì)于每個(gè)JESD204通道，節(jié)省的成本大約為1W，或者對(duì)于來(lái)自天線陣列的每個(gè)數(shù)據(jù)流來(lái)說(shuō)，節(jié)省的成本是不同的。...

  6711次閱讀 · 0評(píng)論 FPGA收發(fā)器asic5GRFSoC
  

• FPGA設(shè)計(jì)中為何應(yīng)慎用鎖存器

  鎖存器、觸發(fā)器和寄存器它們的英文分別為：Latch、Flip-Flop、Register。我們對(duì)這三個(gè)單詞的翻譯真的是非常直觀，從名字就能大概猜出它們的含義。...

  1720次閱讀 · 0評(píng)論 FPGA寄存器鎖存器觸發(fā)器時(shí)序邏輯電路
  

• FPGA助力簡(jiǎn)化電源設(shè)計(jì)

  科通技術(shù)了解到AnDAPT電源解決方案的目標(biāo)市場(chǎng)是電源軌數(shù)量較多的市場(chǎng)，因此需要電源管理功能，并通過(guò)AnDAPT產(chǎn)品線幫助AMD產(chǎn)品線的客戶簡(jiǎn)化電源設(shè)計(jì)。...

  769次閱讀 · 0評(píng)論 FPGA芯片Agi
  

• 基于FPGA的TLC5620數(shù)模轉(zhuǎn)換（DA）設(shè)計(jì)

  本設(shè)計(jì)采用串行數(shù)/模轉(zhuǎn)換芯片TLC5620，TLC5620是一個(gè)擁有四路輸出的數(shù)/模轉(zhuǎn)換器，時(shí)鐘頻率最大可達(dá)到1MHz。...

  2684次閱讀 · 0評(píng)論 FPGA運(yùn)算放大器數(shù)模轉(zhuǎn)換器數(shù)模轉(zhuǎn)換基準(zhǔn)電源
  

• FPGA為什么比GPU的延遲低這么多？

  FPGA 正是一種硬件可重構(gòu)的體系結(jié)構(gòu)。它的英文全稱是Field Programmable Gate Array，中文名是現(xiàn)場(chǎng)可編程門陣列。 FPGA常年來(lái)被用作專用芯片（ASIC）的小批量替代品，然而近年來(lái)在微軟、百度等公司的數(shù)據(jù)中心大規(guī)模部署，以同時(shí)提供強(qiáng)大的計(jì)算能力和足夠的靈活性。...

  1485次閱讀 · 0評(píng)論 cpugpu圖像處理交換機(jī)機(jī)器學(xué)習(xí)
  

• 基于FPGA的網(wǎng)絡(luò)加速設(shè)計(jì)實(shí)現(xiàn)

  首先是FPGA硬件的變化太多，各個(gè)模塊可配參數(shù)的變化（比如卷積模塊并行數(shù)的變化），另外一個(gè)是網(wǎng)絡(luò)模型多種多樣以及開源的網(wǎng)絡(luò)模型平臺(tái)也很多（tensorflow，pytorch等）。網(wǎng)絡(luò)壓縮也有很多種算法，這些算法基本上都會(huì)導(dǎo)致網(wǎng)絡(luò)模型精度的降低。...

  2256次閱讀 · 0評(píng)論 FPGA神經(jīng)網(wǎng)絡(luò)算力
  

• 基于FPGA進(jìn)行DNN設(shè)計(jì)的經(jīng)驗(yàn)總結(jié)

  DNN中應(yīng)用最廣泛的是CNN和RNN，CNN是一種卷積網(wǎng)絡(luò)，在圖片識(shí)別分類中用的較多，RNN可以處理時(shí)間序列的信息，比如視頻識(shí)別和語(yǔ)音識(shí)別。...

  1292次閱讀 · 0評(píng)論 FPGAcpu神經(jīng)網(wǎng)絡(luò)機(jī)器學(xué)習(xí)dnn
  

• 深入探索Vivado非工程模式FPGA設(shè)計(jì)流程

  在設(shè)計(jì)過(guò)程的每個(gè)階段，設(shè)計(jì)者均可以打開Vivado集成開發(fā)環(huán)境，對(duì)存儲(chǔ)器中保存的當(dāng)前設(shè)計(jì)進(jìn)行分析和操作。...

  2155次閱讀 · 0評(píng)論 FPGA數(shù)據(jù)庫(kù)Vivado
  

• 詳解Vivado非工程模式的精細(xì)設(shè)計(jì)過(guò)程

  將設(shè)置設(shè)計(jì)的輸出路徑，設(shè)置設(shè)計(jì)輸出路徑的步驟如下所示。 第一步：如圖4.3所示，在“Vivado%”提示符后輸入命令“set outputDir ./gate_Created_Data/top_output”。...

  3435次閱讀 · 0評(píng)論 XilinxWINDOWS操作系統(tǒng)Vivado
  

• FPGA設(shè)計(jì)中SPI的參數(shù)化結(jié)構(gòu)設(shè)計(jì)方法

  為了避免每次SPI驅(qū)動(dòng)重寫，直接參數(shù)化，盡量一勞永逸。SPI master有啥用呢，你發(fā)現(xiàn)各種外圍芯片的配置一般都是通過(guò)SPI配置的，只不過(guò)有三線和四線。...

  1881次閱讀 · 0評(píng)論 FPGA寄存器cpuSPI
  

• FPGA對(duì)顯示接口與面板有何作用

  HDR 內(nèi)容和顯示實(shí)際上包括三個(gè)考慮因素：動(dòng)態(tài)范圍、光電/電光傳遞函數(shù)(OETF/EOTF) 和寬色域。 HDR 提供了從黑色到白色的更大范圍，或通常所稱的更白的白色或更黑的黑色。...

  1342次閱讀 · 0評(píng)論 FPGAasic賽靈思socHDR
  

• FPGA異構(gòu)計(jì)算架構(gòu)的深度對(duì)比研究

  FPGA本質(zhì)是一種可編程的芯片?？梢园延布O(shè)計(jì)重復(fù)燒寫在它的可編程存儲(chǔ)器里，從而使FPGA芯片可以執(zhí)行不同的硬件設(shè)計(jì)和功能。...

  1830次閱讀 · 0評(píng)論 FPGA芯片cpld可編程器件異構(gòu)計(jì)算
  
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