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隨著開源的MCU源代碼越來越多，也逐漸的影響著嵌入式系統(tǒng)開發(fā)的思路，出現(xiàn)了兩種以前不常見的設(shè)計思路。第一，原本需要購買一顆MCU芯片的設(shè)計，現(xiàn)在直接考慮購買一顆帶有MCU硬核的FPGA（如ZYNQ系列FPGA）替代，既有MCU的功能，又有接口可編程的能力，更加的靈活；第二種思路是設(shè)計中原本需要寫復(fù)雜控制邏輯的Verilog模塊，現(xiàn)在直接考慮替換為一顆或者多顆開源的MCU IP核，反正這些MCU都是驗(yàn)證過沒問題的，并且占用資源很小，同時可編程也帶來了功能

01、ARM中斷體系 ① ARM體系中，在存儲地址的低位，固化了一個32字節(jié)的硬件中斷向量表。 ② 異常中斷發(fā)生時，程序計數(shù)器PC所指的位置不同，異常中斷就不同。中斷結(jié)束后，中斷不同，返回地址也不同。但是，對于系統(tǒng)復(fù)位中斷，不需要返回，因?yàn)檎麄€應(yīng)用系統(tǒng)就是從復(fù)位中斷中開始的。 數(shù)據(jù)訪問終止：數(shù)據(jù)訪問的地址不存在，或者當(dāng)前地址不允許訪問。 快速中斷請求：外部引腳的快速中斷請求，比外部中斷請求等級高，但是一般外設(shè)的中斷請求使用

作者：雪湖科技 梅碧峰 在這篇文章里你可以了解到廣告推薦算法Wide and deep模型的相關(guān)知識和搭建方法，還能了解到模型優(yōu)化和評估的方式。我還為你準(zhǔn)備了將模型部署到賽靈思 FPGA上做硬件加速的方法，希望對你有幫助。閱讀這篇文章你可能需要20分鐘的時間。 早上起床打開音樂APP，會有今日歌單為你推薦一些歌曲。地鐵上閑來無事，刷一刷抖音等短視頻，讓枯燥的時光變得有趣。睡前打開購物APP，看一看今天是不是有新品上架。不知不覺大家已經(jīng)習(xí)

作者：殷建飛 本文是昨天發(fā)的文章《龍芯杯CPU設(shè)計競賽與ZYNQ設(shè)計流程介紹》接續(xù)部分。重點(diǎn)介紹傳統(tǒng)方式的Linux移植和Xilinx的Petalinux的快速移植開發(fā)兩種。 部分硬件設(shè)計中需要CPU完成對電路寄存器的配置，為了完成Zedboard對FPGA上部分寄存器的配置功能，可以在PS單元（處理器系統(tǒng)）上運(yùn)行裸機(jī)程序（無操作系統(tǒng)支持）完成和PL單元（FPGA部分）的數(shù)據(jù)交互功能，此時PS單元更像單片機(jī)開發(fā)；另一種方法是PS單元運(yùn)行Linux操作系統(tǒng)，通過驅(qū)動程序和應(yīng)用程序完

PIPE 接口上的數(shù)據(jù)在 Gen3 的速度下被加密。當(dāng)調(diào)試 PCIe 問題時，能在 PCIe 鏈接上查看各個包會很有幫助。 若要實(shí)現(xiàn)此目的，用戶需擁有協(xié)議鏈接分析器。由于其成本較高，能接觸到此等設(shè)備的用戶不多。隨協(xié)議鏈接分析器提供的包分析工具很廣泛，可對鏈接流量進(jìn)行深入分析。 賽靈思 UltraScale+ 器件的 PCIe Express Gen3 IP 集成塊有一個功能，可讓您集成一個解擾器模塊，以便解密在 PIPE 接口上被加密的數(shù)據(jù)。盡管它不能提供與協(xié)議鏈接分析器相同數(shù)量的分析

發(fā)起沿（LaunchEdge）：數(shù)據(jù)被launch的時鐘邊沿；也就是說，每一個啟動沿，一般都會產(chǎn)生一個新的數(shù)據(jù)！

原因很簡單，不經(jīng)過編碼的源視頻數(shù)據(jù)量太大了。例如輸出一路1920×1080分辨率、24位色、每秒30幀的高清視頻，就這么一秒鐘的視頻，它的碼率達(dá)就到了1.5Gbps.因此需要編碼。

對ZYNQ的學(xué)習(xí)的渴望由來已久，前不久買了一個基于xc7z010的開發(fā)板，現(xiàn)在將自己的學(xué)習(xí)的進(jìn)階之路記錄在此，希望能給想要入門的ZYNQ學(xué)習(xí)者一點(diǎn)幫助，本人也剛開始學(xué)習(xí)，能力有限，其中若有不足之處希望大家多多交流，以便共同進(jìn)步！ xilinx ZYNQ-7000系列芯片將處理器的軟件可編程能力與FPGA的硬件可編程能力實(shí)現(xiàn)了完美結(jié)合，有低功耗和低成本等系統(tǒng)優(yōu)勢，可以實(shí)現(xiàn)無與倫比的系統(tǒng)性能、靈活性和可擴(kuò)展性，同時可以加速產(chǎn)品的上市進(jìn)程。與傳統(tǒng)的SoC處

用籃球砸中 3 米外懸停的無人機(jī)，你能做到嗎？ 那些打過籃球并玩過無人機(jī)的人，會想當(dāng)然地回答，小事一樁。但在這臺無人機(jī)面前，你錯了，因?yàn)樗鼤焖?、靈活地躲避飛來的襲擊。 最近，來自瑞士蘇黎世大學(xué)（University of Zurich）的研究人員設(shè)計出一種新方法，可以讓無人機(jī)在主動躲閃移動障礙物的情況下快速導(dǎo)航。 該研究讓無人機(jī)向著擁有更優(yōu)異的性能，比如在惡劣環(huán)境下更快速地飛行，在更短時間內(nèi)完成更多任務(wù)等邁出很大一步。 圖 | 成功躲避

單片射頻器件大大方便了一定范圍內(nèi)無線通信領(lǐng)域的應(yīng)用，采用合適的微控制器和天線并結(jié)合此收發(fā)器件即可構(gòu)成完整的無線通信鏈路。 它們可以集成在一塊很小的電路板上，應(yīng)用于無線數(shù)字音頻、數(shù)字視頻數(shù)據(jù)傳輸系統(tǒng)，無線遙控和遙測系統(tǒng)，無線數(shù)據(jù)采集系統(tǒng)，無線網(wǎng)絡(luò)以及無線安全防范系統(tǒng)等眾多領(lǐng)域。 1、 數(shù)字電路與模擬電路的潛在矛盾 如果模擬電路（射頻） 和數(shù)字電路（微控制器） 單獨(dú)工作可能各自工作良好，但是一旦將兩者放在同一塊電

OFFSET語句：OFFSET說明了外部時鐘和與其相關(guān)的輸入，輸出數(shù)據(jù)引腳之間的時序關(guān)系。

作者：高志凱 一次常規(guī)調(diào)試中發(fā)現(xiàn)上電后交換機(jī)多個口同時打流會導(dǎo)致卡死的現(xiàn)象，最后一步步分析問題出現(xiàn)的原因是位寬不夠?qū)е碌囊绯?。這讓我回想起團(tuán)隊(duì)已經(jīng)量產(chǎn)的某款芯片，也是因?yàn)槟硞€寄存器位寬設(shè)置過小的原因，導(dǎo)致組播組設(shè)置的時候不能超過31，否則就會溢出，只能想辦法通過軟件來解決這個問題。這次出現(xiàn)問題的交換機(jī)是基于共享緩存的架構(gòu)，希望后面引以為戒，設(shè)計每個小的寄存器時都要考慮全面。 背景 在使用verilog進(jìn)行程序設(shè)計時

一、簡介 RapidIO是由Motorola和Mercury等公司率先倡導(dǎo)的一種高性能、 低引腳數(shù)、 基于數(shù)據(jù)包交換的互連體系結(jié)構(gòu)，是為滿足和未來高性能嵌入式系統(tǒng)需求而設(shè)計的一種開放式互連技術(shù)標(biāo)準(zhǔn)。RapidIO主要應(yīng)用于嵌入式系統(tǒng)內(nèi)部互連，支持芯片到芯片、板到板間的通訊，可作為嵌入式設(shè)備的背板（Backplane）連接。 RapidIO協(xié)議由邏輯層、傳輸層和物理層構(gòu)成。邏輯層定義了所有協(xié)議和包格式。這是對終端進(jìn)行初始化和完成傳送的很有必要的信息。傳輸層為數(shù)據(jù)包從

連續(xù)賦值語句總是處于激活狀態(tài)。只要任意一個操作數(shù)發(fā)生變化，表達(dá)式就會被立即重新計算，并且將結(jié)果賦給等號左邊的線網(wǎng)。

詳細(xì)解析vivado約束時序路徑分析問題...

項(xiàng)目介紹1 RDA5807M模塊是小型化的調(diào)頻收音模塊。為了便于能夠在面包板上進(jìn)行實(shí)驗(yàn)，下面將該模塊通過一個轉(zhuǎn)接板來形成六針接口模塊，這便于在面包板上完成相應(yīng)的實(shí)驗(yàn)。 六針接口的定義如下：正視模塊，排針在最下面，從左到右的功能分別是： 在新的功能模塊上增加了3.3V的穩(wěn)壓芯片：A1117-3.3V，I2C總線的上拉電阻：10k \Omega。 ： 將RDA5807焊接在轉(zhuǎn)接板上。需要在頂部的天線部分增加一個長度為10厘米的軟線作為RF接收天線。 測試實(shí)驗(yàn) 硬件 將RDA5807轉(zhuǎn)

RDA5807的RSSI信號響應(yīng)RF強(qiáng)度測試...

uart接收模塊設(shè)計主要分為波特率控制計數(shù)邏輯和按位接收邏輯。

idelay2中按推薦配置，從DATAIN還是從IDATAIN輸入?yún)^(qū)別為是內(nèi)部延時還是從IO輸入，F(xiàn)IXED固定延時，idelay value先輸入0，，時鐘是200M，其他全部接0。

在大部分的教科書中，都會提到如何分頻，包括奇數(shù)分頻，偶數(shù)分頻，小數(shù)分頻等。 1、DDS相位累加器 （1）DDS合成流程 首先講述DSS（直接頻率合成法）的原理。 DDS是重要的頻率合成方法，在波形發(fā)生器中有極其重要的應(yīng)用。DDS主要由以下幾部分組成： a) 相位累加器 b) RAM數(shù)據(jù)讀取 c) D/A轉(zhuǎn)換器 d) 低通濾波器 直接頻率合成法的流程圖，有固定模塊，輸入頻率控制器，輸出固定頻率的波形。如下圖： 此電路最主要模塊是相位累加器，通過相位累加器循環(huán)計