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get_clocks后面的對(duì)象是我們之前通過create_clocks或者create_generated_clocks創(chuàng)建的時(shí)鐘，不在硬件上直接映射。

前言 在FPGA的設(shè)計(jì)中，避免使用鎖存器是幾乎所有FPGA工程師的共識(shí)，Xilinx和Altera也在手冊(cè)中提示大家要慎用鎖存器，除非你明確知道你確實(shí)需要一個(gè)latch來解決問題。而且目前網(wǎng)上大多數(shù)文章都對(duì)鎖存器有個(gè)誤解，我們后面會(huì)詳細(xì)說明。 這篇文章，我們包含如下內(nèi)容： ①鎖存器、觸發(fā)器和寄存器的原理和區(qū)別，為什么鎖存器不好？ ② 什么樣的代碼會(huì)產(chǎn)生鎖存器？ ③ 為什么鎖存器依然存在于FPGA中？ 鎖存器、觸發(fā)器和寄存器的原理和區(qū)別，為什么鎖存器

作者：貓叔 git有多好用我就不用多說了，可謂是程序員必備技能之一。對(duì)于一般的軟件代碼來說，只需把源文件進(jìn)行g(shù)it管理即可。但對(duì)于FPGA工程師來說，使用git多多少少有些蛋疼，主要有下面幾個(gè)問題： ① 有bd文件的工程中，只把bd文件加入git是不行的； ② 很多公司都會(huì)有一些積累下來的hdl文件，放到某個(gè)文件夾中，所有的工程目錄下都會(huì)有這個(gè)文件夾，因此這個(gè)文件中會(huì)有很多不是當(dāng)前工程的文件，因此git的文件中，必須包含當(dāng)前工程的files list，

跳頻通信具有良好的抗干擾、抗多徑衰落、抗截獲等能力和同步迅速等特點(diǎn)，廣泛應(yīng)用于軍事、交通、商業(yè)等各個(gè)領(lǐng)域。其關(guān)鍵技術(shù)主要有三點(diǎn):跳頻序列發(fā)生器、跳頻頻率合成器和跳頻同步器。頻率合成器是跳頻系統(tǒng)的心臟，直接影響到跳頻信號(hào)的穩(wěn)定性和產(chǎn)生頻率的準(zhǔn)確度，在跳頻頻率合成器中,直接數(shù)字式頻率合成器(Direct Digital Synthesizer :DDS)使用最為廣泛。DDS這簡單可靠、控制方便，且具有很高的頻率分辨率和轉(zhuǎn)換速度，非常適合跳頻通信的要求。

深度解析Xilinx FPGA的GTx的參考時(shí)鐘...

FPGA設(shè)計(jì)中兩種IO約束：管腳約束，延遲約束...

Q： 什么是上拉/下拉電阻？有什么作用？又該怎么用？ A： 上拉電阻：將一個(gè)不確定的信號(hào)通過電阻連接到高電平（VCC），使該信號(hào)初始電平為高電平。下拉電阻：將一個(gè)不確定的信號(hào)通過電阻連接到低電平（GND），使該信號(hào)的初始電平為低電平。 上拉下拉電阻如何接線？ 上拉電阻示例 電阻R12將KEY1網(wǎng)絡(luò)標(biāo)識(shí)上拉到高電平，在按鍵S2沒有按下的情況下KEY1將被鉗制在高電平，從而避免了引腳懸空而引起的誤動(dòng)作。 下拉電阻示例 電阻R29將DIR網(wǎng)絡(luò)標(biāo)識(shí)下拉到

本文主要介紹各種通信接口物理層的編碼技術(shù)，包括數(shù)字-數(shù)字接口編碼方式、數(shù)字-模擬接口編碼方式、模擬-數(shù)字接口編碼方式、模擬-模擬接口編碼方式。 Digital to Digital Encoding 數(shù)字-數(shù)字接口的編碼方式主要就是對(duì)二進(jìn)制比特流的編碼，常見的可以歸為三大類： 單極性碼（單電平）：非零電平代表一種信號(hào)邏輯狀態(tài)，零電平代表另一種； 極性碼（雙電平）：正電平代表一種信號(hào)邏輯狀態(tài)，負(fù)電平代表另一種； 雙極性碼（多電平）：無線路信號(hào)代表一種

極性碼采用兩個(gè)電壓值編碼：正電平代表一種信號(hào)邏輯狀態(tài)，負(fù)電平代表另一種狀態(tài)。極性碼包括：歸零碼、不歸零碼、雙相位碼、塊編碼等。下面就進(jìn)行詳細(xì)介紹。 RZ Encoding 歸零編碼使用兩組電平值：正-零，負(fù)-零。 信號(hào)變化不是發(fā)生在比特之間而是發(fā)生在每個(gè)比特內(nèi)。在每個(gè)比特間隙的中段，信號(hào)將歸零。比特1實(shí)際上是用正電平跳變到零表示，比特0則用負(fù)電平跳變到零表示，而不是僅僅通過電平的正負(fù)來表示。在每個(gè)比特內(nèi)產(chǎn)生信號(hào)變化可以解決

AXI 協(xié)議主要描述了主設(shè)備和從設(shè)備之間的數(shù)據(jù)傳輸方式，主設(shè)備和從設(shè)備之間通過握手信號(hào)建立連接。當(dāng)從設(shè)備準(zhǔn)備好接收數(shù)據(jù)時(shí)，會(huì)發(fā)出 READY 信號(hào)。

電磁閥是一種將電能轉(zhuǎn)換為機(jī)械能的裝置。它的線圈纏繞在導(dǎo)電材料上，這種裝置起到電磁鐵的作用。電磁鐵相對(duì)于天然磁鐵的優(yōu)點(diǎn)在于，當(dāng)需要通過激勵(lì)線圈時(shí)可以打開或關(guān)閉電磁鐵。

本系列文章主要針對(duì)FPGA初學(xué)者編寫，包括FPGA的模塊書寫、基礎(chǔ)語法、狀態(tài)機(jī)、RAM、UART、SPI、VGA、以及功能驗(yàn)證等。將每一個(gè)知識(shí)點(diǎn)作為一個(gè)章節(jié)進(jìn)行講解，旨在更快速的提升初學(xué)者在FPGA開發(fā)方面的能力，每一個(gè)章節(jié)中都有針對(duì)性的代碼書寫以及代碼的講解，可作為讀者參考。 第一章：模塊書寫 Verilog HDL 語言的基本語法與 C語言相似，因此與 VHDL 相比較更容易上手。本章將會(huì)在實(shí)際小項(xiàng)目的基礎(chǔ)上，以 Verilog HDL 語言為主， 教讀者怎么更方便、更高效的

淺談數(shù)字-數(shù)字編碼中的雙極性碼...

基于ESP32-CAM模塊IP監(jiān)控CCTV的人臉識(shí)別系統(tǒng)...

深入研究數(shù)字-模擬編碼技術(shù)...

新發(fā)地來勢(shì)洶洶的疫情，再次牽動(dòng)著全國人民的心，我們要保持信心，保持警惕，打贏這場(chǎng)防疫戰(zhàn)！而機(jī)器人的加入，必然是錦上添花。在隔離區(qū)，機(jī)器人實(shí)現(xiàn)了無接觸配送，保障了隔離區(qū)內(nèi)人員的生活。在醫(yī)院感染區(qū)，移動(dòng)機(jī)器人可以代替醫(yī)護(hù)人員進(jìn)入感染區(qū)執(zhí)行消毒，看護(hù)，體溫測(cè)量，清潔等工作，減少了醫(yī)護(hù)人員的感染風(fēng)險(xiǎn)。在居民社區(qū)，機(jī)器人實(shí)現(xiàn)了防疫宣傳、外來人口登記，保障了疫情期間人們的正常生活 這些功能的實(shí)現(xiàn)，都離不開機(jī)器人的

針對(duì)現(xiàn)在廣泛應(yīng)用的電力巡檢無人機(jī)存在的充電自主化水平低問題，廣西電網(wǎng)有限責(zé)任公司電力科學(xué)研究院的研究人員陳千懿、高立克、陳紹南、肖靜，在2020年第5期《電氣技術(shù)》雜志上撰文，設(shè)計(jì)了基于磁耦合諧振原理的無線充電系統(tǒng)。 針對(duì)目前廣泛采用的具有對(duì)中機(jī)構(gòu)的固定機(jī)場(chǎng)，研究人員通過COMSOL仿真分析3種不同磁耦合機(jī)構(gòu)的磁路分布、磁場(chǎng)強(qiáng)度及抗偏移性能，發(fā)現(xiàn)螺線管型磁耦合機(jī)構(gòu)耦合系數(shù)高、磁通密度大、抗偏移性能更好。進(jìn)一步分析了

可例化的XPM方案解析...

一、前言：長鑫DRAM芯片的普及需要更多的大陸內(nèi)存廠商 可能很多同學(xué)提到臺(tái)電內(nèi)存，可能會(huì)覺得他們不是一線頂尖品牌，顆粒使用上也不會(huì)有什么亮點(diǎn)，不過這一次，臺(tái)電騰龍G40內(nèi)存100%用了原廠顆粒，而且是來自于合肥長鑫的純國產(chǎn)CXMT DRAM芯片。 合肥長鑫作為國產(chǎn)DRAM芯片行業(yè)的代表，曾經(jīng)吸收過奇夢(mèng)達(dá)(Qimonda)的部分資源，這家德國DRAM廠商沒能等到熬過10年前的內(nèi)存寒冬，在破產(chǎn)后將2.8TB的技術(shù)文件以及16000相專利申請(qǐng)轉(zhuǎn)讓給了合肥長鑫。 經(jīng)過了足足

如何把賽靈思SDK工程移植到Vitis...