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可編程邏輯

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矩陣鍵盤的線反轉(zhuǎn)法用FPGA怎么實現(xiàn)呢？

2019-04-01 標(biāo)簽：FPGA 矩陣鍵盤線反轉(zhuǎn)

求網(wǎng)絡(luò)層和傳輸層有關(guān)的Verilog開源代碼

2019-03-31 標(biāo)簽：Verilog

FPGA小白 Win10 ISE14.7 用一塊斯巴達(dá)6的板子

2019-03-31 標(biāo)簽：FPGA ISE

請問有基于FPGA的數(shù)字鑒相的模塊嗎？

2019-03-30 標(biāo)簽：FPGA 雷達(dá)

用FPGA實現(xiàn)算法的功能，結(jié)果最后出來的timing score特別高，結(jié)果也是錯的，請問有辦法優(yōu)化么？

2019-03-28 標(biāo)簽：FPGA ISE 時序

FPGA的一些基礎(chǔ)資料分享

2019-03-28 標(biāo)簽：FPGA

請教大家，有pid 的代碼嗎

2019-03-28 標(biāo)簽：PID FPGA

有用CLCYCLONE 10 LP的高手請指點一下

2019-03-27 標(biāo)簽：分頻器 IP核

想請問如何將lms算法 rls算法通過fpga實現(xiàn)呢

2019-03-27 標(biāo)簽：LMS算法 RLS算法 FPGA

FPGA時鐘問題

2019-03-27 標(biāo)簽：FPGA 時鐘

給VHDL/Verilog的初學(xué)者的一些實用建議

2019-03-27 標(biāo)簽：Verilog VHDL

【modelsim】代碼再次打開一部分變成了一行/x00/x00/x00/...請問是什么原因？

2019-03-26 標(biāo)簽：modelsim Verilog

2019-03-26 標(biāo)簽：verilog HDL Verilog

FPGA想先開啟核電壓再開啟輔助電壓的芯片

2019-03-26 標(biāo)簽：FPGA

FPGA的擴展IO引腳作為輸入直接采集信號？

2019-03-26 標(biāo)簽：FPGA FPGA開發(fā)板

想用CPLD生成兩路方波，所用的芯片為Xilinx的XC2C64A-5QFG48C

2019-03-25 標(biāo)簽：CPLD Xilinx

Verilog HDL語言編程的誤區(qū)與經(jīng)驗

2019-03-26 標(biāo)簽：Verilog

學(xué)會這6個步驟，讓你輕松成為FPGA設(shè)計高手

2019-03-26 標(biāo)簽：FPGA

PXI系列的I/O卡驅(qū)動問題

2019-03-25 標(biāo)簽：PXI機箱 PXI系統(tǒng)

請問誰有QUARTUS17.1里面Platform Designer的開發(fā)資料？最近想要用AX1025。

2019-03-25 標(biāo)簽：QUARTUS FFT

FPGA開發(fā)全攻略（全，分為上下2部）

2019-03-25 標(biāo)簽：FPGA

新人剛用modelsim仿真，編譯通過了，但是還是沒有辦法仿真，求助各位大佬！

2019-03-24 標(biāo)簽：編譯 modelsim

請問一個完整的VI程序由那幾部分組成

2019-03-24 標(biāo)簽：程序

nios中c語言編程必須用庫函數(shù)版么？

2019-03-23 標(biāo)簽：NIOS c語言

FPGA大公司面試筆試數(shù)電部分試題，你能答到第幾題？

2019-03-24 標(biāo)簽：數(shù)字電路 FPGA

ise win7 32位系統(tǒng)用一天就打不開了

2019-03-21 標(biāo)簽：win7 ISE

ISE中的net load delay是什么意思

2019-03-21 標(biāo)簽：ISE Xilinx

【PYNQ-Z2試用體驗】剪枝量化好幫手，深鑒科技Deepin套件DNNDK使用(結(jié)項)

2019-03-21 標(biāo)簽：Xilinx PYNQ-Z2

FPGA

2019-03-21 標(biāo)簽：電源板電機驅(qū)動板 FPGA開發(fā)板

CYCLONE IV FPGA想用JTAG口編程FLASH，提問關(guān)于MSEL的BANK區(qū)為1.8V時的配置問題

2019-03-21 標(biāo)簽：JTAG FPGA

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