語音芯片在0.18um以及工作頻率高達300MHz的芯片設(shè)計，基本的限制因素是綜合和布局布線必須分開，用有線搭載模型( WLM )進行鏈接。在過去的一年中，具有常規(guī)時序驅(qū)動布局布線的總體方法已被能夠提供更好的時序預測性能的物理總體方法取代?？墒菍Ω呒壭酒O(shè)計來講，只靠物理學綜合性也沒法出示詳細的解決方法。如今的物理學綜合性專用工具沒法一次保持數(shù)千萬門的設(shè)計方案。因此，必須將設(shè)計分割成一些可管理的模塊。

尖端ASIC的語音芯片設(shè)計規(guī)模通常超過500萬門、工作頻率大于250 MHz，我們所面臨的挑戰(zhàn)是使其性能跟上CPU頻率的持續(xù)提高，同時保持成本降低并適應(yīng)開發(fā)進度的要求。我們的應(yīng)對方法是一種稱為“結(jié)構(gòu)定制”的混合技術(shù)。

一般情況下，一個語音芯片的設(shè)計始于它的宏功能劃分，每個宏功能由一名獨立的設(shè)計人員創(chuàng)建。然后，下一層的設(shè)計人員將這些模塊(宏功能)嵌入一個新的設(shè)計中，這一進程繼續(xù)進行直至語音芯片設(shè)計完成。現(xiàn)在，一個典型的語音芯片大致有兩層，由五十個左右單獨的設(shè)計構(gòu)成，所有這些都由有限的設(shè)計人員管理。

以前，即使不是全部的模塊，也有許多模塊是定制的?，F(xiàn)在，強國科技在許多語音芯片的選定模塊中使用，按照功能和語音長度給客戶選定適合的語音芯片。這樣可以造成成本不浪費，在能達到客戶要求情況下做到成本低。

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