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串行數(shù)據(jù)發(fā)生器電路原理圖

CHANBAEK ? 來(lái)源:circuit-diagramz ? 作者:circuit-diagramz ? 2023-12-21 17:14 ? 次閱讀
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使用數(shù)據(jù)發(fā)生器測(cè)試電路

數(shù)據(jù)生成器提供了一種簡(jiǎn)單的電路測(cè)試方法,無(wú)需復(fù)雜的軟件。所有必要的組件都很容易接近。該電路設(shè)計(jì)圍繞 SDA3002 型電路的時(shí)序進(jìn)行構(gòu)建,采用三線連接而不是兩線 I2C 格式。在僅需要單個(gè)固定數(shù)據(jù)字的情況下,可以省略 DIP 開關(guān) S2 和 S3 以及八倍拉電阻陣列。這導(dǎo)致 IC3 和 IC4 的輸入保持在固定電平。該發(fā)生器的基礎(chǔ)是兩個(gè)級(jí)聯(lián)移位寄存器(IC3 和 IC4),用作與串行轉(zhuǎn)換器并行運(yùn)行的 16 位寄存器。

時(shí)鐘生成和初始化

IC2 提供時(shí)鐘,通過(guò)使用按鈕開關(guān) S1 設(shè)置雙穩(wěn)態(tài) IC1a.b 來(lái)啟動(dòng)。按下 S1 后,通過(guò)微分網(wǎng)絡(luò) R1 和 C1 施加 100 脈沖以設(shè)置雙穩(wěn)態(tài)的輸入。電容器通過(guò) R2 放電。值得注意的是,即使按住 S1,脈沖持續(xù)時(shí)間也保持恒定。這對(duì)于防止時(shí)序差異至關(guān)重要,因?yàn)槌^(guò)半個(gè)時(shí)鐘周期可能會(huì)導(dǎo)致問(wèn)題。 IC1b 的輸出用作被測(cè)電路的使能信號(hào)。啟動(dòng)脈沖還有助于將用 DIP 開關(guān)配置的邏輯電平加載到移位寄存器上。只要引腳 1 處的信號(hào)為低電平,寄存器就接受并行數(shù)據(jù),這強(qiáng)調(diào)了短啟動(dòng)脈沖的必要性。

串行數(shù)據(jù)發(fā)生器示意圖

測(cè)試周期啟動(dòng)和時(shí)鐘生成

整個(gè)測(cè)試周期的開始由啟動(dòng)信號(hào)標(biāo)記。參見(jiàn)圖2的時(shí)序圖,IC2的輸出23經(jīng)過(guò)IC1d反相,作為移位寄存器的時(shí)鐘源。這種安排可確保 D0 在整個(gè)時(shí)鐘周期內(nèi)保持在輸出狀態(tài),持續(xù) 1.25 ms。當(dāng)達(dá)到高輸出 18 次時(shí),雙穩(wěn)態(tài)復(fù)位,IC1 的輸出 23(與 IC2 的輸出 25 和 28 連接)將啟用線拉低,結(jié)束周期。

可變位移位和雙穩(wěn)態(tài)加法

在此圖中,總共 18 位經(jīng)歷了移位。兩個(gè)最高有效位 (MSB) 受 IC3 串行輸入的影響。如果該輸入寄存器為高電平,則 D16 和 D17 被設(shè)置為“1”。如果需要靈活地使這些位成為變量,則必須引入一個(gè)或兩個(gè)作為移位寄存器連接的附加雙穩(wěn)態(tài)。當(dāng)所有位都為高電平時(shí),發(fā)生器的電流消耗(主要由下拉電阻決定)仍然非常低,約為 80。按下 S1 后,振蕩器會(huì)短暫激活,使電流加倍。

串行數(shù)據(jù)發(fā)生器示意圖

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