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FPGA/ASIC技術(shù)
電子發(fā)燒友本欄目為FPGA/ASIC技術(shù)專欄，內(nèi)容有fpga培圳資料、FPGA開發(fā)板、FPGA CPLD知識以及FPGA/ASIC技術(shù)的其它應(yīng)用等；是您學(xué)習(xí)FPGA/ASIC技術(shù)的好欄目。
成功的平臺商業(yè)戰(zhàn)略：適合不同層次級別的企業(yè)購買采用
作者： Mike Santarini, 出版商，Xcell雜志 下面的內(nèi)容是同發(fā)布在Xcell雜志的封面文章是相同的，詳細(xì)的分析比較了兩類硅工藝平臺產(chǎn)品，給出了一個全面的成本及效益分析，其中一類是賽靈思的Z...
2017-02-08 標(biāo)簽： 349
Adam Taylor玩轉(zhuǎn)MicroZed系列50：AMP（非對稱多進(jìn)程處理模式）和Zynq SoC的OCM（片上存
作者：Adam Taylor 在上一篇博客中我們了解了Zynq SoC的OCM（片上存儲器） ，利用它可以實(shí)現(xiàn)在AMP模式下內(nèi)部處理器內(nèi)核之間的通信?，F(xiàn)在我們將寫一些程序代碼將這個設(shè)備（OCM）利用起來。 在這...
2017-02-08 標(biāo)簽： 1140
2014就快過去了，你知道你的SDRAM在哪里嗎？它將會有什么變化？
作者：Steve Leibson, 賽靈思戰(zhàn)略營銷與業(yè)務(wù)規(guī)劃總監(jiān) 上周在X-fest San Jose大會上，我參加了四個技術(shù)座談會，第一個就是關(guān)于存儲器接口和FPGA的，尤其是Xilinx的UltraScale系列FPGA。這次座談會上有很...
2017-02-08 標(biāo)簽： 407
JESD204B ADC接口將采樣信號流（速度高達(dá)Gsamples/sec）轉(zhuǎn)換成多通道傳輸
作者：Steve Leibson, 賽靈思戰(zhàn)略營銷與業(yè)務(wù)規(guī)劃總監(jiān) 上周在X-fest San Jose大會上，我結(jié)識了安富利電子公司負(fù)責(zé)全球技術(shù)市場和數(shù)字信號處理業(yè)務(wù)的主管Luc Langlois先生，并且從他那里學(xué)到了一個小...
2017-02-08 標(biāo)簽： 366
Adam Taylor玩轉(zhuǎn)MicroZed系列52：一年15萬訪問量，獎勵大家一個pdf文檔
我必須承認(rèn)這是一篇我從來不希望要寫的博客。當(dāng)我開始寫玩轉(zhuǎn)MicroZed時，我還不確定每周一篇寫到52篇。達(dá)到這樣的里程碑并擁有150,000的瀏覽量，我想回顧過去的一年在Zynq SoC上涵蓋的內(nèi)容。...
2017-02-08 標(biāo)簽： 345
常見的機(jī)器視覺工具（轉(zhuǎn)載）
一、開源的OpenCV 機(jī)器視覺我們最常用的軟件是OpenCV（Intel OpenSource Computer Vision Library），它的中文論壇里面有非常清楚的介紹。 二、VisionPro?7.0系統(tǒng)，快速開發(fā)強(qiáng)大的應(yīng)用系統(tǒng) 康耐視公司（Co...
2017-02-08 標(biāo)簽： 1264
關(guān)于光纖通信傳輸距離和功率屏障的分析和介紹
光纖提供了令人難以想象的高速數(shù)據(jù)傳輸，但實(shí)際網(wǎng)絡(luò)搭建中如何高效連接光纖網(wǎng)絡(luò)是擺在網(wǎng)路服務(wù)提供商面前的大難題。這意味著傳輸距離是光纖傳輸過程中的一個重要限制因素。...
Vivado中數(shù)據(jù)導(dǎo)入MATLAB的方法
這段時間在使用Xilinx公司的7系列FPGA，調(diào)試一款TI公司的高速ADC。鑒于目前Xilinx已經(jīng)停止了對ISE開發(fā)組件的維護(hù)更新，所以果斷將開發(fā)環(huán)境轉(zhuǎn)到Vivado上來。 眾所周知，ADC調(diào)試不單單是ADC芯片功能...
2017-02-08 標(biāo)簽： 3499
使用Xilinx CORDIC IP核生成正、余弦波
本文介紹如何調(diào)用Xilinx的CORDIC IP核生成某一頻率的正弦波和余弦波。 主要是CORDIC IP核的設(shè)置，下面對其具體參數(shù)的設(shè)置進(jìn)行了說明。 標(biāo)注1：選擇函數(shù)的類型，這里選擇sin和cos。 標(biāo)注2：選擇...
2017-02-08 標(biāo)簽： 8481
Zynq開發(fā)板FPGA比特流文件下載方式
Zynq開發(fā)板FPGA比特流文件可以通過三種途徑下載： 1. 利用SDK生成的FSBL.elf文件自動加載FPGA比特流配置文件，將比特流文件，F(xiàn)SBL.elf文件和u-boot.elf文件利用SDK工具生成BOOT.BIN文件。 2. 利用u-boot下面...
2017-02-08 標(biāo)簽： 1705
關(guān)于xilinx14.6在modelsim SE 10.1a仿真中遇到的若干問題
由于兩個軟件都是較新的版本，在配合使用過程中出現(xiàn)的問題會比較多，且與之前版本的解決辦法有出入。 1.在使用ModelSim軟件對Xilinx ISE進(jìn)行后仿真時，需要先編譯Xilinx的仿真庫。這個在網(wǎng)上一...
2017-02-08 標(biāo)簽： 1129
Zynq平臺下linux的I2C驅(qū)動（RTC+EEPROM）
現(xiàn)在ARM下對SoC開發(fā)板的硬件描述都是采用devicetree文件，使用linux自帶的dtc程序?qū)ts編譯成dtb之后，由u-boot將dtb導(dǎo)入給linux內(nèi)核，linux內(nèi)核讀取dtb，然后注冊設(shè)備的resource，linux內(nèi)核使用of_系列函數(shù)...
2017-02-08 標(biāo)簽： 3895
SDN將成為物聯(lián)網(wǎng)的關(guān)鍵推動者
SDN將利用集中控制和抽象的網(wǎng)絡(luò)設(shè)備為物聯(lián)網(wǎng)（IoT）提供靈活的、動態(tài)的、自動化的網(wǎng)絡(luò)重構(gòu)。 組織對于物聯(lián)網(wǎng)生成數(shù)據(jù)的業(yè)務(wù)價值保持著相當(dāng)高的興奮度，但是很少討論關(guān)于如何管理網(wǎng)絡(luò)設(shè)...
2017-02-08 標(biāo)簽： 410
FFT的分析和Xilinx FFT核的介紹
fft輸入輸出解析。 輸入：fft要求輸入一個復(fù)數(shù)，但一般可以只輸入實(shí)數(shù)。 輸出：輸出一個復(fù)數(shù)，其模為信號強(qiáng)度。相位為波形相位。 設(shè)： 采樣頻率FS 轉(zhuǎn)換長度N 則： 分辨率為FS/N。 ‘量程’為...
2017-02-08 標(biāo)簽： 1641
ZedBoard的啟動流程（以運(yùn)行l(wèi)inux操作系統(tǒng)為例）
ZedBoard啟動需要的文件： 1、BOOT.bin (由fsbl.elf、system.bit、u-boot.elf 組成） 2、devicetree.dtb 3、uImage 4、uramdisk.image.gz ZedBoard的啟動流程通?？梢苑譃槿齻€步驟： 階段0：在器件上電運(yùn)行后，處理器會...
2017-02-08 標(biāo)簽： 938
Basys3開發(fā)板的MicroBlaze串口實(shí)驗(yàn)
一、目的 學(xué)會diagram中MicroBlaze最小系統(tǒng)的組成 學(xué)會導(dǎo)出、建立以及運(yùn)行基于SDK的工程 二、簡介 實(shí)驗(yàn)?zāi)康模?1.通過tcl腳本新建工程 2.通過block diagram框圖學(xué)會microblaze基本結(jié)構(gòu) 3.實(shí)現(xiàn)microblaze調(diào)用...
2017-02-08 標(biāo)簽： 1383
Basys3開發(fā)板實(shí)現(xiàn)示波器設(shè)計(jì)
一、目的 1）掌握基于v文件的vivado工程設(shè)計(jì)流程 2）學(xué)習(xí)示波器的基本組成結(jié)構(gòu) 二、原理介紹 數(shù)字存儲示波器能夠?qū)⒛M信號進(jìn)行采樣、存儲以及顯示。本系統(tǒng)在Basys3上構(gòu)建了一個簡易數(shù)字存...
2017-02-08 標(biāo)簽： 1873
高大上的“量子計(jì)算機(jī)”是怎么來的？
自上世紀(jì)90年代提出量子計(jì)算機(jī)概念以來，技術(shù)和研發(fā)費(fèi)用是限制這類逆天設(shè)備發(fā)展的壁壘，期間加拿大D-Wave公司曾宣稱已經(jīng)研發(fā)出量子計(jì)算機(jī)，但是業(yè) 界對這臺設(shè)備仍持質(zhì)疑態(tài)度。慶幸的是，...
2017-02-08 標(biāo)簽： 792
建立時間和保持時間（setup time 和 hold time）
建立時間和保持時間貫穿了整個時序分析過程。只要涉及到同步時序電路，那么必然有上升沿、下降沿采樣，那么無法避免setup-time 和 hold-time這兩個概念。 1. 什么是setup-time 和 hold-time 不論是在...
2017-02-08 標(biāo)簽： 7243
教程：在ZYBO中增加串口情況時如何用printf函數(shù)打印
之前用ZYBO板卡做過一個小車平臺。為了讓小車支持藍(lán)牙功能，在Vivado硬件中增加了一個串口，這個串口通過兩個mio（zybo JF接口上的JF2，JF3）來連接藍(lán)牙模塊。但是增加串口的后果就是：如果在...
2017-02-08 標(biāo)簽： 589
教程：在ZYBO板卡實(shí)現(xiàn)bin文件的固化
前言 ·在學(xué)習(xí)本博客內(nèi)容之前，需要用戶已經(jīng)按照《教程：在ZYBO板卡實(shí)現(xiàn)PL-PS交互》博文的內(nèi)容，成功運(yùn)行ZYBO的PL-PS交互實(shí)驗(yàn)。 ·本文提供2種運(yùn)行程序的方式：通過SD卡啟動; 通過QSPI FLASH啟動。...
2017-02-08 標(biāo)簽： 1272
JTAG第二篇：JTAG的基本工作流程
以最常見的Xilinx FPGA平臺為例，一般是一臺裝有iMPACT軟件的PC端通過一根USB Cable連接到開發(fā)板上。Cable的一端使用USB接口，與PC相連；另一端為JTAG接口，與開發(fā)板相連。 不討論USB驅(qū)動、傳輸及操...
2017-02-08 標(biāo)簽： 2579
將 Virtualizer 虛擬原型和 HAPS 系列基于 FPGA 的原型無縫集成
如今，設(shè)計(jì)人員使用兩種相對獨(dú)立的方法進(jìn)行 SoC 原型驗(yàn)證：以事務(wù)級模型為基礎(chǔ)的虛擬原型驗(yàn)證和基于 FPGA 的原型驗(yàn)證。 虛擬原型驗(yàn)證執(zhí)行快速的 TLM，并可提供更高效的調(diào)試和分析方案，非...
2017-02-08 標(biāo)簽： 623
7 FPGA軟件定義網(wǎng)絡(luò)SDN智能互聯(lián)系統(tǒng)級開發(fā)平臺
NetFPGA-SUME是高性能、高密度網(wǎng)絡(luò)設(shè)計(jì)的最佳平臺。作為一款由Digilent公司、劍橋大學(xué)、斯坦福大學(xué)三方共同打造的產(chǎn)品，NetFPGA-SUME能為致力于尖端網(wǎng)絡(luò)系統(tǒng)研發(fā)的科研人士提供所期待的一切。...
2017-02-08 標(biāo)簽： 468
定制自己的攝像機(jī)控制器？ Blackmagic 3G
Blackmagic是一家領(lǐng)先的創(chuàng)意視頻領(lǐng)導(dǎo)者，公司的宗旨是拍攝更高質(zhì)量的視頻，讓后期制作和電視產(chǎn)業(yè)變得更有富有創(chuàng)意，推出了多款工業(yè)級攝像機(jī)以及視頻處理軟件。上周在拉斯維加斯舉辦的N...
2017-02-08 標(biāo)簽： 524
Synopsys HAPS系列基于FPGA的ASIC原型最快捷的交付方式
硅片tapeout前用于系統(tǒng)驗(yàn)證和硬件/軟件集成的原型對于現(xiàn)在的 IP 和 SoC 設(shè)計(jì)團(tuán)隊(duì)而言必不可少。 但是開發(fā)原型的時間很短，從 RTL 完備到獲得芯片時間也很少，這意味著原型開發(fā)工程師必須盡快...
2017-02-08 標(biāo)簽： 1936
通信網(wǎng)絡(luò)虛擬化面臨的重大問題及解決：軟硬件聯(lián)合設(shè)計(jì)技術(shù)
由于可將網(wǎng)絡(luò)功能/特征仿真到軟件并部署于通用服務(wù)器來實(shí)現(xiàn)，以NFV（網(wǎng)絡(luò)功能虛擬化）與SDN（軟件定義網(wǎng)絡(luò)）為代表的“網(wǎng)絡(luò)虛擬化技術(shù)”成為最近一個非常熱門的行業(yè)話題。但是，半導(dǎo)體...
2017-02-08 標(biāo)簽： 943
7 FPGA多媒體音視頻智能互聯(lián)系統(tǒng)評估板
Nexys Video（此前公布名稱為Atlys 2），是Digilent Nexys系列FPGA開發(fā)板的最新產(chǎn)品，專為音頻/視頻發(fā)燒友所設(shè)計(jì)。 Nexys Video的幾大組件使之成為開發(fā)音頻/視頻應(yīng)用最為理想的開發(fā)板。Nexys Video搭載X...
2017-02-08 標(biāo)簽： 599
Club Vivado 的用戶們， 你在哪里？
Club Vivado 2016 用戶群大會正在面向全球用戶征集論文及演講。如果您擁有成功的實(shí)踐經(jīng)驗(yàn)或者獨(dú)到的技巧技能，我們期待著您的分享。 以下是我們推薦的演講主題，但您的思路或創(chuàng)新可以不限于...
2017-02-08 標(biāo)簽： 402
Xilinx Virtex UltraScale FPGA VCU108 評估套件
Virtex UltraScale? FPGA VCU108 評估套件是評估 Virtex UltraScale 器件所提供前所未有高性能、高系統(tǒng)集成度以及高帶寬的完美開發(fā)環(huán)境。該套件是需要海量數(shù)據(jù)流及數(shù)據(jù)包處理的系統(tǒng)原型設(shè)計(jì)的理想平...
2017-02-08 標(biāo)簽： 785
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