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參考設(shè)計(jì)
電子發(fā)燒友網(wǎng)參考設(shè)計(jì)欄目提供全球最前沿最新與fpga相關(guān)的參考設(shè)計(jì)方案。
基于Xilinx Spartan-6 FPGA加速紋理映射的實(shí)現(xiàn)
采用Spartan-6 FPGA加速紋理映射：這種要求嚴(yán)苛的圖形流程曾經(jīng)是定制ASIC內(nèi)核的應(yīng)用，而如今卻成為低成本FPGA的天下。 作為一種以 FPGA 為構(gòu)建基礎(chǔ)，而非采用專業(yè)多媒體片上系統(tǒng)的手持...
基于FPGA的洗衣機(jī)控制系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
隨著時(shí)代的發(fā)展，洗衣機(jī)已成為人們?nèi)粘Ｉ钪械谋匦杵?。目前全自?dòng)單筒、滾筒洗衣機(jī)已日漸盛行，但其結(jié)構(gòu)復(fù)雜，日常維修和購(gòu)買時(shí)成本偏高，所以結(jié)構(gòu)簡(jiǎn)單、價(jià)格實(shí)惠的雙缸洗衣...
2012-08-27 標(biāo)簽：FPGApcb控制系統(tǒng)定時(shí)器 9853
基于FPGA的雷達(dá)回波實(shí)時(shí)模擬器的實(shí)現(xiàn)
本文以FPGA為核心構(gòu)建了一種通用的雷達(dá)回波信號(hào)實(shí)時(shí)模擬系統(tǒng)。該系統(tǒng)采用FPGA作為回波信號(hào)模擬的運(yùn)算單元，充分利用了FPGA資源豐富、并行處理能力強(qiáng)的特點(diǎn)，提高了系統(tǒng)的實(shí)時(shí)性；...
基于FPGA的數(shù)字波束形成技術(shù)的工程實(shí)現(xiàn)
數(shù)字波束形成技術(shù)充分利用陣列天線所獲取的空間信息，通過(guò)信號(hào)處理技術(shù)使波束獲得超分辨率和低副瓣的性能，實(shí)現(xiàn)了波束的掃描、目標(biāo)的跟蹤以及空間干擾信號(hào)的零陷，因而數(shù)字波...
2012-05-25 標(biāo)簽：FPGA信號(hào)處理器 3725
基于FPGA的可擴(kuò)展高速FFT處理器的設(shè)計(jì)與實(shí)現(xiàn)
DFT（離散傅里葉變換）作為將信號(hào)從時(shí)域轉(zhuǎn)換到頻域的基本運(yùn)算，在各種數(shù)字信號(hào)處理中起著核心作用，其快速算法FFT（快速傅里葉變換）在無(wú)線通信、語(yǔ)音識(shí)別、圖像處理和頻譜分析...
基于FPGA的OFDM系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)
本文基于802.16a協(xié)議的原理架構(gòu)，本著小成本、高效率的設(shè)計(jì)思想，建立了一個(gè)基于FPGA的可實(shí)現(xiàn)流水化運(yùn)行的OFDM系統(tǒng)的硬件平臺(tái)，包括模擬前端及OFDM調(diào)制器及OFDM 解調(diào)器，用來(lái)實(shí)現(xiàn)OFDM的...
可編程器件在以太網(wǎng)集線器中的應(yīng)用
隨著以太網(wǎng)技術(shù)的發(fā)展和成熟，應(yīng)用范圍日益廣泛。以太網(wǎng)的互聯(lián)技術(shù)也從早期采用專用同軸電纜的總線式網(wǎng)絡(luò)發(fā)展到現(xiàn)在的多層交換機(jī)方式。傳輸和交換的效率和可靠性大為提高。在...
2012-05-23 標(biāo)簽：可編程器件以太網(wǎng)集線器 1395
基于多相濾波的數(shù)字接收機(jī)的FPGA實(shí)現(xiàn)
基于多相濾波的信道化接收機(jī)抽取在濾波之前，運(yùn)算量小，且輸出速率低，便于FPGA實(shí)現(xiàn)，這使得在 一片F(xiàn)PGA中實(shí)現(xiàn)數(shù)字信道化成為可能。本文利用信道頻率重疊的方法連續(xù)覆蓋整個(gè)瞬時(shí)...
2012-05-23 標(biāo)簽：FPGA多相濾波數(shù)字接收機(jī) 4644
SERDES在數(shù)字系統(tǒng)中高效時(shí)鐘設(shè)計(jì)方案
SERDES在數(shù)字系統(tǒng)中高效時(shí)鐘設(shè)計(jì)方案，無(wú)論是在一個(gè)FPGA、SoC還是ASSP中，為任何基于SERDES的協(xié)議選擇一個(gè)參考時(shí)鐘源都是非常具有挑戰(zhàn)性的。...
2012-02-16 標(biāo)簽：數(shù)字系統(tǒng)SerDes時(shí)鐘設(shè)計(jì) 6368
基于Max+PlusⅡ與VHDL的數(shù)字電壓表設(shè)計(jì)
隨著計(jì)算機(jī)與微電子技術(shù)的發(fā)展，電子設(shè)計(jì)自動(dòng)化EDA領(lǐng)域已成為電子技術(shù)發(fā)展的主體，數(shù)字系統(tǒng)的設(shè)計(jì)正朝著速度快、容量大、體積小、重量輕的方向發(fā)展...
2011-09-26 標(biāo)簽：vhdl 2426
基于可編程邏輯器件的數(shù)字電路設(shè)計(jì)
基于可編程邏輯器件的數(shù)字電路設(shè)計(jì) 0 引 言 可編程邏輯器件PLD(Programmable Logic De-vice)是一種數(shù)字電路，它可以由用戶來(lái)進(jìn)行編程和進(jìn)行配置，利用它可以...
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