可編程邏輯
提供權(quán)威的PLD及可編程邏輯器件設(shè)計(jì)應(yīng)用、Altera公司、Xilinx公司資訊和解決方案，包括HDL語言與源代碼、FPGA開發(fā)板、EDA工具、FPGA、FPGA軟件等領(lǐng)域。
介紹ispMACH 4000ZE CPLD系列的特點(diǎn)及應(yīng)用
本視頻涉及了消費(fèi)電子產(chǎn)品設(shè)計(jì)人員要求低價(jià)格，低功耗和小封裝的可編程邏輯器件的特殊需要。萊迪思推薦的ispMACH 4000ZE CPLD系列滿足了使用電池供電和空間受限的設(shè)計(jì)的要求。...
介紹LatticeECP3 CPRI 的特點(diǎn)及解決方案
隨著無線通信設(shè)備對低功耗低成本平臺需求的日益增長， LatticeECP3 FPGA 成為降低器件成本的理想選擇。...
了解LatticeECP3 FPGA低功耗測量
看看LatticeECP3 FPGA的功耗是多么的低，無論是在實(shí)驗(yàn)室中測量，還是利用萊迪思的功耗計(jì)算器軟件計(jì)算。 LatticeECP3是業(yè)界最低功耗的配備SERDES的FPGA。...
介紹FPGA市場發(fā)展
2011年12月，Lattice收購了Silicon Blue，斥資6300萬美元，使Lattice明確地定位在移動消費(fèi)類FPGA市場。新產(chǎn)品采用65nm/40nm工藝，靜態(tài)功耗18uW起，價(jià)格從1美元起。 演講者：Lattice市場經(jīng)理Bart Borosky...
Lattice公司FPGA產(chǎn)品三大定位
Lattice公司總裁兼CEO Bruno Guilmart說，該公司FPGA產(chǎn)品定位叁大塊：中等密度FPGA，特點(diǎn)是低功耗、量大，典型產(chǎn)品是ECP3;低密度FPGA，其特點(diǎn)是低成本、使用方便、供應(yīng)渠道伙伴，今年將推出非易失產(chǎn)...
2018-06-15 標(biāo)簽：FPGA混合信號數(shù)碼相機(jī)低功耗Lattice 8961
關(guān)于MIPS產(chǎn)品的介紹與發(fā)展情況
本主題為MIPS 公司亞太區(qū)/大中華區(qū)技術(shù)總監(jiān) 許丁堅(jiān)在2009中國集成電路產(chǎn)業(yè)促進(jìn)大會-嵌入式系統(tǒng)產(chǎn)業(yè)發(fā)展論壇上發(fā)表的演講。主要內(nèi)容包括：MIPS的產(chǎn)品介紹，LINUX、Android和Flash on MIPS的發(fā)展動力...
2018-06-27 標(biāo)簽：嵌入式系統(tǒng)socmips 4759
GPU和FPGA優(yōu)缺點(diǎn)的對比詳細(xì)概述你現(xiàn)在要開始了解FPGA了
談?wù)凣PU與FPGA的一些看法...
可重構(gòu)體系結(jié)構(gòu)的異構(gòu)加速器的發(fā)展和應(yīng)用
近年來，在體系結(jié)構(gòu)的頂級國際會議上，涌現(xiàn)了一批以可重構(gòu)體系結(jié)構(gòu)為基礎(chǔ)的異構(gòu)加速器工作，成為學(xué)術(shù)界的研究熱點(diǎn)。與此同時，基于FPGA的加速器平臺也成為工業(yè)界關(guān)注的關(guān)鍵技術(shù)之一，...
一款基于模型的設(shè)計(jì)工具—Model Composer
Model Composer 是一款基于模型的設(shè)計(jì)工具，不僅能夠在 MathWorks Simulink? 環(huán)境中進(jìn)行快速設(shè)計(jì)探索，而且還可通過自動代碼生成加速基于 Xilinx 全可編程器件的生產(chǎn)。您不僅可使用高層次性能優(yōu)化模...
薦讀：如何學(xué)習(xí)FPGA
大家好。又到了每日學(xué)習(xí)的時候了，近期很多人問我該如何去學(xué)FPGA，那么今天咱們就來聊一聊。 一、入門首先要掌握HDL（HDL=verilog+VHDL）。 第一句話是：還沒學(xué)數(shù)電的先學(xué)數(shù)電。然后你可以選...
2018-06-11 標(biāo)簽：FPGA 4806
如何區(qū)分同步復(fù)位和異步復(fù)位？
問：如何區(qū)分同步復(fù)位和異步復(fù)位？可以理解為同步復(fù)位是作用于狀態(tài)，然后通過狀態(tài)來驅(qū)動電路復(fù)位的嗎（這樣理解的話，復(fù)位鍵作為激勵拉高到響應(yīng)拉高，是不是最少要2拍?。?？ 以上問題...
推薦：如何看懂電路原理圖
大家好，又到了每日學(xué)習(xí)的時間了，今天我們來聊一聊如何去看懂電路原理圖。 電器修理、電路設(shè)計(jì)都是要通過分析電路原理圖,了解電器的功能和工作原理,才能得心應(yīng)手開展工作的。作為從事...
2018-06-11 標(biāo)簽：FPGA 12627
FPGA設(shè)計(jì)中的RAM的兩種實(shí)現(xiàn)方法
大家好，又到了每日學(xué)習(xí)的時間了，今天我們來聊一聊在FPGA設(shè)計(jì)中RAM的兩種使用方法，RAM是用來在程序運(yùn)行中存放隨機(jī)變量的數(shù)據(jù)空間，使用時可以利用QuartusII的LPM功能實(shí)現(xiàn)RAM的定制。 軟件環(huán)...
2018-06-08 標(biāo)簽：FPGA 21110
基于matlab FPGA verilog的FIR濾波器設(shè)計(jì)
本例程實(shí)現(xiàn)8階濾波器，9個系數(shù)，由于系數(shù)的對稱性，h(0)=h(8)，h1(1)=h(7)，h(2)=h(6)，h(3)=h(5)，h(4)為中間單獨(dú)一個系數(shù)。根據(jù)公式： 實(shí)現(xiàn)框圖： 推導(dǎo)出當(dāng)系數(shù)N為偶數(shù)時,例如N=4：y(n)=h(0)*{x(0)+x(n-3...
基于FPGA vivado 17.2 的數(shù)字鐘設(shè)計(jì)
基于FPGA vivado 17.2 的數(shù)字鐘設(shè)計(jì)...
2018-06-08 標(biāo)簽：FPGA 11726
ISE設(shè)計(jì)流程簡介--華清遠(yuǎn)見fpga培訓(xùn)視頻教程
本視頻教程主要主要介紹Xilinx公司開發(fā)設(shè)計(jì)流程中的各個功能模塊，包括ISE中的設(shè)計(jì)輸入，綜合，設(shè)計(jì)實(shí)現(xiàn)及驗(yàn)證等內(nèi)容，此專題將為廣大FPGA工程師深入理解EDA工具實(shí)現(xiàn)原理與FPGA開發(fā)完整流程...
萊迪思FPGA在網(wǎng)絡(luò)邊緣計(jì)算AI開發(fā)方案
FPGA 向來是高大上的形象，即便在人工智能火熱的今天，圍繞 FPGA 討論的焦點(diǎn)也集中在云端的加速，與之相提并論的，更多是以高性能計(jì)算見長的 GPU、CPU、DSP。 但是，有家公司，卻專注在網(wǎng)絡(luò)...
Xilinx DocNav工具的使用（文檔查詢利器）
DocNav（Documentation Navigator）可以看作是Xilinx的文檔、視頻“集裝箱”，幾乎所有與芯片、開發(fā)工具、設(shè)計(jì)方法、IP等相關(guān)的文檔和視頻都可以在這里找到，更重要的是它提供了一些快速查找資料...
FPGA設(shè)計(jì)中的HLS 工具應(yīng)用
在集成電路行業(yè)飛速發(fā)展的今天，縮短產(chǎn)品開發(fā)的周期而又不犧牲驗(yàn)證過程，這不可避免地成為了商業(yè)市場的一個關(guān)鍵因素。Xilinx Vivado High Level Synthesis （即Vivado HLS，高層綜合）。這個工具直接...
TCL腳本簡介 vivado hls 的設(shè)計(jì)流程
Vivado HLS 是 Xilinx 提供的一個工具，是 Vivado Design Suite 的一部分，能把基于 C 的設(shè)計(jì) （C、C++ 或 SystemC）轉(zhuǎn)換成在 Xilinx 全可編程芯片上實(shí)現(xiàn)用的 RTL 設(shè)計(jì)文件 （VHDL/Verilog 或 SystemC）。 ...
什么是SDSoC平臺？SDSoC的開發(fā)工作
在理解了SDSoC“平臺”的概念之后（詳見《SDSoC上手必讀：什么是SDSoC平臺？》），現(xiàn)在我們就可以開始使用SDSoC進(jìn)行開發(fā)工作了。 在下載并安裝了SDSoC之后，細(xì)心的人會在文件目錄中發(fā)現(xiàn)Vivado、...
基于FPGA設(shè)計(jì)的智能控制器VHDL設(shè)計(jì)及測試
由于FPGA在智能控制器方面的大量使用，設(shè)計(jì)后的測試便成了設(shè)計(jì)者在開發(fā)過程中必須重點(diǎn)考慮的問題，同時，一種好的測試方法不僅能及早發(fā)現(xiàn)設(shè)計(jì)中存在的問題，而且能提高設(shè)計(jì)的可靠性。...
一看就懂的電子設(shè)計(jì)教育課程，技小新出品！
電子設(shè)計(jì)初學(xué)者如何入門? 業(yè)余電子愛好者如何從零開始自學(xué)成為工程師? 有電子專業(yè)背景,如何系統(tǒng)學(xué)習(xí)電子設(shè)計(jì)方面的知識? 業(yè)內(nèi)大牛電路設(shè)計(jì)、元件選取出神入化,學(xué)校卻只能學(xué)到皮毛? 這些...
2018-06-01 標(biāo)簽：電子設(shè)計(jì)電子教育電子設(shè)計(jì) 9353
FPGA學(xué)習(xí)系列：9.簡單狀態(tài)機(jī)設(shè)計(jì)
設(shè)計(jì)背景： 狀態(tài)機(jī)是描述各種復(fù)雜時序的時序行為，是使用 HDL進(jìn)行數(shù)學(xué)邏輯設(shè)計(jì)中非常重要的方法之一，狀態(tài)機(jī)分為摩爾機(jī)和米粒機(jī)，當(dāng)輸出只和狀態(tài)有關(guān)系的話稱為摩爾機(jī)，當(dāng)輸出不僅和狀...
2018-06-01 標(biāo)簽：FPGA狀態(tài)機(jī) 7943
基于FPGA的模糊PID控制器的設(shè)計(jì)實(shí)現(xiàn)
本文主要詳解基于FPGA的模糊PID控制器的設(shè)計(jì)實(shí)現(xiàn)，首先介紹了FPGA工作原理、基本特點(diǎn)以及FPGA的優(yōu)勢，其次闡述了使用Altera的FPGA設(shè)計(jì)實(shí)現(xiàn)的數(shù)字模糊PID控制器，具體的跟隨小編一起來了解一下...
FPGA學(xué)習(xí)系列：7. 串并轉(zhuǎn)換
設(shè)計(jì)背景： Verilog語法中很多情況都用到了串并轉(zhuǎn)化的思想，旨在與提升運(yùn)算和芯片運(yùn)行的速度，串行轉(zhuǎn)并行已經(jīng)成為設(shè)計(jì)中不可缺少的一種思維。 設(shè)計(jì)原理 : 本次的設(shè)計(jì)主設(shè)計(jì)一個 8位的串并...
2018-05-31 標(biāo)簽：FPGAFPGA串并轉(zhuǎn)換 20185
FPGA學(xué)習(xí)系列：8. 流水燈的設(shè)計(jì)
設(shè)計(jì)原理 : 在以后的設(shè)計(jì)中，用的開發(fā)板都將是我們至芯科技自主設(shè)計(jì)的開發(fā)板，我們的芯片用的是 Cyclone4系列的EP4CE10F17C8，在以后的設(shè)計(jì)中我們將不再討論我們的開發(fā)板 今天的設(shè)計(jì)是流水燈...
為什么數(shù)據(jù)中心使用FPGA越來越多?
本文首先介紹了PGA基本特點(diǎn)與三大優(yōu)勢，其次介紹了FPGA工作原理及典型的應(yīng)用領(lǐng)域，最后闡述了在數(shù)據(jù)中心里使用FPGA越來越多的原因。...
2018-05-31 標(biāo)簽：FPGAcpu數(shù)據(jù)中心 12306
FPGA比CPU和GPU快的原理是什么
本文首先闡述了FPGA的原理了，其次分析了FPGA比CPU和GPU快的原理，最后闡述了CPU與GPU的區(qū)別。...
FPGA學(xué)習(xí)系列：6.組合邏輯和時序邏輯
設(shè)計(jì)背景： Verilog HDL語言分為面向綜合和面向仿真兩大類語句，且可綜合語句遠(yuǎn)少于仿真語句，讀者可能會有可綜合設(shè)計(jì)相對簡單的感覺。然而事實(shí)剛好與此相反，這是因?yàn)椋菏紫?，可綜合設(shè)計(jì)...
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