可編程邏輯
提供權(quán)威的PLD及可編程邏輯器件設(shè)計(jì)應(yīng)用、Altera公司、Xilinx公司資訊和解決方案，包括HDL語言與源代碼、FPGA開發(fā)板、EDA工具、FPGA、FPGA軟件等領(lǐng)域。
可編程邏輯在基站設(shè)計(jì)過程中發(fā)揮作用
隨著人們訂購無線服務(wù)數(shù)量的激增、各種服務(wù)類型的多樣化，以及更低的便攜式設(shè)備接入因特網(wǎng)的費(fèi)用，使得對(duì)于增加基礎(chǔ)設(shè)施容量的需求日益明顯。3G智能手機(jī)、3G上網(wǎng)本和3G平板電腦是引發(fā)對(duì)...
2018-06-10 標(biāo)簽：可編程邏輯 908
如何應(yīng)用可編程邏輯器件PLD將高速視頻內(nèi)容連接到視頻播放器
常用的消費(fèi)類視頻接口包括IEEE 1394(火線)、USB 2.0、DVI、HDMI和各種各樣的無線標(biāo)準(zhǔn)。本文將介紹如何應(yīng)用可編程邏輯器件(PLD)將不同的高速視頻內(nèi)容連接到視頻播放器。 ...
為應(yīng)用選擇最佳可編程SoC時(shí)應(yīng)進(jìn)行的六個(gè)設(shè)計(jì)考慮
選擇新處理器體系結(jié)構(gòu)是關(guān)鍵的決定。供應(yīng)商的產(chǎn)品路線圖能否滿足未來應(yīng)用需求，突出系統(tǒng)優(yōu)勢(shì)，長(zhǎng)期看系統(tǒng)是否具有競(jìng)爭(zhēng)優(yōu)勢(shì)，對(duì)此進(jìn)行評(píng)估非常重要。考慮到較大的軟件投入，基本軟件能...
FPGA與HPS之間互聯(lián)的結(jié)構(gòu)
為了能夠?qū)崿F(xiàn)HPS與FPGA之間的通信接口，衍生出了AXI bridge協(xié)議。AXI bridge協(xié)議能夠處理帶寬適應(yīng)和時(shí)鐘控制，支持HPS與FPGA之間雙向的邏輯和數(shù)據(jù)交互。...
淺談FFT算法原理 基于FPGA的FFT算法的硬件實(shí)現(xiàn)
在FFT算法中，數(shù)據(jù)的寬度通常都是固定的寬度。然而，在FFT的運(yùn)算過程中，特別是乘法運(yùn)算中，運(yùn)算的結(jié)果將不可避免地帶來誤差。因此，為了保證結(jié)果的準(zhǔn)確性，采用定點(diǎn)分析是非常必要的。...
配備四核ARM? Cortex?-A53應(yīng)用處理器核心套件
ZCU106 評(píng)估套件可幫助設(shè)計(jì)人員為視頻會(huì)議、監(jiān)控、高級(jí)駕駛員輔助系統(tǒng) (ADAS) 以及流媒體及編碼應(yīng)用...
2018-04-28 標(biāo)簽：可編程邏輯 10879
基于FPGA開發(fā)設(shè)計(jì)，為何模塊看到一個(gè)嚴(yán)重警告？
為了避免約束多余的應(yīng)用，在2017年1月初，OOC dcp文件將不再包含任何約束信息，如果你遵循我們的建議使用IP xci文件，那么之前的約束信息將能夠重新應(yīng)用于IP，通過將約束信息從dcp文件中移除...
以Spartan3系列為例 詳解FPGA DCM
FPGA看上去就是一個(gè)四方形。最邊緣是IO Pad了。除去IO Pad，內(nèi)部還是一個(gè)四方形。四個(gè)角上各趴著一個(gè)DCM。上邊緣和下邊緣中間則各趴著一個(gè)全局Buffer的MUX。這樣的好處是四個(gè)DCM的輸出可以直接...
高分辨率攝像頭嵌入式360°視域視覺系統(tǒng)設(shè)計(jì)
FPGA陣列結(jié)構(gòu)可能提供18×27乘法/累加單元塊和32×128 RAM的DSP單元塊，而此時(shí)的最佳解決方案可能是帶有48×1024 RAM的16×8 DSP單元塊。...
如何優(yōu)化實(shí)際解決方案使其用于FPGA
LTpowerCAD 可用來為各個(gè)電壓軌提供電源解決方案。它還提供一系列參考設(shè)計(jì)，以讓設(shè)計(jì)人員快速入門。LTpowerCAD 可以從 ADI 公司網(wǎng)站免費(fèi)下載。...
異構(gòu)計(jì)算的兩大派別 為什么需要異構(gòu)計(jì)算？
20世紀(jì)80年代，異構(gòu)計(jì)算技術(shù)就已經(jīng)誕生了。所謂的異構(gòu)，就是CPU、DSP、GPU、ASIC、協(xié)處理器、FPGA等各種計(jì)算單元、使用不同的類型指令集、不同的體系架構(gòu)的計(jì)算單元，組成一個(gè)混合的系統(tǒng)，執(zhí)...
2018-04-28 標(biāo)簽：FPGAasicgpu異構(gòu)計(jì)算 23588
將eFPGA應(yīng)用于嵌入式360度視域視覺系統(tǒng)中
2018年4月11日，工業(yè)和信息化部、公安部和交通運(yùn)輸部聯(lián)合發(fā)布“關(guān)于印發(fā)《智能網(wǎng)聯(lián)汽車道路測(cè)試管理規(guī)范（試行）》的通知”，為我國(guó)智能網(wǎng)聯(lián)汽車道路測(cè)試提供了相關(guān)法律依據(jù)。三部委在...
2018-04-25 標(biāo)簽：嵌入式soc視覺系統(tǒng)efpga 6132
三星
分享到 在技術(shù)發(fā)展程度欠缺的階段，電子產(chǎn)品的問世都只解決用戶單一的需求：相機(jī)用鏡頭記錄世界，而手機(jī)的使命就是打電話、發(fā)短信，完成人們基本的通訊需求。那時(shí)，誰能預(yù)想到隨著數(shù)...
2018-04-24 標(biāo)簽： 296
FPGA學(xué)習(xí)：PLL硬核IP的配置和創(chuàng)建
下面我們來看本實(shí)例如何配置一個(gè)PLL硬核IP，并將其集成到工程中。如圖8.18所示，在新建的工程中，點(diǎn)擊菜單“ToolsàMegaWizard Plug-In Manager”。...
FPGA學(xué)習(xí)：PLL分頻計(jì)數(shù)的LED閃爍實(shí)例
輸入FPGA引腳上的25MHz時(shí)鐘，配置PLL使其輸出4路分別為12.5MHz、25MHz、50MHz和100MHz的時(shí)鐘信號(hào)，這4路時(shí)鐘信號(hào)又分別驅(qū)動(dòng)4個(gè)不同位寬的計(jì)數(shù)器不停的計(jì)數(shù)工作，這些計(jì)數(shù)器的最高位最終輸出用于控...
學(xué)習(xí)FPGA的經(jīng)驗(yàn)和教訓(xùn)
FPGA簡(jiǎn)單的說，就是現(xiàn)場(chǎng)可編程邏輯陣列。它的內(nèi)部是邏輯單元，它們之間可以用線連接，至于以怎樣的形式相連，則可以根據(jù)應(yīng)用者寫入的邏輯決定。每次布線都會(huì)重新組合邏輯單元，從而可...
2018-04-24 標(biāo)簽：FPGA 2385
FPGA設(shè)計(jì)概述 FPGA在各領(lǐng)域的應(yīng)用
FPGA（Field Programmable Gate Array）于1985年由xilinx創(chuàng)始人之一Ross Freeman發(fā)明，雖然有其他公司宣稱自己最先發(fā)明可編程邏輯器件PLD，但是真正意義上的第一顆FPGA芯片XC2064為xilinx所發(fā)明，這個(gè)時(shí)間差不...
略談FPGA圖像處理
FPGA圖像處理之路，從此開始，接下來，讓我們把時(shí)間交給“圖像處理”。一休哥在動(dòng)筆之前，一直在猶豫，反復(fù)思考著一個(gè)問題，這個(gè)問題一直困擾著我，“FPGA在圖像處理領(lǐng)域中的地位？”...
基于FPGA芯片和RISC在圖像驅(qū)動(dòng)中的應(yīng)用
EPXAl0單片集成了ARM核、高密度的FPGA、存儲(chǔ)器及接口和控制模塊，不僅簡(jiǎn)化了ARM與FPGA之間的通訊，也使片外擴(kuò)展存儲(chǔ)器以及和外設(shè)通訊變得相對(duì)簡(jiǎn)單；同時(shí)通過在FPGA中嵌入各種IP核和用戶控制邏...
NI打響LabVIEW雙平臺(tái)更新戰(zhàn)，基于軟件的平臺(tái)戰(zhàn)略協(xié)同客戶實(shí)現(xiàn)雙贏
關(guān)于未來交通的暢想，超級(jí)高鐵Hyperloop One絕對(duì)引領(lǐng)出行方式，其平均時(shí)速可達(dá)1000公里/小時(shí)，“完勝”波音747飛機(jī)。前沿應(yīng)用加劇測(cè)試挑戰(zhàn)，據(jù)悉，該項(xiàng)目的測(cè)試規(guī)模大而分散，需要匯集來自...
基于VHDL的串行發(fā)送電路設(shè)計(jì)
基于VHDL的串口RS232電路設(shè)計(jì) 隨著電子技術(shù)的發(fā)展，現(xiàn)場(chǎng)可編程門陣列 FPGA和復(fù)雜可編程邏輯器件CPLD的出現(xiàn)，使得電子系統(tǒng)的設(shè)計(jì)者利用與器件相應(yīng)的電子CAD軟件，在實(shí)驗(yàn)室里就可以設(shè)計(jì)自己的...
基于FPGA的移動(dòng)目標(biāo)實(shí)時(shí)定位跟蹤系統(tǒng)
基于實(shí)時(shí)物體移動(dòng)的靜態(tài)圖像背景中移動(dòng)目標(biāo)檢測(cè)是計(jì)算機(jī)視覺領(lǐng)域的研究熱點(diǎn)，在安防、監(jiān)控、智能交通、機(jī)器智慧、以及軍事領(lǐng)域等社會(huì)生活和軍事防御等諸多領(lǐng)域都有較大的實(shí)用價(jià)值。移...
2018-04-20 標(biāo)簽：FPGA跟蹤系統(tǒng) 5472
vivado中的IP調(diào)用 vivado HLS的幀差圖像實(shí)現(xiàn)
由目標(biāo)運(yùn)動(dòng)引起的運(yùn)動(dòng)變化區(qū)域包括運(yùn)動(dòng)目標(biāo)在前后兩幀中的共同位置(圖中黑色區(qū)域)、在當(dāng)前幀中新顯露出的背景區(qū)域和新覆蓋的背景區(qū)域三部分。...
零基礎(chǔ)學(xué)FPGA設(shè)計(jì)難嗎 FPGA基本知識(shí)介紹
很多初學(xué)者覺得學(xué)FPGA很難，需要很多的基礎(chǔ)，得懂VERILOG設(shè)計(jì)、會(huì)畫原理圖，會(huì)畫PCB，還有各種各樣不同接口，是這樣嗎？首先看數(shù)字電路，了解什么是與或非，各種觸發(fā)器，各種邏輯門，注意...
2018-04-20 標(biāo)簽：FPGA 3254
萊迪思推出SiI9437和SiI9438 首款符合HDMI 2.1標(biāo)準(zhǔn)的eARC
萊迪思半導(dǎo)體公司推出SiI9437和SiI9438，是首款符合HDMI 2.1標(biāo)準(zhǔn)的增強(qiáng)音頻回傳通道（eARC ）音頻接收器和發(fā)射器。eARC是面向未來的應(yīng)用，可顯著改善家庭影院互連。該易于使用的全新音頻功能是...
2018-04-22 標(biāo)簽：HDMI萊迪思半導(dǎo)體 3826
Xilinx發(fā)布單芯片SoC功能安全性解決方案 可縮短認(rèn)證與開發(fā)時(shí)間 24個(gè)月
Zynq-7000 SoC是通過功能安全性權(quán)威機(jī)構(gòu)TüV萊茵評(píng)估，滿足《IEC 61508國(guó)際標(biāo)準(zhǔn)·第二部分·附件E》片上冗余要求，并將安全與非安全功能集成于單一器件的首款單芯片應(yīng)用處理器。...
2018-04-22 標(biāo)簽：賽靈思soc工業(yè)物聯(lián)網(wǎng) 2157
如何進(jìn)行分FPGA模塊劃分
模塊劃分，顧名思義是指模塊的劃分。但是，明德?lián)P至簡(jiǎn)設(shè)計(jì)法提出的模塊劃分，是廣義的“模塊劃分”。后續(xù)所提及的“模塊劃分”，不單單指模塊的劃分，還包括模塊劃分好后，模塊的端口...
FPGA設(shè)計(jì)之時(shí)序邏輯的模板
模塊的模板包括了輸入輸出信號(hào)列表、信號(hào)定義，組合邏輯和時(shí)序邏輯等，這是一個(gè)模塊常用的組件。學(xué)員只需要理解各個(gè)部分的意義，按要求來填空就可以，完全沒有必要去記住。我看很多學(xué)...
基于FPGA開發(fā)的萬年歷系統(tǒng)
與傳統(tǒng)計(jì)時(shí)工具如鐘表日歷等相比，數(shù)字萬年歷具備精確度高、成本低廉、運(yùn)行穩(wěn)定、功能多樣等眾多優(yōu)點(diǎn)，因此國(guó)內(nèi)外許多設(shè)計(jì)人員先后進(jìn)行了相關(guān)設(shè)計(jì)開發(fā)。其中，基于FPGA開發(fā)除設(shè)計(jì)簡(jiǎn)便...
基于fpga的數(shù)字時(shí)鐘設(shè)計(jì)應(yīng)用
本工程包括矩陣鍵盤和數(shù)碼管顯示模塊，共同實(shí)現(xiàn)一個(gè)帶有鬧鐘功能、可以設(shè)置時(shí)間的數(shù)字時(shí)鐘。具體功能如下：1. 數(shù)碼管可以顯示時(shí)十位、時(shí)個(gè)位、分十位、分個(gè)位、秒十位、秒個(gè)位。2. 上電...
2018-04-19 標(biāo)簽：FPGA數(shù)字時(shí)鐘 16831
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