可編程邏輯
提供權(quán)威的PLD及可編程邏輯器件設(shè)計應(yīng)用、Altera公司、Xilinx公司資訊和解決方案，包括HDL語言與源代碼、FPGA開發(fā)板、EDA工具、FPGA、FPGA軟件等領(lǐng)域。
基于RISC技術(shù)的8位微控制器設(shè)計
摘要： 介紹基于RISC技術(shù)的8位微控制器的設(shè)計與實現(xiàn)。主要包括RISC指令集的選??；取指單元、譯碼單元、執(zhí)行單元的設(shè)計；取指、譯碼、回寫三級流水線技術(shù)的實...
2009-06-20 標(biāo)簽：RISC 1825
基于CPLD的三相多波形函數(shù)發(fā)生器設(shè)計
摘要： 介紹了基于可編程邏輯器件CPLD和直接數(shù)字頻率合成技術(shù)（DDS）的三相多波形函數(shù)發(fā)生器的基本原理，并在此基礎(chǔ)上給出了基于CPLD的各模塊設(shè)計方法及其VHDL...
2009-06-20 標(biāo)簽：cpld 873
NIOS軟核處理器的Linux引導(dǎo)程序U-boot設(shè)計
摘要： 針對將uClinux向Nios處理器移植過程中的啟動加載程序U-boot bootloader進(jìn)行研究。首先介紹移植的步驟，然后利用bootloader的設(shè)計思想，著重討論U-boot在Nios中的設(shè)計與實...
2009-06-20 標(biāo)簽：NIOS 1322
基于CPLD/FPGA的出租車計費器
摘要： 介紹了出租車計費器系統(tǒng)的組成及工作原理，簡述了在EDA平臺上用單片CPLD器件構(gòu)成該數(shù)字系統(tǒng)的設(shè)計思想和實現(xiàn)過程。論述了車型調(diào)整模塊、計程模塊、計費模塊...
基于CPLD的容錯存儲器的設(shè)計實現(xiàn)
摘 要： 分析了存儲器產(chǎn)生錯誤的原因，提出了提高其可靠性的有效途徑。結(jié)合航天計算機可靠性增長計劃，給出了一套利用糾檢錯芯片對其進(jìn)行容錯的方...
2009-06-20 標(biāo)簽：cpld 784
基于狀態(tài)機和流水線技術(shù)的3DES加密算法及其FPGA設(shè)計
摘要： 介紹了3DES加密算法的原理并詳盡描述了該算法的FPGA設(shè)計實現(xiàn)。采用了狀態(tài)機和流水線技術(shù)，使得在面積和速度上達(dá)到最佳優(yōu)化；添加了輸入和輸出接口的設(shè)...
2009-06-20 標(biāo)簽：FPGA 1388
高密度在系統(tǒng)可編程邏輯器件在數(shù)字I/O電路中的應(yīng)用
摘 要： 介紹了在系統(tǒng)可編程（ISP）技術(shù)及ISP器件的特點。分析了變M／T轉(zhuǎn)速測量電路的工作原理。并由高密度ISP器件設(shè)計了位置控制系統(tǒng)單片I/O電路。運行結(jié)果表明所設(shè)計的電路完...
2009-06-20 標(biāo)簽：可編程邏輯器件 1316
CPLD在IGBT驅(qū)動設(shè)計中的應(yīng)用
摘要：介紹了一個實用ＩＧＢＴ驅(qū)動信號轉(zhuǎn)換電路的ＣＰＬＤ設(shè)計?并給出了該設(shè)計的仿真波形。 關(guān)鍵詞：ＰＷＭ ＣＰＬＤ ＩＧＢＴ Ｖ...
2009-06-20 標(biāo)簽：cpld 1210
用增強并口ＥＰＰ協(xié)議擴展計算機的ＩＳＡ接口
摘要：提出了用ＥＰＰ協(xié)議和ＣＰＬＤ擴展筆記本電腦的ＩＳＡ接口的方法，給出了詳細(xì)的技術(shù)解決方案。擴展的ＩＳＡ接口可以達(dá)到１３１０ ＫＢ／ｓ的雙向通訊速度，與...
2009-06-20 標(biāo)簽：epp 1260
分時復(fù)用時CPLD設(shè)計變頻系統(tǒng)中的應(yīng)用
摘要：簡要介紹利用MaxplusII軟件來實現(xiàn)VVVF控制SPWM變頻調(diào)速的方法。設(shè)計中提出一種三相分時運算思路，詳細(xì)闡明其具體實現(xiàn)方式。試驗證明，CPLD應(yīng)用于變頻調(diào)速系統(tǒng)控制是...
2009-06-20 標(biāo)簽：cpld 1183
基于Verilog-HDL的軸承振動噪聲電壓峰值檢測
摘要：介紹模擬峰值電壓的檢測方式，敘述基于Verilog-HDL與高速A/D轉(zhuǎn)換器相結(jié)合所實現(xiàn)的數(shù)字式快速軸承噪聲檢測方法，給出相關(guān)的Verilog-HDL主模塊部分。 ...
2009-06-20 標(biāo)簽：Verilog 1277
換體DMA高速數(shù)據(jù)采集電路原理及其CPLD實現(xiàn)
摘要：介紹了換體DMA高速數(shù)據(jù)采集電路原理及其CPLD實現(xiàn)。用CPLD設(shè)計雙端口RAM緩存、控制譯碼、時序邏輯電路，很好地解決了電路元件所占體積大、電路復(fù)雜、不能實現(xiàn)在線...
2009-06-20 標(biāo)簽：dma 1265
一種基于FPGA的誤碼性能測試方案
摘要：提出了一種基于FPGA的誤碼測試方案，并簡要介紹了該方案的設(shè)計思想。 關(guān)鍵詞：誤碼儀 數(shù)字微波傳輸 ACEX1K系列FPGA ...
2009-06-20 標(biāo)簽：FPGA 1186
基于FPGA的高速高精度頻率測量的研究
摘要：以FPGA為核心的高速高精度的頻率測量，不同于常用測頻法和測周期法。本文介紹的測頻方法，不僅消除了直接測頻方法中對測量頻率需要采用分段測試的局...
2009-06-20 標(biāo)簽：FPGA 1338
M序列偽隨機碼在測距回答概率控制中的應(yīng)用
摘要：通過對機載測距詢問器檢測中測距回答概率控制的工作特性的分析，提出一種基于m序列偽隨機碼的具有可設(shè)定測距回答概率功能及隨機回答特性的測距回答...
2009-06-20 標(biāo)簽：PLD 1568
基于FPGA的核物理實驗定標(biāo)器的設(shè)計與實現(xiàn)
摘要：介紹使用現(xiàn)代EDA手段設(shè)計核物理實驗常用儀器——定標(biāo)器的原理和實現(xiàn)方法。新的定標(biāo)器利用FPGA技術(shù)對系統(tǒng)中大量電路進(jìn)行集成，結(jié)合AT89C51單片機進(jìn)行控制...
2009-06-20 標(biāo)簽：FPGA 1220
用FPGA實現(xiàn)數(shù)據(jù)遠(yuǎn)距離的高精度傳輸
摘要：詳細(xì)闡述一種利用交錯編碼的思想，來改遠(yuǎn)距離通信質(zhì)量的新設(shè)計。設(shè)計由FPGA芯片實現(xiàn)，能很方便加載到各種單片機有線或無線通信系統(tǒng)的收發(fā)接口中。通...
2009-06-20 標(biāo)簽：FPGA 987
基于FPGA的多路模擬量、數(shù)字量采集與處理系統(tǒng)
摘要：提出一種基于FPGA技術(shù)的多路模擬量、數(shù)字量采集與處理系統(tǒng)的設(shè)計方案，分析整個系統(tǒng)的結(jié)構(gòu)，并討論FPGA內(nèi)部硬件資源的劃分和軟件的設(shè)計方案等。本設(shè)計...
2009-06-20 標(biāo)簽：FPGA 2000
在測控系統(tǒng)中用IP核實現(xiàn)D/A轉(zhuǎn)換
摘要：采用數(shù)字化技術(shù)、在測控系統(tǒng)中用IP核實現(xiàn)D/A轉(zhuǎn)換，并且在1片可編程邏輯器件中實現(xiàn)。它不受溫度的影響，既可保持高分辨率，又可降低對電路精度和穩(wěn)...
2009-06-20 標(biāo)簽：vhdlIP核可編程邏輯器件D/A轉(zhuǎn)換IP核vhdl可編程邏輯器件 1272
基于Nios平臺的光信號采集片上系統(tǒng)設(shè)計
摘要： 介紹基于Altera Excalibur平臺的光信號采集片上系統(tǒng)的設(shè)計，詳細(xì)地分析片上系統(tǒng)各個組成部分的工作原理。作為一個新型的測量系統(tǒng)，它具有靈活、穩(wěn)定...
2009-06-20 標(biāo)簽： 742
一種基于FPGA的A超數(shù)字式探傷系統(tǒng)的研究
摘要：簡略介紹了超聲探傷的基本原理，并在此基礎(chǔ)上提出了一種基于FPGA的A型數(shù)字式超聲系統(tǒng)的構(gòu)成方式，著重介紹了系統(tǒng)的硬件構(gòu)成。其中，基于FPGA...
2009-06-20 標(biāo)簽：FPGA 752
基于FPGA的機載合成孔徑雷達(dá)數(shù)字信號處理機接口板卡的設(shè)計與
摘要： 介紹基于ＦＰＧＡ芯片實現(xiàn)的機載合成孔徑雷達(dá)數(shù)字信號處理機接口板卡。該接口板卡負(fù)責(zé)將輸入數(shù)據(jù)緩存和信息格式轉(zhuǎn)換，然后打包成處理機需要的數(shù)據(jù)...
2009-06-20 標(biāo)簽：FPGA 1120
基于數(shù)字移相的高精度脈寬測量系統(tǒng)及其FPGA實現(xiàn)
摘要：采用XILINX公司的SpartanII系列FPGA芯片設(shè)計了一種基于數(shù)字移相技術(shù)的高精度脈寬測量系統(tǒng)，同時給出了系統(tǒng)的仿真結(jié)果和精度分析。與通常的脈沖計...
2009-06-20 標(biāo)簽：數(shù)字移相 2544
智能延遲觸發(fā)產(chǎn)生器的設(shè)計
摘要：針對高速飛行物的Ｘ光陰影照相所要求的提前觸發(fā)問題，設(shè)計了一套可自動根據(jù)物體飛行速度觸發(fā)Ｘ光機的智能延遲觸發(fā)產(chǎn)生器。該產(chǎn)生器采用全...
基于Verilog HDL設(shè)計的自動數(shù)據(jù)采集系統(tǒng)
摘要： 介紹了一種采用硬件控制的自動數(shù)據(jù)采集系統(tǒng)的設(shè)計方法，包括數(shù)字系統(tǒng)自頂向下的設(shè)計思路、Verilog HDL對系統(tǒng)硬件的描述和狀態(tài)機的設(shè)計以及MAX+PLUSII開發(fā)...
基于FPGA的新型諧波分析儀設(shè)計
摘要： 給出一種基于FPGA的新型諧波分析儀的設(shè)計方案。在該方案中，采用FPGA實現(xiàn)快速的FFT運算，使用實時操作系統(tǒng)結(jié)合Ethernet芯片實現(xiàn)TCP/IP協(xié)議直接接入局域網(wǎng)，...
2009-06-20 標(biāo)簽：FPGA 851
CPLD在嵌入式系統(tǒng)與CAN總線網(wǎng)絡(luò)通信中的應(yīng)用
摘 要：本文介紹了一種利用可編程器件CPLD實現(xiàn)CAN總線與微機之間接口的設(shè)計，說明了設(shè)計思想和設(shè)計方案，并給出了使用MAX＋PLUS Ⅱ軟件圖形輸入法的邏輯設(shè)計和...
2009-06-20 標(biāo)簽：cpld 1032
基于GAL器件的步進(jìn)電機控制器的研究與設(shè)計
摘要： 介紹了利用陣列邏輯器件GAL16V8對三相六拍步進(jìn)電機實現(xiàn)控制的方法及其電路設(shè)計。通過計算機編程器對GAL進(jìn)行編程，可以滿足各種控制要求。該電路簡單，...
基于EMP7128的數(shù)字式相位測量儀
摘要： 分析了基于Altera公司CPLD芯片EMP7128SLC84-15進(jìn)行相位測量的基本原理，給出了用EMP7128SLC8415進(jìn)行相位測量的硬件實現(xiàn)電路及ＶＨＤＬ源程序。 關(guān)鍵詞...
2009-06-20 標(biāo)簽： 1512
DSP FPGA在高速高精運動控制器中的應(yīng)用
摘 要 ：數(shù)字信號處理器具有高效的數(shù)值運算能力,并能提供良好的開發(fā)環(huán)境，而可編程邏輯器件具有高度靈活的可配置性。本文描述了通過采用TMS320C32浮點DSP和可編...
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