仿真

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仿真（Simulation），即使用項目模型將特定于某一具體層次的不確定性轉(zhuǎn)化為它們對目標(biāo)的影響，該影響是在項目仿真項目整體的層次上表示的。項目仿真利用計算機模型和某一具體層次的風(fēng)險估計，一般采用蒙特卡洛法進行仿真。

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仿真技術(shù)

HyperLynx 2409的新增部分功能

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FPGA延時Verilog HDL實現(xiàn)

可以在任意時刻啟動，可以重復(fù)啟動，延時時長可調(diào)，單位可切換（ms/us），在50MHz時鐘下的延時范圍是1ms-85899ms/1us-85899us。

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卡爾曼濾波器的特性及仿真

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2024-10-31 標(biāo)簽：FPGA 仿真 Simulink 1.7k 0

CTLE均衡技術(shù)的工作原理

CTLE（Continuous Time Linear Equalization）是一種在高速信號傳輸中常用的均衡技術(shù)。它主要用于補償由于信道引起的信號...

2024-10-29 標(biāo)簽：濾波器仿真均衡技術(shù) 4.9k 0

歐姆定律我是很熟，只是沒想到電流不按套路出牌！

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2024-10-28 標(biāo)簽：仿真歐姆定律 1k 0

使用modelsim時的問題分析

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FPGA仿真工具包軟件EasyGo Vs Addon介紹

EasyGo Vs Addon是一款領(lǐng)先的FPGA仿真工具包軟件，它強大地連接了VeriStand軟件與Matlab/Simulink，為實時測試和驗證...

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Moldflow仿真助力高質(zhì)量連接器開發(fā)方案分享

關(guān)鍵詞：電子連接器、汽車連接器、moldflow、變形機理、新能源汽車、聯(lián)合仿真、LCP材料連接器的應(yīng)用領(lǐng)域非常廣泛，幾乎涵蓋了所有需要光電信號傳輸與...

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Verilog HDL的基礎(chǔ)知識

本文繼續(xù)介紹Verilog HDL基礎(chǔ)知識，重點介紹賦值語句、阻塞與非阻塞、循環(huán)語句、同步與異步、函數(shù)與任務(wù)語法知識。

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如何在Cadence的EMX仿真中精準(zhǔn)設(shè)置長邊PORT

請問在Cadence的EMX仿真里，如果需要在一個較長的邊打PORT，需要怎么設(shè)置會仿真比較精準(zhǔn)？像這樣子直接吸附一個上去可以嗎？

2024-10-23 標(biāo)簽：變壓器 Cadence 仿真 7.8k 0

芯片后仿真要點

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進行靜電中和等。

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