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標(biāo)簽 > 可編程邏輯
邏輯器件可分為兩大類 – 固定邏輯器件和可編程邏輯器件。正如其命名一樣,固定邏輯器件中的電路是永久性的,它們完成一種或一組功能 —— 一旦制造完成,就無法改變。
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千兆以太網(wǎng)的IP核接口和萬兆以太網(wǎng)IP核接口
對(duì)于IP核輸出數(shù)據(jù)的解析最好的工具就是其自帶的仿真文件,里面既將接收的數(shù)據(jù)進(jìn)行了解析,又將發(fā)送給IP核的數(shù)據(jù)進(jìn)行了封裝,這對(duì)于了解數(shù)據(jù)結(jié)構(gòu)和協(xié)議是十分有...
FPGA具有豐富的硬件計(jì)算單元以及分布式并行內(nèi)存,其他芯片只有非常有限的計(jì)算資源,比如CPU只有幾個(gè)高性能ALU,另外其他芯片一般使用一個(gè)共享內(nèi)存,在任...
Zynq UltraScale+ MPSoC的多媒體功能和搭配其的處理引擎
針對(duì) UHD-4K 集成了支持 H.264/H.265 的視頻編解碼器單元,適用但不僅僅適用于監(jiān)控、視頻會(huì)議、嵌入式視覺和一些廣播應(yīng)用等領(lǐng)域,實(shí)現(xiàn)低時(shí)延...
作者:Olivier Tremois(AI 引擎工具市場(chǎng)營銷部門)和 Florent Werbrouck(賽靈思技術(shù)支持產(chǎn)品應(yīng)用工程師) Versal ...
基于FPGA的視頻圖像畫面分割器的軟硬件設(shè)計(jì)與實(shí)現(xiàn)
隨著計(jì)算機(jī)、DSP、超大規(guī)模集成電路等技術(shù)的發(fā)展,畫面分割器開始采用硬件設(shè)計(jì)。首先,將各路視頻信號(hào)轉(zhuǎn)換成數(shù)字視頻信號(hào);然后,在數(shù)字領(lǐng)域?qū)Ω髀芬曨l信號(hào)進(jìn)行...
PLC(可編程邏輯控制器)是一種常用于工業(yè)自動(dòng)化領(lǐng)域的控制器設(shè)備,它能夠?qū)ιa(chǎn)過程進(jìn)行精細(xì)的控制和管理。在PLC的程序設(shè)計(jì)過程中,梯形圖是一種常用的...
即使在微調(diào)模式下,步進(jìn)電動(dòng)機(jī)的一個(gè)問題就是在啟動(dòng)和停止時(shí)它的輸出存在振動(dòng),盡管在很多應(yīng)用中這不算是個(gè)問題,但是如果我們處理像玻璃器皿這樣的精致物品時(shí)就是...
2019-08-21 標(biāo)簽:電動(dòng)機(jī)可編程邏輯功率控制器 4.1k 0
在 SDSoC 中啟動(dòng) Trace 后,事件追蹤功能就會(huì)被自動(dòng)插入到軟件代碼和硬件 IP 中。然后,硬件部分(包括完成事件追蹤功能的監(jiān)控 IP)經(jīng)過綜合...
Zynq UltraScale+ MPSoC存儲(chǔ)器接口系統(tǒng)的介紹
該視頻重點(diǎn)介紹了UltraScale +產(chǎn)品系列的第一個(gè)成員Zynq?UltraScale+?MPSoC,并展示了使用可編程邏輯中的DDR4 SDRAM...
SPLD(可編程邏輯器件)的應(yīng)用場(chǎng)景
SPLD可以用于實(shí)現(xiàn)各種數(shù)字邏輯功能,如計(jì)數(shù)器、寄存器、加法器等。由于其具有靈活的編程能力,可以方便地實(shí)現(xiàn)各種組合邏輯和時(shí)序邏輯電路。
2024-02-02 標(biāo)簽:數(shù)字信號(hào)處理可編程邏輯可編程邏輯器件 4k 0
采用CS1系列PLC實(shí)現(xiàn)糧庫生產(chǎn)路徑控制
糧庫的設(shè)備多,生產(chǎn)路徑多,用一般PLC編制程序顯得繁雜而累贅。PLC主要是指數(shù)字運(yùn)算操作電子系統(tǒng)的可編程邏輯控制器,用于控制機(jī)械的生產(chǎn)過程。也是公共有限...
了解Xilinx。 我們是全球領(lǐng)先的All Programmable FPGA,SoC和3D IC供應(yīng)商。
賽靈思的 SDAccel 開發(fā)環(huán)境為 FPGA 提供軟件應(yīng)用設(shè)計(jì)流程
在 FPGA 設(shè)計(jì)方面,設(shè)計(jì)人員能夠?yàn)檫\(yùn)行特定工作負(fù)載開發(fā)自己的處理架構(gòu)。FPGA 的一大重要優(yōu)勢(shì)就是能夠根據(jù)特定系統(tǒng)需求定制架構(gòu),但這不利于 FPGA...
通過采用CPLD芯片實(shí)現(xiàn)對(duì)MOSFET器件電路的保護(hù)設(shè)計(jì)
功率MOSFET最初是從MOS集成電路發(fā)展起來的,它通過增加源漏橫向距離提高器件耐壓,從而實(shí)現(xiàn)集成電路中高壓驅(qū)動(dòng)[1].功率MOSFET已大量應(yīng)用于電力...
如圖所示為由PGA103構(gòu)成的可編程增益儀表放大電路。該電路采用PGA205與PGA103的級(jí)聯(lián)方式,因此放大器總的增益為兩個(gè)放大器增益之積,即G=G1...
2018-06-15 標(biāo)簽:電路設(shè)計(jì)模擬設(shè)計(jì)可編程邏輯 3.9k 0
如何使用Xilinx SDSoC構(gòu)建電氣驅(qū)動(dòng)器
了解如何使用SDSoC從C ++源代碼創(chuàng)建完整的電氣驅(qū)動(dòng)器示例設(shè)計(jì)*。您的算法改變了嗎?此外,視頻還將展示如何編輯源代碼,并重新構(gòu)建設(shè)計(jì),以獲得電機(jī)的不...
2018-11-27 標(biāo)簽:驅(qū)動(dòng)器賽靈思可編程邏輯 3.8k 0
使用可編程邏輯控制器的Zynq-7000 All Programmable SoC
此視頻演示重點(diǎn)介紹Zynq-7000 All Programmable SoC,該SoC配置為嵌入式PLC,通過以太網(wǎng)Powerlink管理設(shè)備。
【自適應(yīng)計(jì)算在機(jī)器人領(lǐng)域的應(yīng)用】連載六:自適應(yīng)計(jì)算平臺(tái)實(shí)現(xiàn)ROS之路
由于機(jī)器人行為建立在 ROS 節(jié)點(diǎn)交互的結(jié)果之上,因此用于這個(gè)用途的加速器通過從總體上減少 ROS 和 ROS 2 計(jì)算圖數(shù)據(jù)流,顯著影響總時(shí)延。
版圖驗(yàn)證工具不僅要支持扁平化驗(yàn)證,而且要支持層次化驗(yàn)證。扁平化驗(yàn)證是版圖驗(yàn)證工具的基礎(chǔ);層次化驗(yàn)證充分利用版圖層次,可以有效避免重復(fù)報(bào)錯(cuò)和提高處理版圖的...
關(guān)于可編程邏輯推動(dòng)基于MCU的設(shè)計(jì)的分析和應(yīng)用
FPGA架構(gòu)與ASIC類似,但與CPLD差異巨大。一個(gè)通用的FPGA架構(gòu)包括配置邏輯塊(CLB)陣列、I / O焊盤和可編程互連,如圖3所示。加入了時(shí)鐘...
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