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FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點。
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基于Turbo碼編譯碼算法的FPGA實現(xiàn)突發(fā)數(shù)據(jù)通信
Turbo碼是一種低信噪比條件下也能達到優(yōu)異糾錯性能的信道編碼。早期為了強調(diào)Turbo碼接近香農(nóng)限的優(yōu)異性能,研究的碼字長度非常大[1~2],存在譯碼...
在數(shù)字設計中,利用FIFO進行數(shù)據(jù)處理是非常普遍的應用,例如,實現(xiàn)時鐘域交叉、低延時存儲器緩存、總線位寬調(diào)整等。下圖給出了FIFO生成器支持的一種可能配置。
管腳是FPGA重要的資源之一,F(xiàn)PGA的管腳分別包括,電源管腳,普通I/O,配置管腳,時鐘專用輸入管腳GCLK等。
Spartan-3A DSP達芬奇開發(fā)套件的主要特性及應用
安富利公司的達芬奇數(shù)字視頻開發(fā)平臺采用了Xilinx公司的3SD1800A-FG676 FPGA和TI公司的TMS320DM6437“達芬奇” DSP,...
本文主要介紹了一種基于DSP+FPGA的實時圖像去霧增強系統(tǒng)設計,F(xiàn)PGA通常作為一種調(diào)度使用,圖像處理算法實現(xiàn)主要靠高速處理信號處理芯片DSP完成,在...
GDDR6給FPGA帶來的大帶寬存儲優(yōu)勢以及性能測試
IDC預測,全球數(shù)據(jù)總量將從2019年的45ZB增長到2025年的175ZB[1]。同時,全球數(shù)據(jù)中近30%將需要實時處理,因而帶來了對FPGA等硬件數(shù)...
此次培訓涉及到器件的AES加密、JTAG安全,以及唯一ID安全特性和減小SEU等特性。
基于Xilinx System Generator設計平臺快速構建PID算法以及完成硬件實現(xiàn)過程詳解
Xilinx System Generator 是專門為數(shù)字信號算法處理而推出的模型化設計平臺,可以快速、簡單地將DSP系統(tǒng)的抽象算法轉(zhuǎn)換成可綜合的、...
基于FPGA的大屏幕LED單色圖文顯示屏控制系統(tǒng)
LED大屏幕顯示系統(tǒng)由上位機(PC機)、單片機系統(tǒng)、FPGA控制器、LED顯示屏的行列驅(qū)動電路等模塊組成,如圖1所示。上位機負責漢字、字符等數(shù)據(jù)的采集與...
FPGA的設計中,一個前級模塊A向下游模塊B發(fā)送數(shù)據(jù),如下圖所示,當下游模塊B不能及時處理數(shù)據(jù)時,希望前級模塊A停止發(fā)送數(shù)據(jù),這個時候模塊B會通過一個反...
利用FPGA+DSP相配合的全景視覺系統(tǒng)方案設計詳解
基于單相機的全景視覺系統(tǒng)是利用凸面鏡反射四周圖像進行定位,在計算資源有限時是一種較好的選擇,且視覺導航等方向的應用也成為一種最實用的方法,這種方案雖然...
您是否需要不斷提供越來越多的設計功能,同時還要跟上新標準的變化,降低成本和功耗?請觀看這一新的7分鐘視頻,看看在我們具有高端功能的低成本收發(fā)器FPGA—...
UltraScale FPGA器件中PCIe Gen3模塊的性能演示
查看UltraScale FPGA中集成的PCIe Gen3模塊的性能演示。 第一個演示顯示了PCIe鏈路上的最大數(shù)據(jù)吞吐量; demo#2利用現(xiàn)...
在FPGA設計中,時序約束對于電路性能和可靠性非常重要。在上一篇的文章中,已經(jīng)詳細介紹了FPGA時序約束的主時鐘約束。
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