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標(biāo)簽 > fpga
FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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正點(diǎn)原子開拓者FPGA視頻:觸摸按鍵控制LED實(shí)驗(yàn)
觸摸按鍵是多媒體技術(shù)的新應(yīng)用。而且觸摸按鍵擁有堅(jiān)固耐用,節(jié)省空間,操作方便等優(yōu)點(diǎn)。具體來說,觸摸按鍵可以分為四大類 電阻 式, 電容 式,表面聲波感應(yīng)按...
自適應(yīng)比特率( ABR )縮放和高密度轉(zhuǎn)碼的挑戰(zhàn)與解決方案
憑借對內(nèi)容分發(fā)網(wǎng)絡(luò)所面臨挑戰(zhàn)的深刻理解,賽靈思推出了一款能夠出色應(yīng)對上述挑戰(zhàn)的解決方案——賽靈思 U30 軟件開發(fā)者套件( SDK )。
FPGA工程師不得不知的FPGA設(shè)計(jì)經(jīng)驗(yàn)
在IC工業(yè)中有許多不同的領(lǐng)域,IC設(shè)計(jì)者的特征也會(huì)有些不同。在A領(lǐng)域的一個(gè)好的IC設(shè)計(jì)者也許會(huì)花很長時(shí)間去熟悉B領(lǐng)域的知識。在我們職業(yè)生涯的開始,我們應(yīng)...
2014-02-11 標(biāo)簽:FPGA 3.4k 0
采用Altera Stratix II EP2S60器件實(shí)現(xiàn)SoC系統(tǒng)的FPGA實(shí)時(shí)驗(yàn)證
隨著硅片集成技術(shù)的高速發(fā)展,片上系統(tǒng)SoC(system-on-a-Chip)已經(jīng)成為現(xiàn)代數(shù)字系統(tǒng)設(shè)計(jì)的必然趨勢。SoC和一般數(shù)字系統(tǒng)最主要的區(qū)別是前者...
首先,文章使用GPU最擅長處理的工作負(fù)載:通用矩陣乘(GEMM)來跑GPU的benchmark(什么是GEMM請移步https://spatial-la...
Zynq7000系列引腳的分類是確定的,而各類引腳的數(shù)目則因芯片封裝的不同而不同,(為了便于理解,本文所列引腳數(shù)目皆以XQ7Z045 FFG900封裝為...
車規(guī)級芯片封裝技術(shù)發(fā)展及典型流程解讀
按功能種類劃分,車規(guī)級半導(dǎo)體大致可分為主控/計(jì)算類芯片(MCU、CPU、FPGA、ASIC和AI芯片等)、功率半導(dǎo)體(IGBT和MOSFET)、傳感器(...
現(xiàn)場可編程邏輯陣列的一種可編程“萬用”芯片--FPGA
高云半導(dǎo)體科技股份有限公司在上海發(fā)布了一款具有中國自主知識產(chǎn)權(quán)的FPGA芯片及配套平臺化產(chǎn)品,這也是中資公司收購美國FPGA廠商萊迪斯(Lattice)...
2018-01-22 標(biāo)簽:fpga 3.4k 0
眾所周知,軟件如ARM、DSP、單片機(jī)等是按照代碼的順序,一步一步串行執(zhí)行的,通過使用斷點(diǎn)、打印LOG等方法,順序地檢查每步的執(zhí)行結(jié)果,就能找到問題,因...
從C 到 matlab 到 FPGA,如何實(shí)現(xiàn)CNN的項(xiàng)目
經(jīng)過了前面的開胃菜,項(xiàng)目正式開始。一步步講解這個(gè)模型怎么玩起來的。從C 到 matlab 到 FPGA ,三個(gè)平臺聯(lián)合起來完成這個(gè) 由 RTL 實(shí)現(xiàn) C...
2022-03-15 標(biāo)簽:fpga數(shù)據(jù)代碼 3.4k 0
FPGA的出現(xiàn)大大縮短了集成電路設(shè)計(jì)的周期,使產(chǎn)品上市的時(shí)間大大縮短,并減少了設(shè)計(jì)成本。FPGA的應(yīng)用越來越廣泛,并且其市場份額也越來越大。但是逐漸擴(kuò)大...
采用TPS6211X電源轉(zhuǎn)換器件的手持式電子設(shè)備設(shè)計(jì)
在手持設(shè)備中,為了獲得較高的總功率,很多系統(tǒng)的電池電壓都在7 V之上,如7.2 V,9 V,12 V等?;诖?,德州儀器(TI)推出了支持3.1~17 ...
神經(jīng)網(wǎng)絡(luò)專用硬件實(shí)現(xiàn)的方法和技術(shù)
神經(jīng)網(wǎng)絡(luò)專用硬件實(shí)現(xiàn)是人工智能領(lǐng)域的一個(gè)重要研究方向,旨在通過設(shè)計(jì)專門的硬件來加速神經(jīng)網(wǎng)絡(luò)的訓(xùn)練和推理過程,提高計(jì)算效率和能效比。以下將詳細(xì)介紹神經(jīng)網(wǎng)絡(luò)...
2024-07-15 標(biāo)簽:FPGA神經(jīng)網(wǎng)絡(luò)人工智能 3.4k 0
對于FPGA工程師除了日常的調(diào)試工作以外,批量生產(chǎn)時(shí)候指導(dǎo)生成人員下載我們生成的固化文件也是我們的工作,所以今天講一講FPGA單獨(dú)下載<固化文件&...
采用以FPGA為控制器核心實(shí)現(xiàn)多功能輸液節(jié)制系統(tǒng)設(shè)計(jì)
今朝,病院輸液現(xiàn)場一般是人工節(jié)制和看管,但輸液速度和輸液量是一個(gè)很難切確把握的值,護(hù)士經(jīng)由過程動(dòng)彈輸液器上的手動(dòng)輪來節(jié)制輸液速度,并經(jīng)由過程肉眼不雅察看...
流水線的工作方式就象工業(yè)生產(chǎn)上的裝配流水線。在CPU中由5—6個(gè)不同功能的電路單元組成一條指令處理流水線,然后將一條X86指令分成5—6步后再由這些電路...
Vivado設(shè)計(jì)中生成VPSS時(shí)出現(xiàn)的常見問題解析
在 Vivado 設(shè)計(jì)中,最重要的是要看來自 VPSS 的復(fù)位信號(該信號控制上游 (TPG) 和下游 (AXI4S 到視頻輸出) IP)。
2020-12-04 標(biāo)簽:fpgausb操作系統(tǒng) 3.4k 0
深入淺出玩轉(zhuǎn)FPGA視頻:SRAM讀寫實(shí)驗(yàn)
SRAM具有較高的性能,但是SRAM也有它的缺點(diǎn),即它的集成度較低,功耗較DRAM大,相同容量的DRAM內(nèi)存可以設(shè)計(jì)為較小的體積,但是SRAM卻需要很大...
過采樣技術(shù)是數(shù)字信號處理者用來提高模數(shù)轉(zhuǎn)換器(ADC)性能經(jīng)常使用的方法之一,它通過減小量化噪聲,提高ADC的信噪比,從而提高ADC的有效分辨率[1]。...
2018-12-19 標(biāo)簽:fpgaFPGA設(shè)計(jì)Cyclone 3.4k 0
基于RFID技術(shù)與FPGA技術(shù)相結(jié)合實(shí)現(xiàn)閱讀器的設(shè)計(jì)
RFID 系統(tǒng)由閱讀器(Reader),電子標(biāo)簽( Tag) 和后臺數(shù)據(jù)庫組成 ,見圖1。閱讀器從附著在物品上的Tag中讀取數(shù)據(jù),這些數(shù)據(jù)在閱讀器或送給...
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