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標(biāo)簽 > fpga
FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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基于FPGA的彩色TFT-LCD控制電路設(shè)計及其ASIC實現(xiàn)
通過彩色液晶顯示器(LCD)取景是數(shù)碼相機(jī)優(yōu)于傳統(tǒng)相機(jī)的重要特性之一,它解決了使用取景框取景帶來的各種不便,而且可以在拍攝現(xiàn)場用液晶顯示器回放剛拍的相片...
深入淺出玩轉(zhuǎn)FPGA視頻:DIY數(shù)碼相框
數(shù)碼相框就是一個相框,不過它不再用放進(jìn)相片的方式來展示,而是通過一個液晶的屏幕顯示,它可以通過讀卡器的接口從SD卡獲取相片,并設(shè)置循環(huán)顯示的方式,比普通...
基于FPGA通過link口加載TigerSHARC信號處理系統(tǒng)的設(shè)計
TigerSHARC系列處理器是ADI公司推出的高性能數(shù)字信號處理器,包含ADSP TS101、ADSP TS201、ADSP TS202、ADSP T...
2019-04-19 標(biāo)簽:處理器fpga數(shù)字信號處理 3k 0
這里提到的局部重配置技術(shù)(Partial Reconfiguration) 是現(xiàn)場可編程門陣列(呵呵,就是FPGA了) 器件中的一部分。指的是在FPGA...
FPGA的組成結(jié)構(gòu)及優(yōu)缺點(diǎn)介紹
EEVBlog是一個講解電子設(shè)計相關(guān)知識的視頻博客,主播Dave Jones居住在澳大利亞的悉尼。這期視頻Dave Jones講解了FPGA的大致組成結(jié)...
FPGA實現(xiàn)基于SPI協(xié)議的Flash驅(qū)動控制芯片擦除
本篇博客具體包括SPI協(xié)議的基本原理、模式選擇以及時序邏輯要求,采用FPGA(EPCE4),通過SPI通信協(xié)議,對flash(W25Q16BV)存儲的固...
2025-12-02 標(biāo)簽:FPGAFlaShSPI協(xié)議 3k 0
利用IBERT IP核實現(xiàn)GTX收發(fā)器硬件誤碼率測試實例
通過IBERT我們可以獲取誤碼率,觀察眼圖,調(diào)節(jié)串行收發(fā)器的參數(shù),從而有助于判斷可能存在的問題,便于驗證硬件的穩(wěn)定性和信號完整性。
使用FPGA終端創(chuàng)建應(yīng)用程序前,必須創(chuàng)建一個LabVIEW項目。然后添加FPGA終端至該項目并創(chuàng)建FPGA VI。
友晶DE25-Nano開發(fā)板Uboot階段與FPGA外設(shè)交互失敗
近日測試友晶官網(wǎng)提供的de25_nano_revA_sdcard_console_v1.1.zip鏡像(下載地址:https://www.terasic...
基于FPGA的采集卡的圖像增強(qiáng)算法應(yīng)用研究
本文首先對圖像采集卡系統(tǒng)的組成、整體方案和可行性進(jìn)行了論證,然后給出了圖像采集卡的硬件設(shè)計。用VHDL和原理圖結(jié)合的方法對FPGA進(jìn)行編程,實現(xiàn)了圖像采...
Nios Ⅱ處理器具有完善的軟件開發(fā)套件,包括編譯器、集成開發(fā)環(huán)境(IDE)、JTAG調(diào)試器、實時操作系統(tǒng)(RTOS)和TCP/IP協(xié)議棧。設(shè)計者能夠用...
該培訓(xùn)視頻涵蓋了SDAccel RTL內(nèi)核向?qū)?,并詳?xì)介紹了打包RTL設(shè)計,構(gòu)建FPGA設(shè)計和生成Amazon FPGA映像(AFI)所涉及的步驟。
使用SDAccel和RTL內(nèi)核在AWS F1上進(jìn)行開發(fā)(4-1)
該視頻概述了F1和SDAccel,使您可以了解AWS F1 HW和SW堆棧。 觀看此視頻,以深入了解從RTL加速器創(chuàng)建Amazon FPGA映像(AF...
整數(shù)在 IEEE 的規(guī)定上有短整數(shù) short integer , 中整數(shù) integer 和 長整數(shù) long integer
FPGA(Field-ProgrammableGateArray),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)...
Altera FPGA 的PIO IP當(dāng)中bidir和inout選項的區(qū)別
? PIO IP是FPGA 設(shè)計中比較簡單常用的IP, 當(dāng)設(shè)置PIO IP的Direction的時候,可以看到有如下4個選項: Input代表這組IO是...
深入淺出玩轉(zhuǎn)FPGA視頻:SF-EP1C開發(fā)板介紹
SF-EP1C開發(fā)板有著比較豐富的外設(shè),也給用戶預(yù)留了一些可擴(kuò)展的接口。FPGA使用EP1C3T144C8,硬件電路充分考慮了可升級性,該板子同樣適用于...
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