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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。

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全部技術資訊資料帖子視頻產(chǎn)品方案企業(yè) FPGA選型

fpga技術

介紹了解 SoC FPGA功耗問題與未來發(fā)展路線（5）

SoC FPGA系統(tǒng)成本功耗和未來發(fā)展路線

2018-06-22 標簽：fpga altera 功耗 3.8k 0

計數(shù)器占空比80%的輸出控制LED的閃爍

LED點亮占20%時間。使用計數(shù)器產(chǎn)生占空比為80%的輸出，然后控制LED。

2018-06-22 標簽：fpga led altera 7.1k 0

使用FPGA DIY開發(fā)板控制LED燈每間隔1S循環(huán)閃爍

LED間隔1s循環(huán)閃爍。使用取反操作進行。

2018-06-22 標簽：fpga led altera 1.0萬 0

由FPGA DIY開發(fā)板控制蜂鳴器發(fā)出響聲

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2018-06-22 標簽：fpga altera diy 4.9k 0

由FPGA DITY開發(fā)板實現(xiàn)數(shù)碼管模六十計數(shù)器的循環(huán)顯示

數(shù)碼管顯示0到60，每隔0.5s加1.采用動態(tài)掃描方式。如此循環(huán)知道世界末日。

2018-06-22 標簽：fpga altera 計數(shù)器 4.4k 0

LCD1602 滾動顯示功能

zwsheng 的 LCD1602 滾動視頻。

2018-06-22 標簽：fpga altera diy 6.6k 0

關于拔河游戲機的設計

zwsheng 的拔河游戲機視頻。

2018-06-22 標簽：fpga altera diy 6.6k 0

關于 SoC FPGA 解決方案的演講

Fujisoft公司在Altera SoC合作伙伴研討會上演講的主題：Fujisoft Android SoC FPGA解決方案

2018-06-26 標簽：fpga soc altera 3.6k 0

Cyclone V SoC開發(fā)套件特點的展示

該演示由Altera全球合作伙伴Embest提供。展示Altera Cyclone V SoC上雙核ARM Cortex-A9的強大處理能力，以及片上F...

2018-06-26 標簽：fpga 顯示器 arm 4.4k 0

了解100G Interlaken解決方案及使用Stratix IV GT版10G收發(fā)器

您需要密度非常高、性能非常好的器件來實現(xiàn)100G固網(wǎng)應用嗎?請觀看這一x分鐘的新視頻，了解40-nm Stratix IV GT FPGA的設計優(yōu)勢。您...

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2018-06-22 標簽：fpga altera 廣播系統(tǒng) 4.1k 0

FPGA如何與DDR3存儲器進行正確的數(shù)據(jù)對接?

大家好，我叫Paul Evans，是Stratix III產(chǎn)品營銷經(jīng)理。到目前為止，我已經(jīng)從事了6年的雙倍數(shù)據(jù)速率存儲器工作，今天和大家一起討論一下DD...

2018-06-22 標簽：fpga ddr3 存儲器 9.7k 0

采用FPGA DIY開發(fā)板設計數(shù)字時鐘顯示

數(shù)字時鐘。數(shù)碼管顯示時、分、秒，按鍵S1、S2分別對小時進行加、減；S3、S4分別對分進行加10、加1；S5、S6分別對秒進行加10、加1；S8是復位鍵。

2018-06-22 標簽：fpga altera diy 4.2k 0

了解分析Stratix IV GX的特點

Altera新的Stratix? IV GX版收發(fā)器信號完整性開發(fā)套件支持對收發(fā)器互操作性和SERDES信號完整性進行全面評估。觀看5分鐘視頻，...

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40-nm收發(fā)器FPGA和ASIC系列的特點

您意識到對高速收發(fā)器、更高的數(shù)據(jù)速率和帶寬的需求越來越強烈了嗎? 您是否希望“以少勝多”呢? 請觀看這一新視頻，了解全系列收發(fā)器FPGA和ASIC怎樣滿...

2018-06-22 標簽：fpga 收發(fā)器 altera 3.9k 0

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Are you interested in the new generation of high-speed ADCs with serial inte...

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2018-06-22 標簽：fpga 嵌入式系統(tǒng)altera 5.5k 0

如何設計讓Stratix III FPGAs 的消耗比 VITEX-5 的更小

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