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標(biāo)簽 > fpga
FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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如何使用FPGA對(duì)系統(tǒng)設(shè)計(jì)實(shí)現(xiàn)有效管理
隨著工藝幾何尺寸越來(lái)越小,電子器件趨向于采用多種電壓供電,因此越來(lái)越易受到電壓和溫度波動(dòng)的影響,而且在所有電子系統(tǒng)設(shè)計(jì)中進(jìn)行系統(tǒng)管理的重要性也不斷增強(qiáng)。...
基于可編程邏輯器件實(shí)現(xiàn)汽車微控制器的方案設(shè)計(jì)
微控制器在汽車和消費(fèi)類市場(chǎng)上得到了廣泛應(yīng)用,能夠以相對(duì)較低的成本實(shí)現(xiàn)系統(tǒng)高度集成。然而,這類產(chǎn)品也有潛在的成本問(wèn)題。例如,如果元件功能不符合要求,就必須...
FPGA采用了邏輯單元陣列LCA(Logic Cell Array)這樣一個(gè)概念,內(nèi)部包括可配置邏輯模塊CLB、輸出輸入模塊IOB和內(nèi)部連線三個(gè)部分。現(xiàn)...
FPGA設(shè)計(jì):為什么要做同步設(shè)計(jì)?
同步設(shè)計(jì):。 上游數(shù)據(jù)到下游邏輯單元的傳遞是通過(guò)時(shí)鐘來(lái)同步的 -只要能滿足時(shí)延要求,就可以確保下游邏輯單元能正確采樣到_上游數(shù)據(jù)。
2022-11-08 標(biāo)簽:fpga同步設(shè)計(jì) 889 0
在數(shù)字系統(tǒng)設(shè)計(jì)中,我們傳統(tǒng)上都認(rèn)為,應(yīng)該對(duì)所有的觸發(fā)器設(shè)置一個(gè)主復(fù)位,這樣將大大方便后續(xù)的測(cè)試工作。
2022-10-13 標(biāo)簽:fpga觸發(fā)器復(fù)位信號(hào) 889 0
耐輻射低壓降穩(wěn)壓器 (LDO) 是許多航天級(jí)子系統(tǒng)(包括現(xiàn)場(chǎng)可編程門陣列 (FPGA)、數(shù)據(jù)轉(zhuǎn)換器和模擬電路)的重要電源元件。LDO 有助于確保為性能取...
2023-03-16 標(biāo)簽:fpga轉(zhuǎn)換器穩(wěn)壓器 887 0
基于FPGA 構(gòu)建一個(gè)提供瞬時(shí)啟動(dòng)功能的單芯片解決方案
采用 FPGA 實(shí)現(xiàn)視頻監(jiān)控系統(tǒng)具有許多優(yōu)點(diǎn),包括 FPGA 加速 DSP 處理的功能。非易失性 FPGA 可以使 FPGA 在視頻監(jiān)控?cái)z像系統(tǒng)實(shí)現(xiàn)中更...
異步電路的邏輯核心是用組合邏輯電路實(shí)現(xiàn),比如異步的FIFO/RAM讀寫信號(hào),地址譯碼等電路。電路的主要信號(hào)、輸出信號(hào)等并不依賴于任何一個(gè)時(shí)鐘性信號(hào),不是...
verilogHDL用于FPGA設(shè)計(jì)時(shí)的知識(shí)點(diǎn)匯總
里面ChatGPT的回答,第一章作為基礎(chǔ)部分,就一筆帶過(guò)了。主要就是一些器件介紹,語(yǔ)法和設(shè)計(jì)方法,這部分也是最容易掌握的部分。
2023-06-29 標(biāo)簽:fpga數(shù)字設(shè)計(jì)VerilogHDL 876 0
基于FPGA的多核嵌入式系統(tǒng)的設(shè)計(jì)
隨著嵌入式器件在過(guò)去數(shù)十年來(lái)的爆炸性成長(zhǎng),使得硬件組件及軟件工具都有顯著的改善。雖然有著這種成長(zhǎng)與創(chuàng)新,但傳統(tǒng)嵌入式系統(tǒng)的設(shè)計(jì)方法卻少有進(jìn)步,并逐漸變成...
一種基于FPGA的通用位元電路設(shè)計(jì)全面解析
FPGA (Field Programmable Gate Array), 即現(xiàn)場(chǎng)可編程邏輯門陣列,是當(dāng)今集成電路半定制設(shè)計(jì)中的重要組成部分,具有結(jié)構(gòu)...
2018-07-13 標(biāo)簽:FPGA 875 0
《文匯報(bào)》專訪報(bào)道:芯驛電子AUMO為自動(dòng)駕駛多場(chǎng)景提供應(yīng)變解決方案
? 文匯報(bào)“小荷尖尖 民企爭(zhēng)先”系列報(bào)道,將視線投向民企方陣中“小荷才露尖尖角”的新生代、經(jīng)濟(jì)舞臺(tái)上奔赴高光時(shí)刻的候場(chǎng)者,看他們?nèi)绾螑燮磿?huì)贏,踏浪潮頭。...
2025-08-12 標(biāo)簽:FPGA自動(dòng)駕駛 875 0
【VPX650 】青翼凌云科技基于 VPX 系統(tǒng)架構(gòu)的 VU13P FPGA+ZYNQ SOC 超寬帶信號(hào)處理平臺(tái)
VPX650 是一款基于 6U VPX 系統(tǒng)架構(gòu)的 VU13P FPGA + XC7Z100 SOC 超寬帶信號(hào)處理平臺(tái),該平臺(tái)采用一片 Xilinx...
自行科技智能電子外后視鏡系統(tǒng)產(chǎn)品優(yōu)勢(shì)
為駕駛員提供更高清、更廣闊的車外后視野影像并集成豐富的AI主動(dòng)安全功能,提高駕駛安全性,讓行車更安全、更舒適。
事實(shí)上,MCU對(duì)有些任務(wù)來(lái)說(shuō)是很適合的,但對(duì)其它一些任務(wù)來(lái)說(shuō)可能做的并不好。舉例來(lái)說(shuō),當(dāng)需要并行執(zhí)行大量計(jì)算任務(wù)時(shí),F(xiàn)PGA可能會(huì)讓你喜出望外。
FPGA時(shí)序約束:如何查看具體錯(cuò)誤的時(shí)序路徑
時(shí)間裕量包括建立時(shí)間裕量和保持時(shí)間裕量(setup slack和hold slack)。從字面上理解,所謂“裕量”即富余的、多出的。
在友晶DE1-SOC開發(fā)板實(shí)現(xiàn)數(shù)獨(dú)謎題求解器
數(shù)獨(dú)游戲是一種廣受歡迎的數(shù)學(xué)游戲。在其基本且被廣泛認(rèn)可的形式中,數(shù)獨(dú)包含一個(gè) 9 × 9 的網(wǎng)格,其中某些方格已填入數(shù)字。該游戲的目的是通過(guò)填入剩余的方...
基于FPGA和IP Core的定制緩沖管理的實(shí)現(xiàn)
隨著通信協(xié)議的發(fā)展及多樣化,協(xié)議處理部分PE在硬件轉(zhuǎn)發(fā)實(shí)現(xiàn)方面,普遍采用現(xiàn)有的商用芯片NP(Network Processor,網(wǎng)絡(luò)處理器)來(lái)完成,流量...
采用非易失FPGA器件在視頻監(jiān)控系統(tǒng)中的靈活性實(shí)現(xiàn)方案
視頻監(jiān)控和安全行業(yè)正在經(jīng)歷著一場(chǎng)巨大的變革,正在從傳統(tǒng)的模擬閉路電視攝像機(jī)向基于邏輯的數(shù)字?jǐn)z像機(jī)的方向發(fā)展。更高的視頻分辨率、圖像信號(hào)處理、先進(jìn)的視頻分...
2020-08-10 標(biāo)簽:傳感器fpga視頻監(jiān)控 865 0
假如我們不明確這一點(diǎn),當(dāng)改好代碼,增加完的新的feature,跑 testbench 發(fā)現(xiàn)仿真失敗了,我們沒(méi)法知道是原來(lái)就有的bug還是新加入的代碼導(dǎo)致...
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