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FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門(mén)陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門(mén)電路數(shù)有限的缺點(diǎn)。
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基于FPGA進(jìn)行高速可變周期脈沖發(fā)生器設(shè)計(jì)
要求改變脈沖周期和輸出脈沖個(gè)數(shù)的脈沖輸出電路模塊在許多工業(yè)領(lǐng)域都有運(yùn)用。采用數(shù)字器件設(shè)計(jì)周期和輸出個(gè)數(shù)可調(diào)節(jié)的脈沖發(fā)生模塊是方便可行的。為了使之具有高速...
如何用FPGA實(shí)現(xiàn)原型板原理圖的驗(yàn)證
首次流片成功取決于整個(gè)系統(tǒng)硬件和相關(guān)軟件的驗(yàn)證,有些公司提供的快速原型生成平臺(tái)具有許多調(diào)試功能,但這些平臺(tái)的價(jià)格非常高。
2011-01-18 標(biāo)簽:FPGA 1.4k 0
數(shù)字圖像空域?yàn)V波算法的FPGA設(shè)計(jì)與實(shí)現(xiàn)
本文采用的圖像是256×256大小的灰度圖像,濾波模板3×3大小。如何設(shè)計(jì)硬件電路來(lái)完成上述空域?yàn)V波算法,分析上述算法實(shí)現(xiàn)過(guò)程,可以得出結(jié)論,實(shí)現(xiàn)空域?yàn)V...
系統(tǒng)設(shè)計(jì)人員高度渴望擁有可擴(kuò)展的能夠適應(yīng)性能需求潛在變化以及能夠執(zhí)行高性能數(shù)據(jù)處理的架構(gòu)。而在FPGA內(nèi)部實(shí)施的控制平面/數(shù)據(jù)平面處理架構(gòu)就能夠有效滿足...
基于FPGA的LTE系統(tǒng)中轉(zhuǎn)換預(yù)編碼的設(shè)計(jì)
在比較已有FFT實(shí)現(xiàn)方法的基礎(chǔ)上,提出一種基于FPGA的通用FFT處理器的設(shè)計(jì)方案。這種FFT實(shí)現(xiàn)結(jié)構(gòu)根據(jù)不同的輸入數(shù)據(jù)長(zhǎng)度動(dòng)態(tài)配置成相應(yīng)的處理器,可以...
2011-01-16 標(biāo)簽:FPGA預(yù)編碼LTE系統(tǒng) 1.4k 0
基于FPGA視頻采集中的I2C總線設(shè)計(jì)與實(shí)現(xiàn)
在JPEG2000系統(tǒng)下,視頻采集系統(tǒng)是視頻采集功能的FPGA(現(xiàn)場(chǎng)可編程門(mén)陣列)前端系統(tǒng),是視頻圖像處理、應(yīng)用的前項(xiàng)通道。作為視頻采集系統(tǒng)的重要組成部...
基于FPGA實(shí)現(xiàn)多路模擬信號(hào)自適應(yīng)采集系統(tǒng)
本文提供的方式有效地解決了這個(gè)問(wèn)題,既簡(jiǎn)化了前端信號(hào)調(diào)理電路的復(fù)雜度,又充分利用了A/D轉(zhuǎn)換器的輸入電壓動(dòng)態(tài)范圍和量化位數(shù)優(yōu)勢(shì),實(shí)現(xiàn)了對(duì)多路模擬信號(hào)的自...
2011-01-14 標(biāo)簽:fpga 2.1k 0
航管二次監(jiān)視雷達(dá)地面詢問(wèn)編碼器的FPGA設(shè)計(jì)
在航管體系中,常規(guī)模式及S模式技術(shù)用于監(jiān)視功能,建立在獨(dú)立編址,選擇詢問(wèn)的基礎(chǔ)之上,信息交換是通過(guò)將上行詢問(wèn)內(nèi)容和下行應(yīng)答內(nèi)容進(jìn)行脈沖編碼實(shí)現(xiàn)。
FPGA在智能壓力傳感器系統(tǒng)中的應(yīng)用設(shè)計(jì)
傳統(tǒng)氣體壓力測(cè)量?jī)x器的傳感器部分與數(shù)據(jù)采集系統(tǒng)是分離的,抗干擾的能力較差,并且通常被測(cè)對(duì)象的壓力變化較快。因此不僅要求系統(tǒng)具有較快的數(shù)據(jù)吞吐速率,而且要...
基于VHDL的自動(dòng)售貨機(jī)控制模塊FPGA實(shí)現(xiàn)
本文采用VHDL作為工具描述了自動(dòng)售貨機(jī)控制模塊的邏輯控制電路,并在FPGA上實(shí)現(xiàn)。該自動(dòng)售貨機(jī)能夠根據(jù)投入硬幣額度,按預(yù)定的要求在投入硬幣大于規(guī)定值時(shí)...
基于VHDL和FPGA的非對(duì)稱同步FIFO設(shè)計(jì)實(shí)現(xiàn)
本文采用VHDL描述語(yǔ)言,充分利用Xilinx公司Spartan II FPGA的系統(tǒng)資源,設(shè)計(jì)實(shí)現(xiàn)了一種非對(duì)稱同步FIFO,它不僅提供數(shù)據(jù)緩沖,而且能...
Cadence Incisive技術(shù)提升FPGA/ASIC設(shè)計(jì)效率
Cadence設(shè)計(jì)系統(tǒng)公司600多種新功能擴(kuò)展了指標(biāo)驅(qū)動(dòng)型驗(yàn)證(MDV)的范圍,幫助工程師實(shí)現(xiàn)更快、更全面的驗(yàn)證閉合與硅實(shí)現(xiàn)。
賽靈思2011年CES消費(fèi)電子展相關(guān)信息發(fā)布
賽靈思將推出深受行業(yè)歡迎的 Spartan?-6 FPGA 消費(fèi)視頻套件的新版產(chǎn)品,為消費(fèi)電子系統(tǒng)設(shè)計(jì)人員提供一套完整的開(kāi)發(fā)平臺(tái),讓他們輕松應(yīng)用FPGA...
Verilog HDL與VHDL及FPGA的比較分析. Verilog HDL優(yōu)點(diǎn):類(lèi)似C語(yǔ)言,上手容易,靈活。大小寫(xiě)敏感。在寫(xiě)激勵(lì)和建模方面有優(yōu)勢(shì)。
2011-01-11 標(biāo)簽:FPGAVHDLVerilog HDL 1.7k 0
采用混合信號(hào)FPGA實(shí)現(xiàn)智能化熱管理
引言 傳統(tǒng)上,人們一直采用熱敏電阻、熱耦或分離式溫度測(cè)量芯片來(lái)測(cè)量系統(tǒng)溫度。而且,隨著系統(tǒng)速度越
越來(lái)越多的消費(fèi)應(yīng)用開(kāi)始在設(shè)計(jì)中集成流式視頻,結(jié)果引入了許多標(biāo)準(zhǔn)和專有的加密算法。但是加密方案以及實(shí)現(xiàn)方法不統(tǒng)一導(dǎo)致視頻接收設(shè)備在設(shè)計(jì)和支持方面存在巨大的挑戰(zhàn)
基于FPGA的μC/OS-II任務(wù)管理硬件設(shè)計(jì)
實(shí)時(shí)操作系統(tǒng)RTOS(Real Time Operating System)由于具有調(diào)度的實(shí)時(shí)性、響應(yīng)時(shí)間的可確定性、系統(tǒng)高度的可靠性等特點(diǎn),被越來(lái)
為了滿足同步時(shí)序設(shè)計(jì)的要求,一般在FPGA設(shè)計(jì)中采用全局時(shí)鐘資源驅(qū)動(dòng)設(shè)計(jì)的主時(shí)鐘,以達(dá)到最低的時(shí)鐘抖動(dòng)和延遲。 FPGA全局時(shí)鐘資源一般使用全銅層工藝實(shí)...
車(chē)用FPGA在賽車(chē)引擎控制單元中的應(yīng)用
基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限,汽車(chē)
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