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FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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FIFO是FPGA項(xiàng)目中使用最多的IP核,一個(gè)項(xiàng)目使用幾個(gè),甚至是幾十個(gè)FIFO都是很正常的。通常情況下,每個(gè)FIFO的參數(shù),特別是位寬和深度,是不同的。
公開課上,石侃老師主要從FPGA的發(fā)展簡史、FPGA與云數(shù)據(jù)中心、FPGA與人工智能、FPGA的新開發(fā)方法和FPGA的學(xué)術(shù)動(dòng)態(tài)五個(gè)方面進(jìn)行重點(diǎn)介紹,重點(diǎn)...
基于FPGA的SATAll協(xié)議結(jié)構(gòu)層中的物理層設(shè)計(jì)與實(shí)現(xiàn)
SATA作為一種高速串行, 點(diǎn)對(duì)點(diǎn)傳輸?shù)挠脖P接口, 已取代了IDE 硬盤接口。 目前在硬盤中使用較為普遍的是 SATAII 和SATAIII, 其線速率...
利用基于SystemC/TLM的方法學(xué)進(jìn)行IP開發(fā)和FPGA
利用基于SystemC/TLM的方法學(xué)進(jìn)行IP開發(fā)和FPGA建模 隨著系統(tǒng)級(jí)芯片技術(shù)的出現(xiàn),設(shè)計(jì)規(guī)模正變得越來越大,因而變得非常復(fù)雜,同時(shí)上市時(shí)間也變...
2010-01-04 標(biāo)簽:fpga 5.9k 0
創(chuàng)新30年,從Altera那里學(xué)到什么?
FPGA工程師,你說你用Altera公司的FPGA開發(fā)板用了那么多年,Quartus II 軟件用得那么順手。你居然說你不了解Altera公司?!趕緊進(jìn)...
基于FPGA的PEX8311的LBS控制器的實(shí)現(xiàn)
PLX的一款橋芯片PEX8311可將標(biāo)準(zhǔn)處理器,本文就是基于PEX8311和FPGA來實(shí)現(xiàn)PCIe標(biāo)準(zhǔn)1x傳輸。
寫在AMD收購賽靈思之后,國產(chǎn)FPGA廠商的結(jié)局早已注定?
電子發(fā)燒友網(wǎng)報(bào)道(文/吳子鵬)2015年12月29日,當(dāng)英特爾正式宣布以167億美元完成對(duì)Altera收購時(shí),大部分半導(dǎo)體從業(yè)者都有一個(gè)疑問,那就是英特...
那些你不知道的半導(dǎo)體行業(yè)“潛規(guī)則”
所謂的半導(dǎo)體行業(yè)中存在的潛規(guī)則,即預(yù)定的日程計(jì)劃總不能如期完成,卻又總總會(huì)制定不合理的日程安排。本文中提到的“角落里的大象”指的就是這一現(xiàn)象。 縱所周知...
LGA6167 處理器支持LGA4189-4 版本接口(Socket P4)
這么龐大的接口顯然可以支持更高級(jí)的特性,比如八通道 DDR4 內(nèi)存,比如 PCIe 4.0,還有可能集成 OmniPath 高速通道和板載 FPGA,甚...
2015年6月1日,英特爾與Altera宣布,雙方已達(dá)成最終協(xié)議,根據(jù)該協(xié)議,英特爾將以167億美元的價(jià)格收購Altera。這是FPGA行業(yè)的一個(gè)重要里...
Xilinx FPGA平臺(tái)DDR3設(shè)計(jì)保姆式教程(一)
DDR3全稱double-data-rate 3 synchronous dynamic RAM,即第三代雙倍速率同步動(dòng)態(tài)隨機(jī)存儲(chǔ)器。所謂同步,是指DD...
用FPGA的鎖相環(huán)PLL給外圍芯片提供時(shí)鐘
用FPGA的鎖相環(huán)PLL給外圍芯片提供時(shí)鐘 FPGA鎖相環(huán)PLL(Phase-Locked Loop)是一種廣泛使用的時(shí)鐘管理電路,可以對(duì)輸入時(shí)鐘信號(hào)進(jìn)...
FPGA中的晶振大小多少比較合適?為什么會(huì)用到兩個(gè)晶振?
FPGA中的晶振大小多少比較合適?為什么會(huì)用到兩個(gè)晶振 FPGA (Field-Programmable Gate Array) 是一種可編程邏輯芯片,...
FPGA/CPLD中常見模塊設(shè)計(jì)精華集錦(一)
數(shù)字鎖相環(huán)路已在數(shù)字通信、無線電電子學(xué)及電力系統(tǒng)自動(dòng)化等領(lǐng)域中得到了極為廣泛的應(yīng)用。隨著集成電路技術(shù)的發(fā)展,不僅能夠制成頻率較高的單片集成鎖相環(huán)路,...
采用SDR技術(shù)將會(huì)加速LTE行動(dòng)裝置上市開發(fā)時(shí)程,并實(shí)現(xiàn)全球漫游。而在基地臺(tái)端的進(jìn)展,以目前最熱門的Cloud RAN或是稱作Centralized-R...
ARM崛起和后Altera時(shí)代 賽靈思的未來之路任重而道遠(yuǎn)
英特爾和Altera傳出收購消息以后,分分合合好幾次。導(dǎo)致我買的股票上漲了5美元,我獎(jiǎng)勵(lì)自己吃了一頓麥當(dāng)勞,但是這些消息對(duì)于被收購前的Altera可能更有價(jià)值。
Verilog 例化說明 1.什么是模塊例化?為什么要例化? 模塊例化可以理解成模塊調(diào)用。對(duì)于一個(gè) FPGA 工程,通常是由一個(gè)頂層模塊與多個(gè)功能子模塊...
2022-12-12 標(biāo)簽:fpga 5.8k 0
FPGA、Verilog HDL與VHDL的優(yōu)缺點(diǎn)
Verilog HDL 優(yōu)點(diǎn):類似C語言,上手容易,靈活。大小寫敏感。在寫激勵(lì)和建模方面有優(yōu)勢(shì)。 缺點(diǎn):很多錯(cuò)誤在編譯的時(shí)候不能被發(fā)現(xiàn)。 VHDL 優(yōu)點(diǎn)...
FPGA、ASIC將在機(jī)器學(xué)習(xí)領(lǐng)域崛起
盡管GPU仍是當(dāng)前的機(jī)器學(xué)習(xí)市場的主流,但有產(chǎn)業(yè)觀察家已經(jīng)預(yù)見了FPGA、ASIC在機(jī)器學(xué)習(xí)領(lǐng)域的崛起。Deloitte Global分析指出,F(xiàn)PGA...
2018-01-06 標(biāo)簽:fpgaasic機(jī)器學(xué)習(xí) 5.8k 0
使用Xilinx可編程邏輯實(shí)現(xiàn)數(shù)據(jù)中心互連
隨著實(shí)施基于云的服務(wù)和機(jī)器到機(jī)器通信所產(chǎn)生的數(shù)據(jù)呈指數(shù)級(jí)增長,數(shù)據(jù)中心面臨重重挑戰(zhàn)。這種增長毫無減緩態(tài)勢(shì),有業(yè)界專家預(yù)測內(nèi)部數(shù)據(jù)中心機(jī)器對(duì)機(jī)器流量將會(huì)超...
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