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      verilog語言

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      verilog語言技術(shù)

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      2023-08-14 標(biāo)簽：fpga邏輯電路寄存器 2.4k 0

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      本以為ChatGPT對于IC后端設(shè)計幫助應(yīng)該不大，畢竟它非常依賴EDA工具，它對于EDA工具這種非常專業(yè)的、非常Custom的東西了解和訓(xùn)練的數(shù)據(jù)應(yīng)該不...

      2023-03-07 標(biāo)簽：EDA工具Verilog語言VHDL源碼 2.4k 0

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      要通過寫測試文件來檢驗函數(shù)的正確與否。這樣的方法不僅在matlab中有效，對于c、verilog等語言都有效。

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      2023-10-20 標(biāo)簽：仿真器Verilog語言 2.3k 0

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      SystemC是基于C++的系統(tǒng)級設(shè)計語言，兼具描述硬件電路模型和面向?qū)ο蟮某橄竽芰Α?/p>

      2023-08-07 標(biāo)簽：芯片設(shè)計仿真器C語言 2.3k 0

      SystemVerilog中class是什么意思

      class，是面向?qū)ο缶幊蹋╫bject-oriented programming (OOP)）的基礎(chǔ)，而OOP可以讓你創(chuàng)建更高抽象級別的驗證環(huán)境(如UVM)。

      2022-11-14 標(biāo)簽：UVMOOPVerilog語言 2.3k 0

      時序邏輯的時鐘到Q傳播和建立/保持時間

      數(shù)字門級電路可分為兩大類：組合邏輯和時序邏輯。鎖存器是組合邏輯和時序邏輯的一個交叉點，在后面會作為單獨的主題處理。

      2023-02-12 標(biāo)簽：fpgaasicRTL 2.3k 0

      寫出一個包含觸發(fā)器和多路選擇器的子模塊

      我們用3個包含觸發(fā)器和多路選擇器的子模塊來實現(xiàn)圖中電路。題目要求我們寫出包含一個觸發(fā)器和一個多路選擇器的子模塊。

      2022-11-17 標(biāo)簽：時序電路觸發(fā)器Verilog語言 2.2k 0

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      2023-06-20 標(biāo)簽：計數(shù)器Verilog語言DUT 2.2k 0

      SystemVerilog中的tagged Unions是什么

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      2022-11-10 標(biāo)簽：仿真器Verilog語言 2.2k 0

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      兩個N位二進(jìn)制數(shù)x、y的乘積用簡單的方法計算就是利用移位操作來實現(xiàn)。

      2023-06-21 標(biāo)簽：FPGA設(shè)計HDL乘法器 2.1k 0

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      2023-08-21 標(biāo)簽：仿真器Verilog語言 2.1k 0

      verilog/systemverilog中隱藏的初始化說明

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      在Verilog和SystemVerilog中經(jīng)常需要在使用變量或者線網(wǎng)之前，期望變量和線網(wǎng)有對應(yīng)的初始值

      2023-08-25 標(biāo)簽：仿真器VaRVerilog語言 2.1k 0

      教你如何寫出性能更高的SystemVerilog代碼

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      本文旨在幫助大家降低在編碼過程中寫出低性能和耗內(nèi)存的概率，只要大家在寫代碼時稍注意下，積少成多。

      2023-07-26 標(biāo)簽：編碼器計數(shù)器運算器 2.1k 0

      verilog語法基礎(chǔ)知識

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      判定循環(huán)執(zhí)行條件，若為假則跳出循環(huán)；若為真，則執(zhí)行指定語句后，轉(zhuǎn)到第三步

      2023-07-08 標(biāo)簽：存儲器二進(jìn)制Verilog語言 2.1k 0

      聊聊Systemverilog中的function in constraints

      有些情況下，constraint不能簡單用一行來表達(dá)，而是需要復(fù)雜的計算，如果都寫到constraint block內(nèi)部就比較復(fù)雜，而且很亂，這時候可以...

      2023-06-21 標(biāo)簽：Verilog語言求解器 2.1k 0

      列舉一下有趣的Systemverilog數(shù)組約束示例

      上面是最先想到的寫法，但是會報錯，因為SV約束語法不允許使用size()或任何其他隨機值作為索引。

      2023-05-04 標(biāo)簽：Verilog語言 2.1k 0

      soc中的組合邏輯和時序邏輯應(yīng)用說明

      芯片設(shè)計是現(xiàn)代電子設(shè)備的重要組成部分，其中組合邏輯和時序邏輯是芯片設(shè)計中非常重要的概念。組合邏輯和時序邏輯的設(shè)計對于構(gòu)建復(fù)雜的電路系統(tǒng)至關(guān)重要。

      2023-08-30 標(biāo)簽：芯片邏輯電路soc 2.1k 0

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        IoT是Internet of Things的縮寫，字面翻譯是“物體組成的因特網(wǎng)”，準(zhǔn)確的翻譯應(yīng)該為“物聯(lián)網(wǎng)”。物聯(lián)網(wǎng)（Internet of Things）又稱傳感網(wǎng)，簡要講就是互聯(lián)網(wǎng)從人向物的延伸。
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      • STM32F103C8T6
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        UHD是”超高清“的意思UHD的應(yīng)用在電視機技術(shù)上最為普遍，目前已有不少廠商推出了UHD超高清電視。
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        +關(guān)注
        Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機及外圍器件。
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        STC12C5A60S2
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        循跡小車
        +關(guān)注
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      • 光模塊
        光模塊
        +關(guān)注
        光模塊(optical module)由光電子器件、功能電路和光接口等組成，光電子器件包括發(fā)射和接收兩部分。簡單的說，光模塊的作用就是光電轉(zhuǎn)換，發(fā)送端把電信號轉(zhuǎn)換成光信號，通過光纖傳送后，接收端再把光信號轉(zhuǎn)換成電信號。
      • Nexperia
        Nexperia
        +關(guān)注
        Nexperia是大批量生產(chǎn)基本半導(dǎo)體的領(lǐng)先專家，這些半導(dǎo)體是世界上每個電子設(shè)計都需要的組件。該公司廣泛的產(chǎn)品組合包括二極管、雙極晶體管、ESD 保護(hù)器件、MOSFET、GaN FET 以及模擬和邏輯IC。
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        +關(guān)注
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      • TMS320F28335
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        靜電防護(hù)
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