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Vitis Model Composer 是一款 Xilinx 工具包，支持在 MATALB? 和 Simulink? 環(huán)境中進(jìn)行快速設(shè)計(jì)探索和驗(yàn)證，并加速 Xilinx 器件的量產(chǎn)。

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Vitis簡(jiǎn)介

　　Vitis Model Composer 是一款 Xilinx 工具包，支持在 MATALB? 和 Simulink? 環(huán)境中進(jìn)行快速設(shè)計(jì)探索和驗(yàn)證，并加速 Xilinx 器件的量產(chǎn)。

　　使用針對(duì) AI 引擎和可編程邏輯的優(yōu)化模塊，創(chuàng)建設(shè)計(jì)。可視化仿真結(jié)果并對(duì)其進(jìn)行分析，然后將得出的結(jié)果與使用 MALTAB? 和 Simulink? 生成的黃金參考進(jìn)行比較。

　　無縫協(xié)同仿真 AI 引擎及可編程邏輯（HLS、HDL）模塊。
　　自動(dòng)生成代碼（AI 引擎數(shù)據(jù)流程圖、RTL、HLS C++）及設(shè)計(jì)測(cè)試臺(tái)。
　　在硬件驗(yàn)證設(shè)計(jì)，具有與無與倫比的易用性。

　　Vitis 統(tǒng)一軟件平臺(tái)包括：

　　全面的內(nèi)核開發(fā)套件，可無縫構(gòu)建加速的應(yīng)用
　　完整的硬件加速開源庫，針對(duì) Xilinx FPGA 和 Versal ACAP 硬件平臺(tái)進(jìn)行了優(yōu)化
　　插入特定領(lǐng)域的開發(fā)環(huán)境，可直接在熟悉的更高層次框架中進(jìn)行開發(fā)
　　不斷發(fā)展的硬件加速合作伙伴庫和預(yù)建應(yīng)用生態(tài)系統(tǒng)
　　Vitis Model Composer 是一款基于模型的設(shè)計(jì)工具，支持在 MathWorks MATALB? 和 Simulink? 環(huán)境中進(jìn)行快速設(shè)計(jì)探索和驗(yàn)證，并加速 Xilinx 器件的量產(chǎn)。
　　Vitis Networking P4 允許創(chuàng)建軟定義網(wǎng)絡(luò)。VitisNetP4 數(shù)據(jù)平面構(gòu)建器生成的系統(tǒng)可以針對(duì)從簡(jiǎn)單的數(shù)據(jù)包分類到復(fù)雜的數(shù)據(jù)包編輯的各種數(shù)據(jù)包處理功能進(jìn)行編程。

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74LS00

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74LS00是一個(gè)內(nèi)部擁有四個(gè)獨(dú)立的二輸入與非門電路，它滿足與非門的邏輯功能，可以實(shí)現(xiàn)與非門的邏輯功能。共有54/7400、54/74H00、54/74S00、54/74LS00。54XXX

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